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1. 发明专利

TW201814529A 通過爬坡之動態快取分割审中-公开
简体标题：通过爬坡之动态缓存分割
公开(公告)号：TW201814529A
公开(公告)日：2018-04-16
申请号：TW106131116
申请日：2017-09-12
申请人：美商高通公司 , QUALCOMM INCORPORATED
发明人：艾爾雪伊克瑞米莫漢麥德 A , AL SHEIKH, RAMI MOHAMMAD A. , 坎哈洛德韋德三世 , CAIN, HAROLD WADE III
IPC分类号： G06F12/02 , G06F13/16
CPC分类号： G06F12/0848 , G06F12/0811 , G06F12/084 , G06F12/0842 , G06F12/0846 , G06F12/0864 , G06F12/123 , G06F12/128 , G06F2212/1044 , G06F2212/282 , G06F2212/314 , G06F2212/502 , G06F2212/69
摘要：本發明揭示用於動態地分割一共用快取記憶體之系統及方法，其包括動態地判定與經組態以存取該共用快取記憶體之兩個或多於兩個處理器中之每一者相關聯之一機率。基於針對一處理器之該機率而依據針對該處理器之一第一快取行的在該共用快取記憶體中之一未命中將該第一快取行插入於與該共用快取記憶體相關聯之一最近最少使用(LRU)堆疊之一最近最多使用(MRU)位置中。基於針對該處理器之該機率而依據針對一第二快取行的在該共用快取記憶體中之一命中將該第二快取行升階至該LRU堆疊之該MRU位置。基於爬坡而判定針對該處理器之該機率，其中縮減該機率之波動，防止局部最大值，且防止該機率降至低於一臨限值。
简体摘要：本发明揭示用于动态地分割一共享高速缓存之系统及方法，其包括动态地判定与经组态以存取该共享高速缓存之两个或多于两个处理器中之每一者相关联之一概率。基于针对一处理器之该概率而依据针对该处理器之一第一缓存行的在该共享高速缓存中之一未命中将该第一缓存行插入于与该共享高速缓存相关联之一最近最少使用(LRU)堆栈之一最近最多使用(MRU)位置中。基于针对该处理器之该概率而依据针对一第二缓存行的在该共享高速缓存中之一命中将该第二缓存行升阶至该LRU堆栈之该MRU位置。基于爬坡而判定针对该处理器之该概率，其中缩减该概率之波动，防止局部最大值，且防止该概率降至低于一临限值。

2. 发明专利

TWI576760B 微處理器及其管理性能和功率消耗的方法有权
简体标题：微处理器及其管理性能和功率消耗的方法
公开(公告)号：TWI576760B
公开(公告)日：2017-04-01
申请号：TW103143425
申请日：2014-12-12
申请人：上海兆芯集成電路有限公司 , VIA ALLIANCE SEMICONDUCTOR CO., LTD.
发明人：亨利 G 葛蘭 , HENRY, G. GLENN , 嘉斯金斯史蒂芬 , GASKINS, STEPHAN
IPC分类号： G06F5/06 , G06F1/32
CPC分类号： G06F12/0891 , G06F1/3243 , G06F9/50 , G06F12/0842 , G06F12/0864 , G06F12/0893 , G06F2212/6082 , Y02D10/152 , Y02D50/20

3. 发明专利

TW201710908A 用於記憶體管理單元之多執行緒轉換及異動重新排序审中-公开
简体标题：用于内存管理单元之多线程转换及异动重新排序
公开(公告)号：TW201710908A
公开(公告)日：2017-03-16
申请号：TW105115829
申请日：2016-05-20
申请人：高通公司 , QUALCOMM INCORPORATED
发明人：波戴瑪傑森愛德華 , PODAIMA, JASON EDWARD , 韋爾辛斯基保羅克里斯多福約翰 , WIERCIENSKI, PAUL CHRISTOPHER JOHN , 摩瑞拉卡洛斯賈維爾 , MOREIRA, CARLOS JAVIER , 米瑞特斯基艾力山德 , MIRETSKY, ALEXANDER , 法里亞梅格霍爾 , VARIA, MEGHAL , 艾默溫凱爾約翰 , ERNEWEIN, KYLE JOHN , 索瑪桑達嵐曼諾坎桑 , SOMASUNDARAM, MANOKANTHAN , 喬德里穆瀚麥德烏瑪爾 , CHOUDRY, MUHAMMAD UMAR , 葛戴爾雷伯瑟瑞格默尼爾 , GADELRAB, SERAG MONIER
IPC分类号： G06F12/08 , G06F12/10
CPC分类号： G06F12/1063 , G06F12/0806 , G06F12/0842 , G06F12/0844 , G06F12/0891 , G06F12/1009 , G06F12/1036 , G06F2212/1024 , G06F2212/50 , G06F2212/655 , G06F2212/682 , G06F2212/683 , G06F2212/684
摘要：系統及方法係關於在一多執行緒記憶體管理單元(MMU)中執行位址轉譯。兩個或兩個以上位址轉譯請求可由該多執行緒MMU接收且被並行地處理以擷取至一系統記憶體之位址的位址轉譯。若該等位址轉譯存在於該多執行緒MMU之一轉譯快取記憶體中，則可自該轉譯快取記憶體接收該等位址轉譯且將其排程以用於使用該等經轉譯位址存取該系統記憶體。若該轉譯快取記憶體中存在一遺漏，則可在兩個或兩個以上轉譯表查核行程中並行地排程兩個或兩個以上位址轉譯請求。
简体摘要：系统及方法系关于在一多线程内存管理单元(MMU)中运行位址转译。两个或两个以上位址转译请求可由该多线程MMU接收且被并行地处理以截取至一系统内存之位址的位址转译。若该等位址转译存在于该多线程MMU之一转译高速缓存中，则可自该转译高速缓存接收该等位址转译且将其调度以用于使用该等经转译位址存取该系统内存。若该转译高速缓存中存在一遗漏，则可在两个或两个以上转译表查核行程中并行地调度两个或两个以上位址转译请求。

4. 发明专利

TWI560545B 在程式偵測時動態更新硬體預取特性爲互斥或共享的裝置與方法有权
简体标题：在进程侦测时动态更新硬件预取特性为互斥或共享的设备与方法
公开(公告)号：TWI560545B
公开(公告)日：2016-12-01
申请号：TW104134317
申请日：2015-10-20
申请人：威盛電子股份有限公司 , VIA TECHNOLOGIES, INC.
发明人：虎克羅德尼E , HOOKER, RODNEY E. , 婁坡艾伯特J , LOPER, ALBERT J. , 吉爾約翰麥可 , GREER, JOHN MICHAEL
IPC分类号： G06F12/02 , G06F12/08 , G06F3/06
CPC分类号： G06F9/30047 , G06F3/061 , G06F3/0629 , G06F3/0673 , G06F9/30109 , G06F9/3802 , G06F12/0831 , G06F12/084 , G06F12/0842 , G06F12/0862 , G06F2212/1016 , G06F2212/452 , G06F2212/6022 , G06F2212/6024

5. 发明专利

TW201620284A 基於快取一致性之控制方法审中-公开
简体标题：基于缓存一致性之控制方法
公开(公告)号：TW201620284A
公开(公告)日：2016-06-01
申请号：TW103142546
申请日：2014-12-05
申请人：上海兆芯集成電路有限公司 , VIA ALLIANCE SEMICONDUCTOR CO., LTD.
发明人：賴瑾 , LAI, JIIN , 楊夢晨 , YANG, MENG-CHEN
IPC分类号： H04L29/10 , G06F13/16
CPC分类号： H04L67/2857 , G06F9/4856 , G06F12/0813 , G06F12/0815 , G06F12/0842 , G06F15/163 , G06F2212/1016 , H04L67/1095
摘要：本發明提供了一種基於快取一致性之控制方法包括：當一第一電子裝置藉由一快取一致性介面耦接至一第二電子裝置時，藉由上述第一電子裝置發送一連結請求至上述第二電子裝置；根據上述連結請求，藉由上述快取一致性介面，建立上述第一電子裝置和上述第二電子裝置之一連結；以及上述連結建立後，藉由上述第二電子裝置之一第二處理單元經由上述快取一致性介面存取上述第一電子裝置之一第一快取記憶體單元。
简体摘要：本发明提供了一种基于缓存一致性之控制方法包括：当一第一电子设备借由一缓存一致性界面耦接至一第二电子设备时，借由上述第一电子设备发送一链接请求至上述第二电子设备；根据上述链接请求，借由上述缓存一致性界面，创建上述第一电子设备和上述第二电子设备之一链接；以及上述链接创建后，借由上述第二电子设备之一第二处理单元经由上述缓存一致性界面存取上述第一电子设备之一第一高速缓存单元。

6. 发明专利

TWI531912B 具有用於多上下文計算引擎的轉譯後備緩衝之處理器、用於致能多執行緒以存取於處理器中之資源之系統和方法有权
简体标题：具有用于多上下文计算发动机的转译后备缓冲之处理器、用于致能多线程以存取于处理器中之资源之系统和方法
公开(公告)号：TWI531912B
公开(公告)日：2016-05-01
申请号：TW101147788
申请日：2012-12-17
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：羅南朗尼 , RONEN, RONNY , 琴斯伯格波里斯 , GINZBURG, BORIS , 威斯曼伊萊瑟 , WEISSMANN, ELIEZER , 維塞那森卡西基恩 , VAITHIANATHAN, KARTHIKEYAN
IPC分类号： G06F15/80 , G06F9/38 , G06F9/46
CPC分类号： G06F12/1027 , G06F12/0806 , G06F12/0842 , G06F12/1009 , G06F12/1036 , G06F2212/1016 , G06F2212/65 , G06F2212/68 , G06F2212/683 , G06F2212/684

7. 发明专利

TWI498811B 分段式快取記憶體有权
简体标题：分段式高速缓存
公开(公告)号：TWI498811B
公开(公告)日：2015-09-01
申请号：TW101139719
申请日：2012-10-26
申请人：惠普發展公司有限責任合夥企業 , HEWLETT-PACKARD DEVELOPMENT COMPANY, L. P.
发明人：湯瑪斯三世弗瑞德C , THOMAS III, FRED CHARLES , 賈思帕德瓦特A , GASPARD, WALTER A. , 索契W , SO, CHI W.
IPC分类号： G06F5/06 , G06F12/02
CPC分类号： G06F12/0246 , G06F12/0802 , G06F12/0842 , G06F12/0871 , G06F12/0891 , G06F12/126 , G06F2212/222 , G06F2212/6042 , G06F2212/7205 , Y02D10/13

8. 发明专利

TW201530428A 微處理器及其管理性能和功率消耗的方法审中-公开
简体标题：微处理器及其管理性能和功率消耗的方法
公开(公告)号：TW201530428A
公开(公告)日：2015-08-01
申请号：TW103143425
申请日：2014-12-12
申请人：上海兆芯集成電路有限公司 , VIA ALLIANCE SEMICONDUCTOR CO., LTD.
发明人：亨利 G 葛蘭 , HENRY, G. GLENN , 嘉斯金斯史蒂芬 , GASKINS, STEPHAN
IPC分类号： G06F5/06 , G06F1/32
CPC分类号： G06F12/0891 , G06F1/3243 , G06F9/50 , G06F12/0842 , G06F12/0864 , G06F12/0893 , G06F2212/6082 , Y02D10/152 , Y02D50/20
摘要：一種微處理器包括快取記憶體和控制模組。所述控制模組使得快取記憶體的尺寸變為零，並且隨後使得快取記憶體的尺寸在零和快取記憶體的全尺寸之間，在使得所述尺寸在零和全尺寸之間之後，對從快取記憶體逐出的數量進行計數，以及當逐出的數量達到逐出的預定數量時，增加所述尺寸。替代地，微處理器包括：多個核，其每個都具有第一快取記憶體；由核共用的第二快取記憶體；以及控制模組。所述控制模組使得所有的核睡眠，並且使得第二快取記憶體的尺寸變為零，並且接收喚醒所述核中的一個的命令。所述控制模組在接收所述命令之後，對從喚醒的核的第一快取記憶體逐出的數量進行計數，並且當逐出的數量達到逐出的預定數量時，使得所述第二快取記憶體的尺寸變為非零。
简体摘要：一种微处理器包括高速缓存和控制模块。所述控制模块使得高速缓存的尺寸变为零，并且随后使得高速缓存的尺寸在零和高速缓存的全尺寸之间，在使得所述尺寸在零和全尺寸之间之后，对从高速缓存逐出的数量进行计数，以及当逐出的数量达到逐出的预定数量时，增加所述尺寸。替代地，微处理器包括：多个核，其每个都具有第一高速缓存；由核共享的第二高速缓存；以及控制模块。所述控制模块使得所有的核睡眠，并且使得第二高速缓存的尺寸变为零，并且接收唤醒所述核中的一个的命令。所述控制模块在接收所述命令之后，对从唤醒的核的第一高速缓存逐出的数量进行计数，并且当逐出的数量达到逐出的预定数量时，使得所述第二高速缓存的尺寸变为非零。

9. 发明专利

TW201346567A 結構存取處理器、方法、系統及指令失效
简体标题：结构存取处理器、方法、系统及指令
公开(公告)号：TW201346567A
公开(公告)日：2013-11-16
申请号：TW101149051
申请日：2012-12-21
申请人：英特爾公司 , INTEL CORPORATION
发明人：蒙娜里卡麥隆B , MCNAIRY, CAMERON B.
IPC分类号： G06F13/14 , G06F9/06 , G06F9/30
CPC分类号： G06F15/76 , G06F9/3004 , G06F9/30047 , G06F9/30076 , G06F9/30105 , G06F9/3824 , G06F11/1064 , G06F12/0842 , G06F12/0846 , G06F12/0875 , G06F2015/765 , G06F2212/452
摘要：一種態樣之方法，該方法可回應於一或多個結構存取指令而獲執行，該方法包括將一處理器之一結構的一部分之一狀態改變為一隱退狀態。在該隱退狀態中，該處理器之組件不能存取該結構之該部分，但能夠存取該結構之一或多個其他部分。當該結構之該部分處於該隱退狀態中時，可修改該結構之該部分中的非架構可見資料。在該結構之該部分中之該非架構可見資料已獲修改之後，該結構之該部分的該狀態接著自該隱退狀態改變為一非隱退狀態。本案亦揭示其他方法、設備、系統及指令。
简体摘要：一种态样之方法，该方法可回应于一或多个结构存取指令而获运行，该方法包括将一处理器之一结构的一部分之一状态改变为一隐退状态。在该隐退状态中，该处理器之组件不能存取该结构之该部分，但能够存取该结构之一或多个其他部分。当该结构之该部分处于该隐退状态中时，可修改该结构之该部分中的非架构可见数据。在该结构之该部分中之该非架构可见数据已获修改之后，该结构之该部分的该状态接着自该隐退状态改变为一非隐退状态。本案亦揭示其他方法、设备、系统及指令。

10. 发明专利

TW201211777A 用於操控經發佈至資料處理設備內局部快取記憶體結構之存取操作的設備與方法 APPARATUS AND METHOD FOR HANDLING ACCESS OPERATIONS ISSUED TO LOCAL CACHE STRUCTURES WITHIN A DATA PROCESSING APPARATUS 审中-公开
简体标题：用于操控经发布至数据处理设备内局部高速缓存结构之存取操作的设备与方法 APPARATUS AND METHOD FOR HANDLING ACCESS OPERATIONS ISSUED TO LOCAL CACHE STRUCTURES WITHIN A DATA PROCESSING APPARATUS
公开(公告)号：TW201211777A
公开(公告)日：2012-03-16
申请号：TW100116884
申请日：2011-05-13
申请人： ARM股份有限公司
发明人：皮瑞弗雷德里克克勞德瑪麗 , 穆桐路易斯瑪利耶文森 , 斯卡拉比諾盧卡
IPC分类号： G06F
CPC分类号： G06F12/0842 , G06F9/52 , G06F12/0808 , G06F12/0831 , G06F12/0837 , G06F12/1027
摘要：茲揭示一種用於操控經發佈(issue)至資料處理設備內局部快取記憶體結構之存取操作的設備與方法。該資料處理設備包含複數個處理單元，每一處理單元具有與該處理單元相關聯之局部快取記憶體結構。亦揭示共享存取協調電路系統(coordination circuitry)以協調經發佈至任一局部快取記憶體結構之共享存取操作的操控。對共享存取操作而言，與局部快取記憶體結構相關聯之存取控制電路系統將對該局部快取記憶體結構執行局部存取操作，該共享快取記憶體操作係發佈至該局部快取記憶體結構，且存取控制電路系統另外將向共享存取協調電路系統發佈共享存取訊號。對局部存取操作而言，存取控制電路系統通常將在相關聯之局部快取記憶體結構上執行局部存取操作，且不通知共享存取協調電路系統。然而，若已設定存取操作擴充值(extension value)，則存取控制電路系統將此種局部存取操作視為共享存取操作。即使在作業系統及/或應用程式自一個處理單元遷移至另一處理單元之後，此種方法亦確保正確操作。
简体摘要：兹揭示一种用于操控经发布(issue)至数据处理设备内局部高速缓存结构之存取操作的设备与方法。该数据处理设备包含复数个处理单元，每一处理单元具有与该处理单元相关联之局部高速缓存结构。亦揭示共享存取协调电路系统(coordination circuitry)以协调经发布至任一局部高速缓存结构之共享存取操作的操控。对共享存取操作而言，与局部高速缓存结构相关联之存取控制电路系统将对该局部高速缓存结构运行局部存取操作，该共享高速缓存操作系发布至该局部高速缓存结构，且存取控制电路系统另外将向共享存取协调电路系统发布共享存取信号。对局部存取操作而言，存取控制电路系统通常将在相关联之局部高速缓存结构上运行局部存取操作，且不通知共享存取协调电路系统。然而，若已设置存取操作扩充值(extension value)，则存取控制电路系统将此种局部存取操作视为共享存取操作。即使在操作系统及/或应用进程自一个处理单元迁移至另一处理单元之后，此种方法亦确保正确操作。

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