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    • 1. 发明申请
    • 半導体装置
    • 半导体器件
    • WO2011162116A1
    • 2011-12-29
    • PCT/JP2011/063461
    • 2011-06-13
    • 太陽誘電株式会社石黒 隆佐藤 正幸弘中 哲夫稲木 雅人嶋崎 等
    • 石黒 隆佐藤 正幸弘中 哲夫稲木 雅人嶋崎 等
    • H03K19/173
    • G11C8/10G11C7/00H03K19/1776H03K19/17796
    • 【課題】所望の論理回路を構成する記憶素子ブロックの総量を減らすことを図る。 【解決手段】N(Nは、2以上の整数)本のアドレス線と、N本のデータ線と、複数の記憶部であって、各記憶部は、前記N本のアドレス線から入力されるアドレスをデコードしてワード線にワード選択信号を出力するアドレスデコーダと、前記ワード線とデータ線に接続し、真理値表を構成するデータをそれぞれ記憶し、前記ワード線から入力される前記ワード選択信号により、前記データを前記データ線に入出力する複数の記憶素子を有する、複数の記憶部と、を備え、前記記憶部のN本のアドレス線は、前記記憶部の他のN個の記憶部のデータ線に、それぞれ接続するとともに、前記記憶部のN本のデータ線は、前記記憶部の他のN個の記憶部のアドレス線に、それぞれ接続する半導体装置が提供される。
    • 公开了旨在减少构成期望的逻辑电路的存储元件块的总数的半导体器件。 半导体器件包括N条地址线(N是等于2或更大的整数),N条数据线和多条存储部分。 每个存储部分包括地址解码器,用于对通过N个地址线提供的地址进行解码,以将字选择信号输出到字线; 以及连接到字线和数据线的多个存储元件,每个存储元件存储构成真值表的数据,并且经由数据线经由字线提供的字选择信号来输入或输出数据。 半导体器件适于使用于存储部分的N个地址线连接到其他N个存储部分的相应数据线,而用于存储部分的N个数据线连接到其他N的各个地址线 存储部分。
    • 3. 发明申请
    • 半導体装置
    • 半导体器件
    • WO2007060763A1
    • 2007-05-31
    • PCT/JP2006/313502
    • 2006-07-06
    • ジェネシス・テクノロジー株式会社佐藤 正幸
    • 佐藤 正幸
    • H03K19/173G11C29/00H01L21/82
    • H03K19/1776H03K19/17728
    •  本発明に係る半導体装置110は、所定量のデータを記憶するメモリセルを複数備えたメモリセルブロックを複数有する。そして、それぞれのメモリセルブロックは、入力数および出力数が3つ以上であり、内部に前記メモリセルに対する2つの読出アドレスデコーダを備え、所定のアドレス入力に対して所望の論理値を出力するための真理値表データをメモリセルに記憶し、論理回路として動作するように構成されている。また、メモリセルは、2つの読出アドレスデコーダに対応して2本の読出ワード線を有しており、その2本の読出ワード線の両方の電圧が印加された場合に、そのとき保持しているデータが読出データ線から読み出される。さらに、メモリセルブロック同士は、1つのメモリセルブロックからの3つ以上の出力が3つ以上の他のメモリセルブロックへ入力されるように接続されている。
    • 半导体器件(110)具有多个存储单元块,每个存储单元块具有存储预定量数据的多个存储单元。 每个存储单元块具有三个或更多个输出,以及用于存储器单元的两个读地址解码器。 用于响应于预定地址输入输出期望逻辑值的真值表数据被存储到存储单元中,使得每个存储单元块作为逻辑电路运行。 存储单元还具有对应于两个读地址解码器的两个读字线。 当对两个读取字线两者施加电压时,从读取数据线读出所存储的数据。 此外,存储单元块彼此连接,使得来自一个存储器单元块的三个或更多个输出被输入到三个或更多个其他存储单元块。
    • 6. 发明申请
    • 半導体メモリ装置
    • 半导体存储器件
    • WO2013011848A1
    • 2013-01-24
    • PCT/JP2012/067302
    • 2012-07-06
    • 太陽誘電株式会社佐藤 正幸
    • 佐藤 正幸
    • G11C11/413
    • G11C11/418G11C8/10G11C11/419
    • 【課題】半導体メモリ装置において同期又は非同期のデータ読出しを、データ毎に行う。【解決手段】各々がデータを記憶する複数のメモリセルと、前記メモリセルを特定するアドレス信号をデコードし、前記デコードされたアドレスに基づいた複数のメモリセルの一部に接続されるワード線の1つを選択するワード線選択信号を出力するアドレスデコーダと、選択データを保持するとともに、前記選択データに基いて、外部から供給される外部クロックを選択する選択部と、前記外部クロックが選択された場合、前記選択された外部クロックに同期して、又は、前記外部クロックが選択されなかった場合、前記外部クロックに同期せずに、前記ワード線選択信号に基づいて選択される前記複数のメモリセルの一部に対してデータを読み出すデータ読出部と、を備える半導体メモリ装置を提供する。
    • 发明内容本发明的目的是在半导体存储器件中实现对每条数据执行同步或异步数据读出。 [解决方案]提供一种半导体存储器件,其具有:存储数据的多个存储单元; 解码指定存储单元的地址信号的地址解码器,并输出基于解码的地址的字线选择信号,并用于选择连接到多个存储单元的一部分的字线之一; 选择单元,其基于选择数据保存选择数据,并选择外部提供的外部时钟; 以及数据读出单元,其从基于工作线选择信号选择的多个存储单元的一部分中读出数据,所述数据读出单元在外部时钟同步地与外部时钟同步地执行读出 当外部时钟未被选择时被选择,或与外部时钟异步。
    • 8. 发明申请
    • チャックユニット
    • CH K。
    • WO2010029648A1
    • 2010-03-18
    • PCT/JP2008/069960
    • 2008-10-31
    • 日東精工株式会社塩田 耕一郎齋藤 正幸
    • 塩田 耕一郎齋藤 正幸
    • B23P19/06B25B23/04
    • B25B23/04B23P19/006B25B23/10
    • 【課題】本発明は、作業者による見通しを向上させるとともに、ドライバビットの移動に伴って弾性部材の付勢に逆らって押し出されるスイングパイプを確実に常時の位置に復帰させるチャックユニットを提供する。 【解決手段】本発明のチャックユニット(1)においては、スイングパイプ(10)を付勢するコイルばね(11)は、スイングパイプ(10)に巻装されている。そのため、チャックユニット(1)には張り出し部分が小さくなり、当該チャックユニット(1)をハンドドライバ(50)等の先端に取り付けて使用する場合、作業者の被締結物に対する見通しを向上させることが可能となる。
    • [待解决的问题]提供一种卡盘单元,用于改善操作者的视野并且可靠地恢复被推出的摆动管,以防止与驱动器钻头的运动相关联的弹性构件的推动到稳定位置。 解决问题的手段卡盘单元(1)具有螺旋弹簧(11),用于推动缠绕在管道(10)上的摆管(10)。 因此,卡盘单元(1)具有减小的突出部分,使得当将单元(1)附接到手持式螺丝刀(50)等的尖端时,可以改善用于被紧固物体的操作者的视野 用来。
    • 9. 发明申请
    • 静電チャック及び真空処理装置
    • 静电切割机和真空加工设备
    • WO2010024146A1
    • 2010-03-04
    • PCT/JP2009/064415
    • 2009-08-17
    • 株式会社アルバック佐藤 正幸岡 正中村 久三
    • 佐藤 正幸岡 正中村 久三
    • H01L21/683H02N13/00
    • H02N13/00H01L21/6833
    • 静電チャックに透光性を有する処理基板を保持させて、処理基板に対し光の照射を伴う処理を施す際に、光電効果で吸着力が低下しても処理基板を確実に保持できるようにした静電チャックを提供する。 静電チャック(6)は、誘電体から成るチャックプレート(61)と、チャックプレート(61)に設けた第1電極(63 1 )と第2電極(63 2 )とを備え、第1と第2の両電極(63 1 ,63 2 )間に電圧を印加して、処理基板(S)をチャックプレート(61)の表面に吸着する。チャックプレート(61)の表面の一部に、処理基板(S)に対する粘着力を有する粘着シート等から成る基板保持部(64)が設けられる。
    • 本发明提供一种静电卡盘,其通过使静电卡盘保持基板,即使在通过光电效应使吸引力劣化的情况下,也能够将包含光照射的处理中的吸引力固定在待处理的基板上。 静电卡盘(6)设置有由电介质材料构成的卡盘板(61)和布置在卡盘板(61)上的第一电极(631)和第二电极(632),并且施加电压 在第一和第二电极(631,632)之间,并且待处理的基板(S)被吸引到卡盘板(61)的表面。 在卡盘板61的表面的一部分上,配置有对基板(S)具有粘合力的粘合片等构成的基板保持部(64)。