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1. 发明专利

TW201814501A 處理器和將架構指令轉譯成微指令的方法审中-公开
简体标题：处理器和将架构指令转译成微指令的方法
公开(公告)号：TW201814501A
公开(公告)日：2018-04-16
申请号：TW105139477
申请日：2016-11-30
申请人：上海兆芯集成電路有限公司 , VIA ALLIANCE SEMICONDUCTOR CO., LTD.
发明人：白龍飛 , BAI, LONGFEI , 黃振華 , HUANG, ZHENHUA , 閻萌萌 , YAN, MENGMENG
IPC分类号： G06F9/22
CPC分类号： G06F9/3016 , G06F9/28 , G06F9/30058 , G06F9/30145 , G06F9/3017 , G06F9/322 , G06F9/324 , G06F9/3802 , G06F9/3804 , G06F9/3814 , G06F9/3822 , G06F9/3842 , G06F9/3867
摘要：一處理器具有執行微指令的執行管線和將架構指令轉譯成為微指令的指令轉譯器。指令轉譯器具有：記憶體，保持微碼指令且每時脈週期提供多個微碼指令；佇列，保持記憶體所提供的微碼指令；分支解碼器，對微碼指令解碼以檢測局部分支指令，使得要將讀取的多條微碼指令中直到程式順序首位局部分支指令為止但不包括程式順序首位局部分支指令的微碼指令寫入佇列，並防止將程式順序首位局部分支指令及其後續微碼指令寫入佇列。局部分支指令由指令轉譯器進行解析。微碼轉譯器將每時脈週期從佇列接收到的多個微碼指令轉譯成微指令以提供至執行管線。
简体摘要：一处理器具有运行微指令的运行管线和将架构指令转译成为微指令的指令转译器。指令转译器具有：内存，保持微码指令且每时脉周期提供多个微码指令；队列，保持内存所提供的微码指令；分支译码器，对微码指令译码以检测局部分支指令，使得要将读取的多条微码指令中直到进程顺序首位局部分支指令为止但不包括进程顺序首位局部分支指令的微码指令写入队列，并防止将进程顺序首位局部分支指令及其后续微码指令写入队列。局部分支指令由指令转译器进行解析。微码转译器将每时脉周期从队列接收到的多个微码指令转译成微指令以提供至运行管线。

2. 发明专利

TW201804321A 具備使用統一結構的動態派遣窗之虛擬載入儲存佇列审中-公开
简体标题：具备使用统一结构的动态派遣窗之虚拟加载存储队列
公开(公告)号：TW201804321A
公开(公告)日：2018-02-01
申请号：TW106133760
申请日：2013-06-14
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：艾伯戴爾拉摩翰麥德 , ABDALLAH, MOHAMMAD
IPC分类号： G06F9/30 , G06F9/46
CPC分类号： G06F9/30043 , G06F5/14 , G06F9/30145 , G06F9/3017 , G06F9/30185 , G06F9/3824 , G06F9/3826 , G06F9/3834 , G06F9/3836 , G06F9/3842 , G06F2205/063 , G06F2205/064
摘要：本發明揭示一種失序處理器。該處理器包含：一虛擬載入儲存佇列，用於配置複數個載入及複數個儲存，其中可容納超過該處理器載入儲存佇列實際大小的更多載入與更多儲存；其中該處理器可配置超越該載入/儲存佇列的該實際大小限制的載入和儲存與其他指令；及其中即使相關的載入或儲存在該載入儲存佇列內沒有空間，還是可派遣與執行該等其他指令。
简体摘要：本发明揭示一种失序处理器。该处理器包含：一虚拟加载存储队列，用于配置复数个加载及复数个存储，其中可容纳超过该处理器加载存储队列实际大小的更多加载与更多存储；其中该处理器可配置超越该加载/存储队列的该实际大小限制的加载和存储与其他指令；及其中即使相关的加载或存储在该加载存储队列内没有空间，还是可派遣与运行该等其他指令。

3. 发明专利

TWI610232B 用於資料預測執行之系統、裝置及方法有权
简体标题：用于数据预测运行之系统、设备及方法
公开(公告)号：TWI610232B
公开(公告)日：2018-01-01
申请号：TW104138800
申请日：2015-11-23
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 休斯克里斯多夫 , HUGHES, CHRISTOPHER , 瓦倫泰羅柏 , VALENTINE, ROBERT , 吉卡密林德 , GIRKAR, MILIND B.
IPC分类号： G06F9/30 , G06F9/34
CPC分类号： G06F9/3016 , G06F9/30043 , G06F9/30087 , G06F9/30098 , G06F9/34 , G06F9/3455 , G06F9/3834 , G06F9/3842 , G06F9/3855 , G06F9/3859 , G06F9/3861 , G06F9/467

4. 发明专利

TWI592868B 用於重疊原子區域執行的處理器有权
简体标题：用于重叠原子区域运行的处理器
公开(公告)号：TWI592868B
公开(公告)日：2017-07-21
申请号：TW105113272
申请日：2012-12-26
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：鄭在雄 , CHUNG, JAEWOONG , 王正 , WANG, CHENG , 吳玉芬 , WU, YOUFENG
IPC分类号： G06F9/22 , G06F9/30
CPC分类号： G06F9/3861 , G06F9/30116 , G06F9/3842 , G06F9/467 , G06F9/528

5. 发明专利

TW201723813A 用於診斷執行串流指令的處理器之方法、設備、及系統审中-公开
简体标题：用于诊断运行串流指令的处理器之方法、设备、及系统
公开(公告)号：TW201723813A
公开(公告)日：2017-07-01
申请号：TW105139190
申请日：2016-11-29
申请人： ARM股份有限公司 , ARM LIMITED
发明人：馬丁戴米恩羅賓 , MARTIN, DAMIEN ROBIN , 德蒙若克萊門特馬克 , DEMONGEOT, CLEMENT MARC , 威廉斯麥克約翰 , WILLIAMS, MICHAEL JOHN
IPC分类号： G06F9/30 , G06F11/28
CPC分类号： G06F11/3632 , G06F9/30043 , G06F9/30087 , G06F9/3842 , G06F9/3851 , G06F9/3861 , G06F9/4812 , G06F9/52 , G06F9/528 , G06F11/3604 , G06F11/3636
摘要：本案提供一種藉由致使該處理器在一連串階段中執行串流指令來診斷執行該串流指令的處理器之方法、設備及系統，其中各個階段之間發生診斷異常。該方法涉及當到達將發生診斷異常之點時，將處理器控制在當前階段中以在儲存位置中儲存包括用於在該串流中之當前指令的類型指示符及用於在該串流中之下一指令的類型指示符之類型指示符資訊。隨後發生該診斷異常，致使執行診斷操作，其包括自儲存位置存取類型指示符資訊，以及根據用於當前指令之類型指示符及用於下一指令之類型指示符，決定控制資訊以識別用於下一診斷異常之至少一個觸發條件。隨後，自該診斷異常的返回致使該處理器根據該已決定之控制資訊在下一階段中操作。藉由不僅擷取關於在將發生診斷異常之點處處理之當前指令的資訊，亦擷取關於該下一指令的資訊，可提供在處理診斷程序之效率方面之顯著改良。
简体摘要：本案提供一种借由致使该处理器在一连串阶段中运行串流指令来诊断运行该串流指令的处理器之方法、设备及系统，其中各个阶段之间发生诊断异常。该方法涉及当到达将发生诊断异常之点时，将处理器控制在当前阶段中以在存储位置中存储包括用于在该串流中之当前指令的类型指示符及用于在该串流中之下一指令的类型指示符之类型指示符信息。随后发生该诊断异常，致使运行诊断操作，其包括自存储位置存取类型指示符信息，以及根据用于当前指令之类型指示符及用于下一指令之类型指示符，决定控制信息以识别用于下一诊断异常之至少一个触发条件。随后，自该诊断异常的返回致使该处理器根据该已决定之控制信息在下一阶段中操作。借由不仅截取关于在将发生诊断异常之点处处理之当前指令的信息，亦截取关于该下一指令的信息，可提供在处理诊断进程之效率方面之显着改良。

6. 发明专利

TWI585682B 具備免消歧義失序載入儲存佇列的重新排序推測性指令序列有权
简体标题：具备免消歧义失序加载存储队列的重新排序推测性指令串行
公开(公告)号：TWI585682B
公开(公告)日：2017-06-01
申请号：TW102121090
申请日：2013-06-14
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：艾伯戴爾拉摩翰麥德 , ABDALLAH, MOHAMMAD
IPC分类号： G06F9/30 , G06F9/38
CPC分类号： G06F9/30043 , G06F9/30032 , G06F9/30047 , G06F9/3017 , G06F9/30185 , G06F9/3826 , G06F9/3834 , G06F9/3842 , G06F9/3855 , G06F9/3857

7. 发明专利

TWI584193B 處理器協助設施有权
简体标题：处理器协助设施
公开(公告)号：TWI584193B
公开(公告)日：2017-05-21
申请号：TW102116786
申请日：2013-05-10
申请人：萬國商業機器公司 , INTERNATIONAL BUSINESS MACHINES CORPORATION
发明人：葛瑞納丹F , GREINER, DAN F. , 傑可比克理斯俊 , JACOBI, CHRISTIAN , 菲力藍達爾W , PHILLEY, RANDALL W. , 雷爾森彼得J , RELSON, PETER J. , 史洛歌提摩西J , SLEGEL, TIMOTHY J.
IPC分类号： G06F9/38
CPC分类号： G06F9/3861 , G06F9/3004 , G06F9/30087 , G06F9/3842 , G06F9/3857 , G06F9/466

8. 发明专利

TW201702865A 用於重疊原子區域執行的處理器审中-公开
简体标题：用于重叠原子区域运行的处理器
公开(公告)号：TW201702865A
公开(公告)日：2017-01-16
申请号：TW105113272
申请日：2012-12-26
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：鄭在雄 , CHUNG, JAEWOONG , 王正 , WANG, CHENG , 吳玉芬 , WU, YOUFENG
IPC分类号： G06F9/22 , G06F9/30
CPC分类号： G06F9/3861 , G06F9/30116 , G06F9/3842 , G06F9/467 , G06F9/528
摘要：在一實施例中，本發明包括具有用以執行指令之核心的處理器。此核心可包括允許以重疊之方式來執行不同原子區域之指令的各種結構和邏輯。為此目的，該核心可包括：具有暫存器以儲存用於執行該等指令之資料的暫存器檔案、以及各自用以在啟動給定原子區域時儲存暫存器檢查點的多個影子暫存器檔案。以此方式，可發生由編程器或編譯器所識別之原子區域的重疊執行。亦敘述其他實施例並加以做成申請專利範圍。
简体摘要：在一实施例中，本发明包括具有用以运行指令之内核的处理器。此内核可包括允许以重叠之方式来运行不同原子区域之指令的各种结构和逻辑。为此目的，该内核可包括：具有寄存器以存储用于运行该等指令之数据的寄存器文档、以及各自用以在启动给定原子区域时存储寄存器检查点的多个影子寄存器文档。以此方式，可发生由编程器或编译器所识别之原子区域的重叠运行。亦叙述其他实施例并加以做成申请专利范围。

9. 发明专利

TW201640338A 用於資料預測執行之系統、裝置及方法审中-公开
简体标题：用于数据预测运行之系统、设备及方法
公开(公告)号：TW201640338A
公开(公告)日：2016-11-16
申请号：TW104138800
申请日：2015-11-23
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 休斯克里斯多夫 , HUGHES, CHRISTOPHER , 瓦倫泰羅柏 , VALENTINE, ROBERT , 吉卡密林德 , GIRKAR, MILIND B.
IPC分类号： G06F9/30 , G06F9/34
CPC分类号： G06F9/3016 , G06F9/30043 , G06F9/30087 , G06F9/30098 , G06F9/34 , G06F9/3455 , G06F9/3834 , G06F9/3842 , G06F9/3855 , G06F9/3859 , G06F9/3861 , G06F9/467
摘要：描述用於資料預測執行(DSX)之系統、方法、及裝置。於某些實施例中，用以履行DSX之硬體裝置包含硬體解碼器，用以解碼一指令，該指令係用以包括運算碼和用以儲存後降位址之一部分的運算元和用以儲存跨步值的運算元；執行硬體，用以執行該已解碼指令而藉由以下方式來起始資料預測執行(DSX)區：啟動DSX追蹤硬體以追蹤預測記憶體存取並檢測該DSX區中之排序違反、及儲存該後降位址。
简体摘要：描述用于数据预测运行(DSX)之系统、方法、及设备。于某些实施例中，用以履行DSX之硬件设备包含硬件译码器，用以译码一指令，该指令系用以包括运算码和用以存储后降位址之一部分的算子和用以存储跨步值的算子；运行硬件，用以运行该已译码指令而借由以下方式来起始数据预测运行(DSX)区：启动DSX追踪硬件以追踪预测内存存取并检测该DSX区中之排序违反、及存储该后降位址。

10. 发明专利

TW201640337A 用於資料推測執行的系統、設備及方法审中-公开
简体标题：用于数据推测运行的系统、设备及方法
公开(公告)号：TW201640337A
公开(公告)日：2016-11-16
申请号：TW104138790
申请日：2015-11-23
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 休斯克里斯多夫 , HUGHES, CHRISTOPHER , 瓦倫泰羅柏 , VALENTINE, ROBERT , 吉卡密林德 , GIRKAR, MILIND B.
IPC分类号： G06F9/30
CPC分类号： G06F9/3016 , G06F9/30087 , G06F9/30098 , G06F9/3834 , G06F9/3842 , G06F9/3859 , G06F9/3861 , G06F9/467
摘要：本發明描述了用於資料推測執行(DSX)的系統、方法以及設備。在一些實施例中，用於執行DSX的硬體設備包含硬體解碼器用以解碼指令，指令用以包括運算碼，以及執行硬體，用以執行該解碼的指令以繼續資料推測執行(DSX)，以及用以決定DSX迴圈疊代是將被提交的、提交與該DSX迴圈疊代相關的推測性儲存以及開始新的DSX迴圈疊代。
简体摘要：本发明描述了用于数据推测运行(DSX)的系统、方法以及设备。在一些实施例中，用于运行DSX的硬件设备包含硬件译码器用以译码指令，指令用以包括运算码，以及运行硬件，用以运行该译码的指令以继续数据推测运行(DSX)，以及用以决定DSX循环叠代是将被提交的、提交与该DSX循环叠代相关的推测性存储以及开始新的DSX循环叠代。

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