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1. 发明专利

TW201814501A 處理器和將架構指令轉譯成微指令的方法审中-公开
简体标题：处理器和将架构指令转译成微指令的方法
公开(公告)号：TW201814501A
公开(公告)日：2018-04-16
申请号：TW105139477
申请日：2016-11-30
申请人：上海兆芯集成電路有限公司 , VIA ALLIANCE SEMICONDUCTOR CO., LTD.
发明人：白龍飛 , BAI, LONGFEI , 黃振華 , HUANG, ZHENHUA , 閻萌萌 , YAN, MENGMENG
IPC分类号： G06F9/22
CPC分类号： G06F9/3016 , G06F9/28 , G06F9/30058 , G06F9/30145 , G06F9/3017 , G06F9/322 , G06F9/324 , G06F9/3802 , G06F9/3804 , G06F9/3814 , G06F9/3822 , G06F9/3842 , G06F9/3867
摘要：一處理器具有執行微指令的執行管線和將架構指令轉譯成為微指令的指令轉譯器。指令轉譯器具有：記憶體，保持微碼指令且每時脈週期提供多個微碼指令；佇列，保持記憶體所提供的微碼指令；分支解碼器，對微碼指令解碼以檢測局部分支指令，使得要將讀取的多條微碼指令中直到程式順序首位局部分支指令為止但不包括程式順序首位局部分支指令的微碼指令寫入佇列，並防止將程式順序首位局部分支指令及其後續微碼指令寫入佇列。局部分支指令由指令轉譯器進行解析。微碼轉譯器將每時脈週期從佇列接收到的多個微碼指令轉譯成微指令以提供至執行管線。
简体摘要：一处理器具有运行微指令的运行管线和将架构指令转译成为微指令的指令转译器。指令转译器具有：内存，保持微码指令且每时脉周期提供多个微码指令；队列，保持内存所提供的微码指令；分支译码器，对微码指令译码以检测局部分支指令，使得要将读取的多条微码指令中直到进程顺序首位局部分支指令为止但不包括进程顺序首位局部分支指令的微码指令写入队列，并防止将进程顺序首位局部分支指令及其后续微码指令写入队列。局部分支指令由指令转译器进行解析。微码转译器将每时脉周期从队列接收到的多个微码指令转译成微指令以提供至运行管线。

2. 发明专利

TWI512465B 客戶至本機區塊位址映射與本機碼儲存之管理有权
简体标题：客户至本机区块位址映射与本机码存储之管理
公开(公告)号：TWI512465B
公开(公告)日：2015-12-11
申请号：TW101102838
申请日：2012-01-30
申请人：軟體機器公司 , SOFT MACHINES, INC.
发明人：艾伯戴爾拉摩翰麥德 , ABDALLAH, MOHAMMAD
IPC分类号： G06F12/08 , G06F12/10 , G06F9/06
CPC分类号： G06F9/355 , G06F9/30054 , G06F9/30174 , G06F9/322 , G06F9/3802 , G06F9/4552 , G06F12/0895 , G06F12/0897 , G06F12/1036 , G06F2212/604

3. 发明专利

TW200805147A 具有跳越驗證之安全化的微處理器 SECURISED MICROPROCESSOR WITH JUMP VERIFICATION 审中-公开
简体标题：具有跳越验证之安全化的微处理器 SECURISED MICROPROCESSOR WITH JUMP VERIFICATION
公开(公告)号：TW200805147A
公开(公告)日：2008-01-16
申请号：TW095136755
申请日：2006-10-03
申请人：納格瑞卡股份有限公司 NAGRACARD S.A.
发明人：安德列庫得斯基 KUDELSKI, ANDRE
IPC分类号： G06F
CPC分类号： G06F9/322 , G06F9/321 , G06F9/3863 , G06F21/52
摘要：本發明之一目的在於提供避免因程式計數器之不同步化而造成的破壞之方法與裝置。一種安全化之微處理器,包含程式計數器以及與含有指令之程式記憶體接介的介面,該微處理器為其中其包含該程式計數器之歷史記憶體,其指示在先前的指令執行時該程式計數器的位置,以及指令驗證模組,該模組包含驗證資訊的額外片段之讀取機構,其針對正被執行之程序中的該指令,界定該先前程式計數器之應該的位置,該驗證模組包含將該驗證資訊與源自該歷史記憶體者作比較之機構,以及若該驗證指示不相容則產生錯誤之機構。
简体摘要：本发明之一目的在于提供避免因进程计数器之不同步化而造成的破坏之方法与设备。一种安全化之微处理器,包含进程计数器以及与含有指令之进程内存接介的界面,该微处理器为其中其包含该进程计数器之历史内存,其指示在先前的指令运行时该进程计数器的位置,以及指令验证模块,该模块包含验证信息的额外片段之读取机构,其针对正被运行之进程中的该指令,界定该先前进程计数器之应该的位置,该验证模块包含将该验证信息与源自该历史内存者作比较之机构,以及若该验证指示不兼容则产生错误之机构。

4. 发明专利

TWI284282B 具有遠跳躍與遠呼叫指令之分支預測的方法及微處理器 PROCESSOR INCLUDING BRANCH PREDICTION MECHANISM FOR FAR JUMP AND FAR CALL INSTRUCTIONS 有权
简体标题：具有远跳跃与远调用指令之分支预测的方法及微处理器 PROCESSOR INCLUDING BRANCH PREDICTION MECHANISM FOR FAR JUMP AND FAR CALL INSTRUCTIONS
公开(公告)号：TWI284282B
公开(公告)日：2007-07-21
申请号：TW092127363
申请日：2003-10-03
申请人：智慧第一公司 IP FIRST, LLC
发明人：柯爾葛拉 COL, GERARD M. , 麥當勞湯瑪斯 MCDONALD, THOMAS C.
IPC分类号： G06F
CPC分类号： G06F9/322 , G06F9/30054 , G06F9/3806 , G06F9/3844
摘要：一種用於處理遠跳躍-呼叫分支指令以增加處理器管線效能之方法與裝置。此一處理器係包括有一遠跳躍-呼叫目標緩衝器，其係可儲存相對應於每一個在前面所執行之複數個遠跳躍-呼叫指令的位址/運算元尺寸預設值。當遇到一遠跳躍-呼叫指令時，其係可利用相對應之位址/運算元尺寸預設值來推測性地加以執行。此推測性遠跳躍-呼叫指令被執行與分解後遂可決定出實際之位址/運算元尺寸。而若該實際之位址/運算元尺寸與推測性位址/運算元尺寸相匹配時，表示推測正確，則繼續後續的處理流程。而若兩者不相匹配時，其係表示推測錯誤，則管線必須清洗。
简体摘要：一种用于处理远跳跃-调用分支指令以增加处理器管线性能之方法与设备。此一处理器系包括有一远跳跃-调用目标缓冲器，其系可存储相对应于每一个在前面所运行之复数个远跳跃-调用指令的位址/算子尺寸默认值。当遇到一远跳跃-调用指令时，其系可利用相对应之位址/算子尺寸默认值来推测性地加以运行。此推测性远跳跃-调用指令被运行与分解后遂可决定出实际之位址/算子尺寸。而若该实际之位址/算子尺寸与推测性位址/算子尺寸相匹配时，表示推测正确，则继续后续的处理流程。而若两者不相匹配时，其系表示推测错误，则管线必须清洗。

5. 发明专利

TW200412539A 應用程式之核心模式操作系統及方法审中-公开
简体标题：应用进程之内核模式操作系统及方法
公开(公告)号：TW200412539A
公开(公告)日：2004-07-16
申请号：TW092100252
申请日：2003-01-07
申请人：緯創資通股份有限公司 WISTRON CORPORATION
发明人：劉韋宏 LIU, WEI HONG
IPC分类号： G06F
CPC分类号： G06F9/322
摘要：一種應用程式之核心模式操作系統，包括：一核心介面產生器(Kernel–ModeInterfaceGenerator)、一核心模式介面驅動程式(Kernel–ModeInterfaceDriver)及一特權介面(PrivilegeInterface)，核心介面產生器係用以動態產生核心模式介面驅動程式，接著核心模式介面驅動程式產生一呼叫閘道(CallGate)，並使呼叫閘道可在一核心模式下執行一最高特權等級(Ring0)操作，特權介面係用以連接使用者模式及核心模式，特權介面透過呼叫閘道，提供使用者模式之一行程切換進入核心模式，以執行最高特權等級操作。
简体摘要：一种应用进程之内核模式操作系统，包括：一内核界面产生器(Kernel–ModeInterfaceGenerator)、一内核模式界面驱动程序(Kernel–ModeInterfaceDriver)及一特权界面(PrivilegeInterface)，内核界面产生器系用以动态产生内核模式界面驱动程序，接着内核模式界面驱动程序产生一调用闸道(CallGate)，并使调用闸道可在一内核模式下运行一最高特权等级(Ring0)操作，特权界面系用以连接用户模式及内核模式，特权界面透过调用闸道，提供用户模式之一行程切换进入内核模式，以运行最高特权等级操作。

6. 发明专利

TW200300903A 資料處理器 data processor 审中-公开
简体标题：数据处理器 data processor
公开(公告)号：TW200300903A
公开(公告)日：2003-06-16
申请号：TW091134100
申请日：2002-11-22
申请人：日立製作所股份有限公司 , 日立北海半導體股份有限公司
发明人：石倉裕道 , 安田元 , 三石直幹 , 石橋謙一
IPC分类号： G06F
CPC分类号： G06F9/342 , G06F9/30189 , G06F9/322 , G06F9/324
摘要：【課題】對於資料容量對位址空間之大小，不使CPU之使用方法變差，而謀求編碼效率以及資料處理效率的改善。【解決手段】採用因應動作模式之動態切換而可以變更對於同一命令的解釋之命令控制部(CONT)以構成資料處理器之故，可以動態切換因資料區域對位址空間之限定所致之編碼效率的提高以及使命令取得高速化優先之動作慔式選擇狀態，以及極力使可以使用之資料區域的限制變不見之動作模式選擇狀態。藉由此，能夠不使CPU之使用方法變差，而活用藉由縮短形命令等之優點。
简体摘要：【课题】对于数据容量对位址空间之大小，不使CPU之使用方法变差，而谋求编码效率以及数据处理效率的改善。【解决手段】采用因应动作模式之动态切换而可以变更对于同一命令的解释之命令控制部(CONT)以构成数据处理器之故，可以动态切换因数据区域对位址空间之限定所致之编码效率的提高以及使命令取得高速化优先之动作慔式选择状态，以及极力使可以使用之数据区域的限制变不见之动作模式选择状态。借由此，能够不使CPU之使用方法变差，而活用借由缩短形命令等之优点。

7. 发明专利

TWI467490B 包括複數個處理器之系統以及操作該系統之方法有权
简体标题：包括复数个处理器之系统以及操作该系统之方法
公开(公告)号：TWI467490B
公开(公告)日：2015-01-01
申请号：TW097119627
申请日：2008-05-28
申请人：高級微裝置公司 , ADVANCED MICRO DEVICES, INC.
发明人：凱倫妮奇魏 , KRANICH, UWE
IPC分类号： G06F9/46 , G06F9/38
CPC分类号： G06F9/3012 , G06F9/30043 , G06F9/30076 , G06F9/30087 , G06F9/3009 , G06F9/30189 , G06F9/322 , G06F9/3851 , G06F9/3861 , G06F9/3877 , G06F9/3879 , G06F9/3889

8. 发明专利

TW201246066A 具有近端分支與遠端分支序列結構的客戶指令區塊至本機指令區塊 GUEST INSTRUCTION BLOCK WITH NEAR BRANCHING AND FAR BRANCHING SEQUENCE CONSTRUTION TO NATIVE INSTRUCTION BLOCK 审中-公开
简体标题：具有近端分支与远程分支串行结构的客户指令区块至本机指令区块 GUEST INSTRUCTION BLOCK WITH NEAR BRANCHING AND FAR BRANCHING SEQUENCE CONSTRUTION TO NATIVE INSTRUCTION BLOCK
公开(公告)号：TW201246066A
公开(公告)日：2012-11-16
申请号：TW101102831
申请日：2012-01-30
申请人：軟體機器公司
发明人：艾伯戴爾拉摩翰麥德
IPC分类号： G06F
CPC分类号： G06F9/322 , G06F9/30058 , G06F9/30174 , G06F9/3808 , G06F9/3844 , G06F9/3863 , G06F9/4552
摘要：本發明揭示一種用於轉譯指令給一處理器之方法。該方法包括存取複數個包括多個客戶分支指令的客戶指令，該多個客戶分支指令包括客戶遠端分支的至少之一者，並且藉由使用該客戶遠端分支的至少之一者上之分支預測，從該複數個客戶指令中建立一指令序列。該方法進一步包括從該指令序列組裝一客戶指令區塊。該客戶指令區塊轉譯成對應的本機轉換區塊，其中本機遠端分支的至少之一者對應至客戶遠端分支的至少之一者，並且其中該本機遠端分支的至少之一者包括一相對的客戶位址，用於該客戶遠端分支的至少之一者之相對分支路徑。在遇到錯失預測的情況時，利用存取該相對客戶位址可獲得正確的指令序列。
简体摘要：本发明揭示一种用于转译指令给一处理器之方法。该方法包括存取复数个包括多个客户分支指令的客户指令，该多个客户分支指令包括客户远程分支的至少之一者，并且借由使用该客户远程分支的至少之一者上之分支预测，从该复数个客户指令中创建一指令串行。该方法进一步包括从该指令串行组装一客户指令区块。该客户指令区块转译成对应的本机转换区块，其中本机远程分支的至少之一者对应至客户远程分支的至少之一者，并且其中该本机远程分支的至少之一者包括一相对的客户位址，用于该客户远程分支的至少之一者之相对分支路径。在遇到错失预测的情况时，利用存取该相对客户位址可获得正确的指令串行。

9. 发明专利

TW200905566A 包括複數個處理器之系統以及操作該系統之方法 SYSTEM COMPRISING A PLURALITY OF PROCESSORS AND METHOD OF OPERATING THE SAME 审中-公开
简体标题：包括复数个处理器之系统以及操作该系统之方法 SYSTEM COMPRISING A PLURALITY OF PROCESSORS AND METHOD OF OPERATING THE SAME
公开(公告)号：TW200905566A
公开(公告)日：2009-02-01
申请号：TW097119627
申请日：2008-05-28
申请人：高級微裝置公司 ADVANCED MICRO DEVICES, INC.
发明人：凱倫妮奇魏 KRANICH, UWE
IPC分类号： G06F
CPC分类号： G06F9/3012 , G06F9/30043 , G06F9/30076 , G06F9/30087 , G06F9/3009 , G06F9/30189 , G06F9/322 , G06F9/3851 , G06F9/3861 , G06F9/3877 , G06F9/3879 , G06F9/3889
摘要：一種系統包括主控處理器及至少一個從屬處理器。該主控處理器之狀態包括第一複數個變數,且該從屬處理器之狀態包括第二複數個變數。該系統包括由該主控處理器及該從屬處理器處理資料的平行作業模式、以及由該主控處理器處理資料的序列作業模式。在該平行作業模式中發生中斷或異常時,該系統執行下列步驟:將該第一複數個變數及該第二複數個變數的至少一部分儲存到緩衝記憶體;以及將該系統切換到該序列作業模式。若該從屬處理器中發生中斷或異常,則將該第一複數個變數中之至少一個變數設定為該第二複數個變數中之至少一個變數的値。
简体摘要：一种系统包括主控处理器及至少一个从属处理器。该主控处理器之状态包括第一复数个变量,且该从属处理器之状态包括第二复数个变量。该系统包括由该主控处理器及该从属处理器处理数据的平行作业模式、以及由该主控处理器处理数据的串行作业模式。在该平行作业模式中发生中断或异常时,该系统运行下列步骤:将该第一复数个变量及该第二复数个变量的至少一部分存储到缓冲内存;以及将该系统切换到该串行作业模式。若该从属处理器中发生中断或异常,则将该第一复数个变量中之至少一个变量设置为该第二复数个变量中之至少一个变量的値。

10. 发明专利

TW200828111A 微碼修補系統及方法 MICROCODE PATCHING SYSTEM AND METHOD 审中-公开
简体标题：微码修补系统及方法 MICROCODE PATCHING SYSTEM AND METHOD
公开(公告)号：TW200828111A
公开(公告)日：2008-07-01
申请号：TW096112686
申请日：2007-04-11
申请人：聯發科技股份有限公司 MEDIA TEK INC.
发明人：李明鴻 LI, MING HUNG
IPC分类号： G06F
CPC分类号： G06F12/0638 , G06F9/268 , G06F9/322 , G06F9/328 , Y02D10/13
摘要：一種微碼修補系統,包括一記憶單元、一位址選取單元,以及一捕捉及修補邏輯單元。記憶單元係包括一第一記憶體,用以儲存至少一微碼主指令,以及一第二記憶體,用以提供至少一微碼修補指令。記憶單元係根據一選取輸出位址來被存取。位址選取單元係用以提供一第一輸出位址。捕捉及修補邏輯單元係耦接於位址選取單元及記憶單元之間,用以判斷是否第一輸出位址與至少一錯誤位址當中任一相符,並且當第一輸出位址與錯誤位址當中之一者相符時,選出一用於存取第二記憶體之選取修補位址作為一第二輸出位址,當第一輸出位址與錯誤位址皆不相符時,選取第一輸出位址作為一第二輸出位址,其中第二輸出位址係耦接於記憶單元。
简体摘要：一种微码修补系统,包括一记忆单元、一位址选取单元,以及一捕捉及修补逻辑单元。记忆单元系包括一第一内存,用以存储至少一微码主指令,以及一第二内存,用以提供至少一微码修补指令。记忆单元系根据一选取输出位址来被存取。位址选取单元系用以提供一第一输出位址。捕捉及修补逻辑单元系耦接于位址选取单元及记忆单元之间,用以判断是否第一输出位址与至少一错误位址当中任一相符,并且当第一输出位址与错误位址当中之一者相符时,选出一用于存取第二内存之选取修补位址作为一第二输出位址,当第一输出位址与错误位址皆不相符时,选取第一输出位址作为一第二输出位址,其中第二输出位址系耦接于记忆单元。

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