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热词
    • 54. 发明授权
    • 반도체 웨이퍼 제조 방법
    • 生产半导体波形的方法
    • KR101291880B1
    • 2013-07-31
    • KR1020100051121
    • 2010-05-31
    • 실트로닉 아게
    • 슈반드네르위르겐
    • H01L21/304
    • B24B37/042H01L21/02024
    • 반도체 웨이퍼를 제조하는 방법은,
      a) 실리콘 봉을 절단하여 웨이퍼로 만듦으로써 반도체 웨이퍼를 마련하는 단계;
      b) 반도체 웨이퍼가 전면 및 배면에서 편평한 표면과 에지 영역에서 경사진 라운드 표면을 포함하도록 반도체 웨이퍼의 에지를 라운드 가공하는 단계; 및
      c) 반도체 웨이퍼의 전면 및 배면을 폴리싱 가공하는 단계
      를 포함하며, 반도체 웨이퍼의 전면의 폴리싱 가공은 고정된 연마재가 없는 폴리싱 패드를 이용한 화학기계적 폴리싱 가공을 포함하며, 반도체 웨이퍼의 배면의 폴리싱 가공은 연마재 물질이 결합되어 있고 반도체 웨이퍼의 배면 상에 폴리싱 압력으로 압박되는 폴리싱 패드를 각각 이용하여 3단계로 수행하되, 제1 단계에서는 고상 성분이 없는 폴리싱제를 폴리싱 패드와 반도체 웨이퍼의 배면 사이에 도입하는 한편 제2 및 제3 단계에서는 연마재 물질을 함유한 폴리싱제를 도입하고, 상기 폴리싱 압력은 제1 및 제2 단계에서 8 내지 15 psi로 하고 제3 단계에서는 0.5 내지 5 psi로 감소시킨다.
    • 56. 发明授权
    • 반도체 기판의 표면 가공 방법
    • 半导体衬底表面处理方法
    • KR101261239B1
    • 2013-05-07
    • KR1020110131218
    • 2011-12-08
    • 코닝정밀소재 주식회사
    • 어성우김경준
    • H01L21/304
    • H01L21/02024H01L21/0201H01L21/02052
    • PURPOSE: A method for processing the surface of a semiconductor substrate is provided to etch a damage layer to form a concavo-convex shape after the semiconductor substrate is lapped, to perform a polishing process after a polishing surface area is reduced, and to completely remove the damage layer without several surface processes. CONSTITUTION: The surface of a semiconductor substrate is lapped(S100). The lapped surface of the semiconductor substrate is etched to form a concavo-convex shape(S200). The concavo-convex-shaped surface is polished(S300). [Reference numerals] (S100) Lap the surface of a semiconductor substrate; (S200) Etch into a concavo-convex shape; (S300) Perform polishing
    • 目的:提供一种用于处理半导体衬底的表面的方法,以在半导体衬底被研磨之后蚀刻损伤层以形成凹凸形状,以在研磨表面积减小之后执行抛光工艺,并且完全去除 损伤层没有几个表面处理。 构成:研磨半导体衬底的表面(S100)。 蚀刻半导体衬底的重叠表面以形成凹凸形状(S200)。 抛光凹凸形表面(S300)。 (附图标记)(S100)搭接半导体衬底的表面; (S200)蚀刻成凹凸形状; (S300)进行抛光
    • 57. 发明公开
    • Ⅲ-N 기판의 평활화방법
    • 用于吸收III-N基材的方法
    • KR1020130022426A
    • 2013-03-06
    • KR1020137001513
    • 2006-07-26
    • 프라이베르게르 컴파운드 마터리얼스 게엠베하
    • 횔찌히쉬테판라이비거군나르
    • C30B33/00H01L21/304C30B29/38
    • C09G1/02C09K3/1409H01L21/02024H01L21/30625
    • 본 발명은 평활화된 III-N, 상세하게는 평활화된 III-N 기판 또는 III-N 템플레이트를 준비하는 방법을 기술하며, 이때 상기 III은 Al, Ga 및 In으로부터 선택된 원소주기율표의 적어도 하나의 III족 원소를 가리키고, 평활화제는 연마제 입자로서 입방정질화붕소를 포함한다. 이로써, 기판 전체 또는 웨이퍼 표면 전체에 걸쳐 매우 낮은 표면조도의 균일성으로 적어도 40mm의 직경을 갖는 대형 III-N 기판이나 III-N 템플레이트를 제공할 수 있다. 따라서, 백색광간섭계에 의한 웨이퍼표면의 매핑에서 rms값의 표준편차는 5% 또는 그 이하이다. 동시에, 이 특성은 상기 표면 또는 상기 표면부근 영역에서 매우 양호한 결정품질로 달성될 수 있고, 이는 예를 들어 로킹곡선매핑 및/또는 마이크로라만 매핑에 의해 측정될 수 있다.
    • 本发明涉及一种生产平滑III-N,特别是平滑的III-N底物或III-N模板的方法,III是指从Al,Ga和In中选择的周期表III族中的至少一种元素。 平滑装置包括立方氮化硼作为磨料颗粒。 所述方法使得可以在衬底或晶片的整个表面上产生具有最小直径为40mm的大面积III-N衬底或III-N模板,具有均匀的非常低的表面粗糙度。 例如,当通过白光干涉仪映射晶片表面时,均方根值的标准偏差为5%或更小。 所述性质可以在表面或表面附近的非常好的晶体质量下获得,例如通过摇摆曲线测绘和/或微拉曼测绘来测量质量。
    • 59. 发明授权
    • 반도체 웨이퍼의 양면 연마 방법
    • 半导体波形双面抛光方法
    • KR101229707B1
    • 2013-02-07
    • KR1020110028882
    • 2011-03-30
    • 실트로닉 아게
    • 슈반더위르겐부슈하르트토마스코퍼트롤란드
    • H01L21/304
    • H01L21/02024B24B37/044B24B37/08
    • 반도체 웨이퍼의 양면 연마를 위한 방법에 있어서, 제1 연마 패드로 덮인 상부 연마 플레이트와 제2 연마 패드로 덮인 하부 연마 플레이트 사이에 캐리어의 컷아웃에 위치된 반도체 웨이퍼의 동시 양면 연마를 포함하고, 캐리어에 위치된 반도체 웨이퍼는 연마 동안 상부 및 하부 연마 플레이트에 의해 형성된 작업 간격으로부터 자신의 영역의 일부가 일시적으로 돌출되며, 둘 다의 연마 패드는 정사각형 세그먼트들의 체크무늬 배열이 연마 패드 상에 형성되도록 0.5 내지 2 mm의 깊이와 폭을 갖는 채널들의 규칙적인 배열을 가지며, 상부 연마 플레이트 상에 위치된 제1 연마 패드는 20 mm x 20 mm보다 큰 세그먼트들을 갖고, 하부 연마 플레이트 상에 위치된 제2 연마 패드는 20 mm x 20 mm 이하의 세그먼트들을 가지며, 둘 다의 연마 패드는 세그먼트들 상에 0.1 내지 1.0 ㎛의 평균 크기를 갖는, 실리콘, 알루미늄 및 세륨으로 구성된 그룹으로부터 선택된 원소의 산화물의 연마재를 포함하고, 연마 프로세스 동안 연마제 용액이 공급되고, 연마제 용액의 pH 값은 11 내지 13.5의 범위에서 알칼리성 성분의 대응하는 공급에 의해 변할 수 있으며, 제1 단계에서 11-12.5의 pH를 갖는 연마제 용액이 공급되고 제2 단계에서 13-13.5의 pH를 갖는 연마제 용액이 공급되는 것인, 반도체 웨이퍼의 양면 연마를 위한 방법이 제공된다.