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    • 3. 发明专利
    • 受信回路
    • 接收电路
    • JP2017028491A
    • 2017-02-02
    • JP2015144789
    • 2015-07-22
    • 富士通株式会社
    • 柴▲崎▼ 崇之
    • H03L7/08H03L7/091H04L7/033
    • H03L7/087H03L7/0807H03L7/1072H04L7/06
    • 【課題】サンプリングクロックの周波数の収束時間を短縮する。 【解決手段】判定回路2は、入力データ信号Diを受け、サンプリングクロックCLKの論理レベルが変化するタイミングで、入力データ信号Diの値を判定する。サンプリングクロック生成回路3は、入力データ信号Diに基づきサンプリングクロックCLKを生成するとともに、サンプリングクロックCLKと、入力データ信号Diとの周波数差に基づく周波数調整値FRudを生成し、周波数調整値FRudに基づきサンプリングクロックCLKの周波数を調整する。周波数引き込み制御回路4は、期間Tごとに、周波数調整値FRudを積分して積分値を求め、期間Tが終わるまでにその積分値が閾値に達すると、期間Tが終わるまで、サンプリングクロック生成回路3に周波数調整値FRudを初期状態にさせるリセット信号FDrstを出力する。 【選択図】図1
    • 本发明的一个目的是降低采样时钟的频率的收敛时间。 判定电路2接收的输入数据信号D i,在定时时的采样时钟CLK的变化的逻辑电平,确定输入数据信号Di的值 采样时钟产生电路3,并且生成输入数据信号D i的基础上的采样时钟CLK,并产生一个采样时钟CLK,基于所述输入数据信号D i之间的频率差的频率调整值恢复团结民族阵线,基于该频率调整值恢复团结民族阵线 调整采样时钟CLK的频率。 频率引入控制电路4,对于每个周期T,通过集成频率调整值恢复团结民族阵线,获得积分值当T达到阈值的周期的结束之前的累计值,直到周期T,采样时钟生成电路的端 频率调整值恢复团结民族阵线输出复位信号FDRST到初始状态3。 点域1