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1. 发明专利

JP3611340B2 Semiconductor circuit 失效
公开(公告)号：JP3611340B2
公开(公告)日：2005-01-19
申请号：JP35208693
申请日：1993-12-28
申请人：アイ・アンド・エフ株式会社 , ユーシーティー株式会社 , 忠弘大見 , 直柴田
发明人：忠弘大見 , 毅雄山下 , 直柴田
IPC分类号： G06F3/05 , G06F15/18 , G06G7/60 , G06N3/06 , G06N3/063 , G11C27/00 , H01L21/8234 , H01L27/088 , H03K3/3568 , H03K19/20 , H03M1/12 , H03M1/36 , H03M1/80
CPC分类号： G06N3/0635 , G11C27/005 , H03K3/3568 , H03M1/36 , H03M1/802

2. 发明专利

JP2018523346A 試験信号を挿入してAC結合相互接続を試験するように構成された送信機审中-公开
公开(公告)号：JP2018523346A
公开(公告)日：2018-08-16
申请号：JP2017560186
申请日：2016-05-11
申请人：ザイリンクスインコーポレイテッド , XILINX INCORPORATED
发明人：マックロード, スコットディー. , イム, シュンジャイ , チェン, スタンリーワイ.
IPC分类号： H03F3/45 , G01R31/28 , H03K19/0175 , H04L25/02 , H03F3/72
CPC分类号： G01R31/041 , G01R31/2884 , G01R31/318572 , H03K3/012 , H03K3/3568 , H03K19/017527 , H03K19/018514 , H04L25/0272
摘要：一例では、ドライバ回路は、電流源(502)によってバイアスされるように構成され、また、差動入力(516)および差動出力(512)を含む差動トランジスタ対(504)を含む。ドライバ回路は、ノード対と差動出力の間に結合された抵抗器対(506)と、電圧供給とノード対の間に結合されたトランジスタ対と、ノード対の間に結合されたブリッジトランジスタとをさらに含む。ドライバ回路は、入力ポートのそれぞれの対、制御ポートのそれぞれの対および出力ポートのそれぞれの対を有する一対の3状態回路素子(510)をさらに含む。出力ポートの対は、それぞれノード対に結合される。制御ポートの対は、トランジスタ対の個々のゲートおよびブリッジトランジスタのゲートを備えた共通ノードに結合される。【選択図】図5

3. 发明专利

JPWO2003028214A1 多安定回路审中-公开
公开(公告)号：JPWO2003028214A1
公开(公告)日：2005-01-13
申请号：JP2003531610
申请日：2001-09-19
申请人：鈴木利康 , 利康鈴木
发明人：鈴木　利康 , 利康鈴木
IPC分类号： H03K3/356 , G11C7/00 , H03K3/038 , H03K3/3565 , H03K3/3568 , H03K19/20
CPC分类号： H03K3/3565 , H03K3/038 , H03K3/3568
摘要：その安定状態に応じた電圧もしくは電位を出力できる多安定回路で、用途は多値メモリー・セル、多値メモリー、多値記憶手段、多値論理回路、多値コンピュータ、多値制御手段などである。例えば、10安定回路の場合、電源線(V1)から電源線(V10)の方へ行くのに従って順々にその電位は高くなり、電源線(V1)と入出力端子(Tio)の間に「負性抵抗特性を持つプル・ダウン手段」を接続し、電源線(V2)から電源線(V9)までの各電源線と入出力端子(Tio)の間に「その負性抵抗特性を双方向に持つ双方向性プル手段」を1つずつ接続し、電源線(V10)と入出力端子(Tio)の間に「その負性抵抗特性を持つプル・アップ手段」を接続している。その負性抵抗特性は「その両端電圧の大きさが小さくなるとその抵抗が小さくなり、その両端電圧の大きさが大きくなるとその抵抗が大きくなる負性抵抗特性」である。前記双方向性プル手段を8つ用いたので、読み出し不能も、読み出し時の安定状態の変化も、誤った読み出しも無くなり、読み出し時間が早くなる。

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