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    • 6. 发明专利
    • 半導體記憶裝置
    • 半导体记忆设备
    • TW201351432A
    • 2013-12-16
    • TW102130342
    • 2008-09-16
    • 東芝股份有限公司KABUSHIKI KAISHA TOSHIBA
    • 井上裕文INOUE, HIROFUMI
    • G11C8/08
    • G11C7/12G11C13/0004G11C13/0011G11C13/004G11C13/0069G11C2013/0076G11C2213/11G11C2213/12G11C2213/72
    • 一種半導體記憶裝置,其包括:複數個平行字元線;交叉於該複數個字元線形成之複數個平行位元線;及配置於該等字元線與該等位元線相交處之複數個記憶胞。每一記憶胞具有連接至該字元線之一個端及連接至該位元線之另一端。該裝置亦包括一驅動電路,其運作以跨越該字元線及該位元線選擇性地施加一用於資料讀取/寫入之電壓。其進一步包括一感測放大器電路,其連接至該複數個位元線且運作以讀取儲存於該記憶胞中之資料/將資料寫入至該記憶胞中。該裝置亦包括一位元線驅動輔助電路,其運作以基於由該感測放大器電路自該記憶胞讀出之資料來選擇性地調節該複數個位元線上之電位。
    • 一种半导体记忆设备,其包括:复数个平行字符线;交叉于该复数个字符线形成之复数个平行比特线;及配置于该等字符线与该等比特线相交处之复数个记忆胞。每一记忆胞具有连接至该字符线之一个端及连接至该比特线之另一端。该设备亦包括一驱动电路,其运作以跨越该字符线及该比特线选择性地施加一用于数据读取/写入之电压。其进一步包括一传感放大器电路,其连接至该复数个比特线且运作以读取存储于该记忆胞中之数据/将数据写入至该记忆胞中。该设备亦包括一比特线驱动辅助电路,其运作以基于由该传感放大器电路自该记忆胞读出之数据来选择性地调节该复数个比特在线之电位。