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41. 发明专利

TW201814504A 處置針對向量指令的元素間位址危害审中-公开
简体标题：处置针对矢量指令的元素间位址危害
公开(公告)号：TW201814504A
公开(公告)日：2018-04-16
申请号：TW106130131
申请日：2017-09-04
申请人： ARM股份有限公司 , ARM LIMITED
发明人：荷斯奈爾馬修詹姆士 , HORSNELL, MATTHEW JAMES , 伊宥爾瑪普 , EYOLE, MBOU
IPC分类号： G06F9/30 , G06F13/16
CPC分类号： G06F9/30036
摘要：一種裝置具有支援向量加載及儲存指令的處理電路系統4。回應於交易開始事件，處理電路系統推測性地執行一或更多個後續指令。回應於交易結束事件，處理電路系統4實行彼等指令的推測性結果。危害偵測電路系統50偵測在用於先前的向量加載指令的資料元素J的位址及用於後來的向量儲存指令的資料元素K的位址之間是否發生元素間位址危害，其中K及J是不相等的。回應於偵測到元素間位址危害，危害偵測電路系統50觸發處理電路系統4以中止交易開始事件之後的指令的進一步處理且防止推測性結果被實行。此方法可針對向量化代碼提供更快的效能。
简体摘要：一种设备具有支持矢量加载及存储指令的处理电路系统4。回应于交易开始事件，处理电路系统推测性地运行一或更多个后续指令。回应于交易结束事件，处理电路系统4实行彼等指令的推测性结果。危害侦测电路系统50侦测在用于先前的矢量加载指令的数据元素J的位址及用于后来的矢量存储指令的数据元素K的位址之间是否发生元素间位址危害，其中K及J是不相等的。回应于侦测到元素间位址危害，危害侦测电路系统50触发处理电路系统4以中止交易开始事件之后的指令的进一步处理且防止推测性结果被实行。此方法可针对矢量化代码提供更快的性能。

42. 发明专利

TW201814503A 執行任務的處理節點決定方法以及使用該方法的裝置审中-公开
简体标题：运行任务的处理节点决定方法以及使用该方法的设备
公开(公告)号：TW201814503A
公开(公告)日：2018-04-16
申请号：TW105132698
申请日：2016-10-11
申请人：群暉科技股份有限公司 , SYNOLOGY INC.
发明人：陳志豪 , CHEN, CHIH HAO , 廖挺富 , LIAO, TING FU , 簡寗晏 , CHIEN, NING YEN , 張慈麟 , CHANG, TZU LIN
IPC分类号： G06F9/30 , G06F9/50 , G06F13/12
CPC分类号： H04L67/1008 , H04L47/805 , H04L67/1025 , H04L67/322
摘要：本發明實施例提出一種執行任務的處理節點決定方法，由處理器於執行守護程序時實施。當一個任務由第一節點中的處理器執行時，守護程序週期性地取得此任務於一段期間之關聯於使用第一節點的輸出入裝置的第一評估分數，以及，於此期間之關聯於使用第二節點的輸出入裝置的第二評估分數。當第二評估分數大於第一評估分數時，將此任務改變由第二節點中的處理器執行。
简体摘要：本发明实施例提出一种运行任务的处理节点决定方法，由处理器于运行守护进程时实施。当一个任务由第一节点中的处理器运行时，守护进程周期性地取得此任务于一段期间之关联于使用第一节点的输出入设备的第一评估分数，以及，于此期间之关联于使用第二节点的输出入设备的第二评估分数。当第二评估分数大于第一评估分数时，将此任务改变由第二节点中的处理器运行。

43. 发明专利

TW201814494A 記憶體系統及處理器系統审中-公开
简体标题：内存系统及处理器系统
公开(公告)号：TW201814494A
公开(公告)日：2018-04-16
申请号：TW106108076
申请日：2017-03-10
申请人：東芝記憶體股份有限公司 , TOSHIBA MEMORY CORPORATION
发明人：野口紘希 , NOGUCHI, HIROKI , 藤田忍 , FUJITA, SHINOBU
IPC分类号： G06F3/06 , G06F9/30
CPC分类号： G06F3/0659 , G06F3/0604 , G06F3/0679 , G06F13/16 , G11C11/1673 , G11C11/1675 , G11C11/1677 , G11C11/1693
摘要：本發明之實施形態係關於記憶體系統及處理器系統。本發明提供一種可實現錯誤產生概率降低、存取速度提高及低消耗電力化之記憶體系統及處理器系統者。一態樣之記憶體系統具備：非揮發記憶體；記憶部，其可較上述非揮發記憶體更高速存取，將對於上述非揮發記憶體之存取資訊於存取至上述非揮發記憶體前進行記憶；及記憶體控制部，其基於上述記憶部之空間容量、或記憶於上述記憶部之上述存取資訊，而控制上述非揮發記憶體之寫入脈衝寬度。
简体摘要：本发明之实施形态系关于内存系统及处理器系统。本发明提供一种可实现错误产生概率降低、存取速度提高及低消耗电力化之内存系统及处理器系统者。一态样之内存系统具备：非挥发内存；记忆部，其可较上述非挥发内存更高速存取，将对于上述非挥发内存之存取信息于存取至上述非挥发内存前进行记忆；及内存控制部，其基于上述记忆部之空间容量、或记忆于上述记忆部之上述存取信息，而控制上述非挥发内存之写入脉冲宽度。

44. 发明专利

TWI620122B 用於資料推測執行的設備和方法有权
简体标题：用于数据推测运行的设备和方法
公开(公告)号：TWI620122B
公开(公告)日：2018-04-01
申请号：TW104138795
申请日：2015-11-23
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 休斯克里斯多夫 , HUGHES, CHRISTOPHER , 瓦倫泰羅柏 , VALENTINE, ROBERT , 吉卡密林德 , GIRKAR, MILIND B.
IPC分类号： G06F9/30 , G06F9/38
CPC分类号： G06F9/3842 , G06F9/30007 , G06F9/30101 , G06F9/3861

45. 发明专利

TW201812573A 用於控制將送至處理電路系統的觸發訊號設定為有效態的行為的裝置及方法审中-公开
简体标题：用于控制将送至处理电路系统的触发信号设置为有效态的行为的设备及方法
公开(公告)号：TW201812573A
公开(公告)日：2018-04-01
申请号：TW106127747
申请日：2017-08-16
申请人： ARM股份有限公司 , ARM LIMITED
发明人：波特曼弗朗索瓦克里斯多福雅客 , BOTMAN, FRANCOIS CHRISTOPHER JACQUES , 格羅卡特湯瑪士克里斯多夫 , GROCUTT, THOMAS CHRISTOPHER , 荷利約翰麥克 , HORLEY, JOHN MICHAEL , 威廉斯麥克約翰 , WILLIAMS, MICHAEL JOHN
IPC分类号： G06F9/30 , G06F11/30
CPC分类号： G06F11/3072 , G06F11/3636 , G06F11/3648
摘要：提供了一種用以控制將送到處理電路系統的觸發訊號設定為有效態的行為的裝置及方法。該裝置具有：評估電路系統，用以接收指示由該處理電路系統所執行之一程式指令的程式指令執行資訊，該評估電路系統被佈置為執行一評估操作以參照評估資訊來判定該程式指令執行資訊是否指示一觸發條件存在。使用觸發訊號產生電路系統以取決於該觸發條件是否被判定存在，將送到該處理電路系統的一觸發訊號設定為有效態。進一步地，過濾電路系統被佈置為接收指示發生在該處理電路系統內的至少一個事件的事件資訊，且被佈置為參照過濾控制資訊及該事件資訊來判定一合格條件是否存在。該過濾電路系統被佈置為在判定該合格條件不存在之後防止將該觸發條件的存在通知給該觸發訊號產生電路系統。這允許將特定程式指令執行行為的監控合格化，使得僅在一合格事件被額外判定存在時才通知該處理電路系統。
简体摘要：提供了一种用以控制将送到处理电路系统的触发信号设置为有效态的行为的设备及方法。该设备具有：评估电路系统，用以接收指示由该处理电路系统所运行之一进程指令的进程指令运行信息，该评估电路系统被布置为运行一评估操作以参照评估信息来判定该进程指令运行信息是否指示一触发条件存在。使用触发信号产生电路系统以取决于该触发条件是否被判定存在，将送到该处理电路系统的一触发信号设置为有效态。进一步地，过滤电路系统被布置为接收指示发生在该处理电路系统内的至少一个事件的事件信息，且被布置为参照过滤控制信息及该事件信息来判定一合格条件是否存在。该过滤电路系统被布置为在判定该合格条件不存在之后防止将该触发条件的存在通知给该触发信号产生电路系统。这允许将特定进程指令运行行为的监控合格化，使得仅在一合格事件被额外判定存在时才通知该处理电路系统。

46. 发明专利

TW201810070A 利用索引和立即數執行向量排列的方法和設備审中-公开
简体标题：利用索引和立即数运行矢量排列的方法和设备
公开(公告)号：TW201810070A
公开(公告)日：2018-03-16
申请号：TW105141618
申请日：2015-11-26
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：柯柏吉瑟斯 , CORBAL, JESUS , 歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 瓦倫泰羅柏 , VALENTINE, ROBERT , 查尼馬克 , CHARNEY, MARK J. , 吉卡密林德 , GIRKAR, MILIND B. , 托爾布萊特 , TOLL, BRET L. , 艾斯帕薩羅傑 , ESPASA, ROGER , 索羅吉勒姆 , SOLE, GUILLEM , 巴拉特傑洛 , BALART, JAIRO , 希克曼布萊恩 , HICKMANN, BRIAN J.
IPC分类号： G06F15/80 , G06F9/30
CPC分类号： G06F9/30036 , G06F7/764 , G06F9/30032 , G06F15/8053 , G06F15/8084 , G06F17/30952 , G06F2209/462
摘要：本發明揭示用於執行向量排列的方法和設備。例如，處理器的一個實施例包含：來源向量暫存器，用以儲存複數個來源資料元件；目的地向量暫存器，用以儲存複數個目的地資料元件；控制向量暫存器，用以儲存複數個控制資料元件，各控制資料元件對應於該些目的地資料元件中的一者且包括N位元值，該N位元值指示來源資料元件是否被複製到該對應的目的地資料元件；向量排列邏輯，用以將各控制資料元件的該N位元值與立即數的N位元部分比較以決定是否將來源資料元件複製到對應的目的地資料元件，其中如果該些N位元值匹配，則該向量排列邏輯是用以使用包括在該控制資料元件中的索引值來識別來源資料元件，以及用以響應地將該來源資料元件複製到該目的地向量暫存器中的該對應的目的地資料元件。
简体摘要：本发明揭示用于运行矢量排列的方法和设备。例如，处理器的一个实施例包含：来源矢量寄存器，用以存储复数个来源数据组件；目的地矢量寄存器，用以存储复数个目的地数据组件；控制矢量寄存器，用以存储复数个控制数据组件，各控制数据组件对应于该些目的地数据组件中的一者且包括N比特值，该N比特值指示来源数据组件是否被复制到该对应的目的地数据组件；矢量排列逻辑，用以将各控制数据组件的该N比特值与立即数的N比特部分比较以决定是否将来源数据组件复制到对应的目的地数据组件，其中如果该些N比特值匹配，则该矢量排列逻辑是用以使用包括在该控制数据组件中的索引值来识别来源数据组件，以及用以响应地将该来源数据组件复制到该目的地矢量寄存器中的该对应的目的地数据组件。

47. 发明专利

TW201810032A 程式語言轉換方法审中-公开
简体标题：编程语言转换方法
公开(公告)号：TW201810032A
公开(公告)日：2018-03-16
申请号：TW105129060
申请日：2016-09-08
申请人：陳家慶
发明人：陳家慶
IPC分类号： G06F9/45 , G06F9/30
摘要：本發明提供一種程式語言轉換方法，包含：(A)一處理模組依序判定第一程式語言中之每一指令的指令類別；(B)當所判定之指令的指令類別為一第一流程控制指令時，該處理模組將該指令及相鄰該指令且與該指令中之變數相關的變數來源指令轉換為第二程式語言之一第二流程控制指令；(C)當所判定之指令的指令類別為參數配置指令時，該處理模組將該指令及相鄰該指令且與該指令中之參數相關的參數配置指令轉換為第二程式語言之運算指令；及(D)當所判定之指令的指令類別為第一輸入輸出指令時處理模組，將該指令轉換為第二程式語言中之一第二輸入輸出指令。
简体摘要：本发明提供一种编程语言转换方法，包含：(A)一处理模块依序判定第一编程语言中之每一指令的指令类别；(B)当所判定之指令的指令类别为一第一流程控制指令时，该处理模块将该指令及相邻该指令且与该指令中之变量相关的变量来源指令转换为第二编程语言之一第二流程控制指令；(C)当所判定之指令的指令类别为参数配置指令时，该处理模块将该指令及相邻该指令且与该指令中之参数相关的参数配置指令转换为第二编程语言之运算指令；及(D)当所判定之指令的指令类别为第一输入输出指令时处理模块，将该指令转换为第二编程语言中之一第二输入输出指令。

48. 发明专利

TW201810029A 用於跨步載入的系統、設備及方法审中-公开
简体标题：用于跨步加载的系统、设备及方法
公开(公告)号：TW201810029A
公开(公告)日：2018-03-16
申请号：TW106118135
申请日：2017-06-01
申请人：美商英特爾股份有限公司 , INTEL CORPORATION
发明人：波特尼可夫麥克漢 , PLOTNIKOV, MIKHAIL , 歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA
IPC分类号： G06F9/30
CPC分类号： G06F9/30036 , G06F9/30018 , G06F9/30032 , G06F9/30043 , G06F9/3016 , G06F9/30192 , G06F9/3455
摘要：說明了用於跨步載入的系統、方法及設備。在實施例中，用以包括至少運算碼、用於至少二緊縮資料來源運算元的欄位、用於緊縮資料目的地運算元的欄位及立即值的指令被指明為跨步載入指令。執行該指令以使用跨步來從該至少二緊縮資料來源運算元載入緊縮資料元件，並且將跨步載入之結果儲存到從部分地自該立即值決定的定義位置開始的該緊縮資料目的地運算元中。
简体摘要：说明了用于跨步加载的系统、方法及设备。在实施例中，用以包括至少运算码、用于至少二紧缩数据源算子的字段、用于紧缩数据目的地算子的字段及立即值的指令被指明为跨步加载指令。运行该指令以使用跨步来从该至少二紧缩数据源算子加载紧缩数据组件，并且将跨步加载之结果存储到从部分地自该立即值决定的定义位置开始的该紧缩数据目的地算子中。

49. 发明专利

TW201810025A 解碼方法、記憶體儲存裝置及記憶體控制電路單元审中-公开
简体标题：译码方法、内存存储设备及内存控制电路单元
公开(公告)号：TW201810025A
公开(公告)日：2018-03-16
申请号：TW105112619
申请日：2016-04-22
申请人：大心電子(英屬維京群島)股份有限公司 , EPOSTAR ELECTRONICS (BVI) CORPORATION
发明人：蕭又華 , HSIAO, YU-HUA , 顏恆麟 , YEN, HENG-LIN
IPC分类号： G06F9/30 , G06K7/015 , G06F13/10
CPC分类号： G06F11/1068 , G11C16/10 , G11C16/26 , G11C29/021 , G11C29/028 , G11C29/36 , G11C29/38 , G11C29/44 , G11C29/52
摘要：一種解碼方法、記憶體儲存裝置及記憶體控制電路單元。此解碼方法包括：基於第一讀取電壓準位讀取目標實體單元以獲得目標資料；對目標資料執行第一解碼操作；若第一解碼操作失敗，基於第一候選電壓準位讀取驗證實體單元以獲得第一輔助資料並基於第二候選電壓準位讀取驗證實體單元以獲得第二輔助資料；根據第一輔助資料與驗證資料獲得第一評估參數並根據第二輔助資料與驗證資料獲得第二評估參數；根據第一評估參數與第二評估參數決定第二讀取電壓準位；以及基於第二讀取電壓準位再次讀取目標實體單元。藉此，可改善解碼效率。
简体摘要：一种译码方法、内存存储设备及内存控制电路单元。此译码方法包括：基于第一读取电压准位读取目标实体单元以获得目标数据；对目标数据运行第一译码操作；若第一译码操作失败，基于第一候选电压准位读取验证实体单元以获得第一辅助数据并基于第二候选电压准位读取验证实体单元以获得第二辅助数据；根据第一辅助数据与验证数据获得第一评估参数并根据第二辅助数据与验证数据获得第二评估参数；根据第一评估参数与第二评估参数决定第二读取电压准位；以及基于第二读取电压准位再次读取目标实体单元。借此，可改善译码效率。

50. 发明专利

TW201810020A 用於累乘的系統、設備及方法审中-公开
简体标题：用于累乘的系统、设备及方法
公开(公告)号：TW201810020A
公开(公告)日：2018-03-16
申请号：TW106117443
申请日：2017-05-25
申请人：美商英特爾股份有限公司 , INTEL CORPORATION
发明人：布朗威廉 , BROWN, WILLIAM M. , 歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA
IPC分类号： G06F7/523 , G06F9/30
CPC分类号： G06F9/30036 , G06F9/3001 , G06F9/30018 , G06F9/30098 , G06F9/3016 , G06F9/30192 , G06F15/8007
摘要：說明了用於執行指令的系統、方法及設備。在一些實施例中，該指令包括至少運算碼、用於緊縮資料來源運算元的欄位以及用於緊縮資料目的地運算元的欄位。當執行時，該指令造成針對該來源運算元之各個資料元件位置，對在該資料元件位置中儲存的值與在該緊縮資料來源運算元之先前資料元件位置中儲存的所有值作乘法，並且將該乘法的結果儲存到該緊縮資料目的地運算元之對應的資料元件位置中。
简体摘要：说明了用于运行指令的系统、方法及设备。在一些实施例中，该指令包括至少运算码、用于紧缩数据源算子的字段以及用于紧缩数据目的地算子的字段。当运行时，该指令造成针对该来源算子之各个数据组件位置，对在该数据组件位置中存储的值与在该紧缩数据源算子之先前数据组件位置中存储的所有值作乘法，并且将该乘法的结果存储到该紧缩数据目的地算子之对应的数据组件位置中。

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