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1. 发明公开

KR20180064975A 선두 제로 예측 审中-公开
公开(公告)号：KR20180064975A
公开(公告)日：2018-06-15
申请号：KR20170155312
申请日：2017-11-21
IPC分类号： G06F7/483 , G06F7/74
CPC分类号： G06F7/483 , G06F5/012 , G06F7/74 , H03K19/20
摘要： 데이터처리장치가제공된다. 중간값생성회로는제 1 부동소수점수치및 제 2 부동소수점수치로부터중간값을생성한다. 중간값은제 1 부동소수점수치및 제 2 부동소수점수치의절대값들사이의차이값에있는선두 0값들의수의예측값을나타내는선두 0값들의수를포함한다. 예측값은제 1 부동소수점수치및 제 2 부동소수점수치의절대값들사이의차이값에있는선두 0값들의수와최대한 1만큼다르다. 계수회로는중간값에있는선두 0값들의수를계수하고, 마스크생성회로는중간값을사용하여한 개이상의마스크를발생한다. 마스크생성회로는, 계수회로가중간값에있는선두 0값들의수를계수하는것과동시에또는계수하기전에한 개이상의마스크를발생한다.

2. 发明公开

KR1020150107614A 데이터 처리장치 및 이진수에 대해 시프트 기능을 수행하는 방법 审中-实审
标题翻译：一种用于执行二进制转换功能的数据处理装置和方法
公开(公告)号：KR1020150107614A
公开(公告)日：2015-09-23
申请号：KR1020150028864
申请日：2015-03-02
申请人： 에이알엠 리미티드
发明人： 루츠데이빗레이몬드 , 버지스네일
IPC分类号： G06F7/49 , G06F5/01
CPC分类号： G06F5/01 , G06F5/012 , G06F7/74 , G06F7/49
摘要： 이진수에 대해 시프트 기능을 수행하는 데이터 처리장치 및 방법이 제공된다. 이 장치는 미리 정해진 비트값을 갖는 이진수에서의 다수의 인접 비트 위치를 결정하는 카운트 결정회로를 구비하고, 상기 카운트 결정회로는, 결정된 다수의 인접 비트 위치를 나타내는 카운트 값을 출력한다. 상기 카운트 결정회로의 동작과 동시에, 코스 시프팅 회로는 적어도 하나의 미리 정해진 수의 인접 비트 위치에 대해, 이진수 내의 미리 정해진 수의 인접 비트 위치가 미리 정해진 비트값을 갖는지 여부를, 판정하기 위해서 사용된다. 그 다음, 중간 이진수를 생성하기 위해서 그 판정에 근거해서 이진수에 대해 초기 시프트 동작을 수행한다. 카운트 값이 카운트 결정회로로부터 이용가능하면, 미세 시프팅 회로는 결과의 이진수를 생성하기 위해서, 카운트 결정회로에 의해 출력된 카운트 값에 근거해, 중간 이진수에 대해 추가 시프트 동작을 수행한다. 이것은 여전히 카운트 결정회로로부터 카운트 값을 취득하면서, 이진수에 대해 시프트 기능을 수행하는 효율적인 메카니즘을 제공한다.
摘要翻译：提供了用于对二进制数执行移位功能的数据处理装置和方法。该装置包括一个计数确定电路，用于确定具有预定比特值的二进制数中的连续比特位数，并且该计数确定电路输出一个表示确定的连续比特位数的计数值。与计数确定电路的操作并行，粗移位电路用于对于至少一个预定数量的连续位位置来确定二进制数中的预定数量的连续位位置是否具有预定位值。然后基于该确定对二进制数执行初始移位操作，以便产生中间二进制数。当从计数确定电路获得计数值时，微调电路然后基于计数确定电路输出的计数值对中间二进制数执行进一步的移位操作，以便产生结果二进制数。因此，提供了一种用于在二进制数目上执行移位功能的有效机构，同时仍然从计数确定电路捕获计数值。

3. 发明授权

KR100818011B1 연산 처리 장치, 정보 처리 장치, 및 연산 처리 방법 有权
标题翻译：算术运算单元，信息处理装置和算术运算方法
公开(公告)号：KR100818011B1
公开(公告)日：2008-03-31
申请号：KR1020060037654
申请日：2006-04-26
申请人： 후지쯔 가부시끼가이샤
发明人： 다지리구니히코
IPC分类号： G06F7/00
CPC分类号： G06F5/012 , G06F7/483 , G06F7/49952 , G06F7/49957 , G06F7/5443 , G06F7/74 , G06F2207/382
摘要： 본 발명은 스티키 비트를 생성하기 위한 하드웨어 자원을 저감하면서, 스티키 비트를 생성하기 위해 요구되는 사이클 타임을 삭감하여 스티키 비트를 효율적으로 생성할 수 있도록 하는 것을 목적으로 한다.
연산 결과가 정규화일 때에 연산 결과가 시프트되었는지의 여부를 나타내는 정보의 생성을 행하는 연산 처리 장치에서, 연산 결과를 출력하는 연산 수단과, 복수의 시프트 수단을 가지며, 연산 결과에 대한 정규화 처리를 복수의 시프트 수단에 의해 분할하여 행하는 정규화 처리 수단(30)과, 복수의 시프트 수단에 대한 복수의 시프트량을 산출하는 시프트량 산출 수단과, 복수의 시프트량을 이용하여 연산 결과가 정규화일 때에 연산 결과가 시프트되는지의 여부의 예측 결과인 임시 정보의 생성을 행하는 예측 수단(51)과, 임시 정보를 이용하여 상기 정보의 생성을 행하는 생성 수단(52)을 구비한다.

4. 发明授权

KR100331846B1 실수 연산기 失效
标题翻译：浮动加法
公开(公告)号：KR100331846B1
公开(公告)日：2002-04-09
申请号：KR1019990011618
申请日：1999-04-02
申请人： 에스케이하이닉스 주식회사
发明人： 이동순
IPC分类号： G06F7/48
CPC分类号： G06F7/74 , G06F5/012 , G06F7/485
摘要： 본발명은연산속도를증가시키기위한실수연산기에관한것으로, 두입력값의사인(Sign) 값을비교하여그에따른제어신호를출력하는콘트롤부와, 상기두 입력값의지수값의차를구하고지수값이큰 유효숫자는그대로출력하고지수값이작은유효숫자를지수자 만큼쉬프팅하여출력하는유효숫자출력부와, 상기콘트롤부의제어에의해두 입력값의지수값 중큰 값을선택하여출력하는제 1 멀티플렉서와, 감산연산시상기콘트롤부의제어신호에따라상기유효숫자출력부의지수값이큰 유효숫자를반전시키는제 1 비트인버터와, 쉬프팅된지수값이작은유효숫자와제 1 비트인버터에서출력되는유효숫자를가산하는가산기와, 상기유효숫자출력부의지수값이큰 유효숫자와쉬프팅된유효숫자로부터제로(zero, '0')의연속성을예측하는리딩제로예측부와, 상기리딩제로예측부의출력으로부터제로값을카운팅하는리딩제로카운터와, 상기가산기에서출력되는값을특정비트수로저장하기위해나머지자릿수를판단하여올림수를출력하는라운딩콘트롤부와, 상기가산기에서출력되는값을상기리딩제로카운터에서출력되는자릿수만큼왼쪽으로자리옮김을수행하는레프트쉬프터와, 상기가산기에서가산된값이음수이면상기레프트쉬프터에서출력되는값을 2의보수로처리하는제 2 비트인버터와, 상기라운딩콘트롤부의신호에따라상기제 2 비트인버터에서출력되는값에 1 증가시켜최종적으로유효숫자값을연산하는인크리먼터와, 상기인크리먼터에서출력되는유효숫자값이최대값일때자릿수를보상하기위해쉬프팅하는보상쉬프터와, 상기제 1 멀티플렉서에서출력되는값과상기리딩제로카운터에서출력되는값을감산하는지수감산기와, 상기지수감산기의출력신호에서 1 비트를감소하여지수값을최종출력하는디크리먼터를포함하여구성된것이다.

5. 发明授权

KR101922462B1 데이터 처리장치 및 이진수에 대해 시프트 기능을 수행하는 방법 有权
公开(公告)号：KR101922462B1
公开(公告)日：2018-11-27
申请号：KR1020150028864
申请日：2015-03-02
申请人： 에이알엠 리미티드
发明人： 루츠데이빗레이몬드 , 버지스네일
IPC分类号： G06F7/49 , G06F5/01
CPC分类号： G06F5/01 , G06F5/012 , G06F7/74
摘要： 이진수에대해시프트기능을수행하는데이터처리장치및 방법이제공된다. 이장치는미리정해진비트값을갖는이진수에서의다수의인접비트위치를결정하는카운트결정회로를구비하고, 상기카운트결정회로는, 결정된다수의인접비트위치를나타내는카운트값을출력한다. 상기카운트결정회로의동작과동시에, 코스시프팅회로는적어도하나의미리정해진수의인접비트위치에대해, 이진수내의미리정해진수의인접비트위치가미리정해진비트값을갖는지여부를, 판정하기위해서사용된다. 그다음, 중간이진수를생성하기위해서그 판정에근거해서이진수에대해초기시프트동작을수행한다. 카운트값이카운트결정회로로부터이용가능하면, 미세시프팅회로는결과의이진수를생성하기위해서, 카운트결정회로에의해출력된카운트값에근거해, 중간이진수에대해추가시프트동작을수행한다. 이것은여전히카운트결정회로로부터카운트값을취득하면서, 이진수에대해시프트기능을수행하는효율적인메카니즘을제공한다.

6. 发明公开

KR1020170037518A 부동소수점 곱셈 장치 및 방법 审中-实审
标题翻译：浮点乘法装置和方法
公开(公告)号：KR1020170037518A
公开(公告)日：2017-04-04
申请号：KR1020160116944
申请日：2016-09-12
申请人： 에이알엠 리미티드
发明人： 루츠데이빗레이몬드
IPC分类号： G06F7/487
CPC分类号： G06F7/487 , G06F5/012
摘要： 부동소수점곱셈의장치및 방법을제공한다. 2개의부분곱은 2개의오퍼랜드가수로부터생성된다. 비편향결과지수는, 오퍼랜드지수값들및 선두제로카운트와, 필요에따라소정의정규형식의소정의최소지수값에대한곱 가수의시프트량과시프트방향으로부터결정된다. 상기부분곱의가산에주입하기위한제1 및제2의라운딩값은, 제1 라운딩값에대한반대의시프트방향으로소정의라운딩패턴을상기시프트방향만큼시프트시키고제2 라운딩값을주기위해상기제1 라운딩을 1비트씩좌측시프트함으로써, 생성된다. 제1 및제2의부분곱은, 제1 곱가수를주기위해제1 라운딩값과함께가산되고, 제2 곱가수를주기위해제2 라운딩값과함께가산된다. 이들곱 가수는시프트방향으로시프트량만큼시프트되고나서, 하나의곱 가수가소정의정규형식으로포맷된가수를생성하기위해서선택된다. 조기주입라운딩은, 보다빠른부동소수점곱셈기를제공한다.
摘要翻译：提供了一种浮点乘法的装置和方法。两个部分产品从两个操作数尾数生成。无偏结果指数，和操作数的指数和所述前导零计数，如从产品尾数对于给定的标准形式的索引的预定最小值的偏移量和偏移方向需要被确定。舍入第一mitje 2的值用于注入另外的部分乘积的是，在换档方向相反于第一轮值第一预定四舍五入图案是由所述移动方向以得到第二舍入值移位左移四舍五入一位。第一和第二产品的部分产品与第一舍入值一起被添加以给出第一产品尾数并且与第二舍入值一起被添加以给出第二产品尾数。这些产品尾数在移位方向上移位一个移位量，并且选择一个产品尾数以产生以预定规范形式格式化的尾数。早期注入四舍五入提供了一个更快的浮点乘法器。

7. 发明授权

KR101085810B1 멀티스테이지 부동 소수점 누산기 有权
标题翻译：多级浮点积分器
公开(公告)号：KR101085810B1
公开(公告)日：2011-11-22
申请号：KR1020097001736
申请日：2007-08-17
申请人： 퀄컴 인코포레이티드
发明人： 두윈 , 위춘 , 자오궈팡
IPC分类号： G06F7/485 , G06F5/01 , G06F7/509
CPC分类号： G06F7/5095 , G06F5/012 , G06F7/485 , G06F7/49936 , G06F2207/3884
摘要： 멀티스테이지 부동 소수점 누산기는 적어도 2 개의 스테이지를 포함하고, 보다 고속으로 동작할 수 있다. 일 디자인에 있어서, 부동 소수점 누산기는 제 1 스테이지 및 제 2 스테이지를 포함한다. 제 1 스테이지는 3 개의 피연산자 정렬 유닛, 2 개의 다중화기, 및 3 개의 래치를 포함한다. 3 개의 피연산자 정렬 유닛은, 현재의 부동 소수점 값, 이전의 부동 소수점 값, 및 이전의 누산된 값에 대해 동작한다. 제 1 다중화기는 제 2 피연산자 정렬 유닛으로 제로 또는 이전의 부동 소수점 값을 제공한다. 제 2 다중화기는 제 3 피연산자 정렬 유닛으로 제로 또는 이전의 누산된 값을 제공한다. 3 개의 래치는 3 개의 피연산자 정렬 유닛에 연결된다. 제 2 스테이지는, 3 개의 피연산자 정렬 유닛에 의해 발생된 피연산자를 합산하는 3-피연산자 가산기, 래치, 및 후정렬 유닛을 포함한다.
멀티스테이지 부동 소수점 누산기, 피연산자 정렬, 후정렬, 산술 논리 유닛, 그래픽스, MAC 연산, 파이프라인

8. 发明公开

KR1020090057588A 비선형 함수 연산을 위한 부동 소수점 프로세서 및 이를이용한 비선형 함수 연산 방법 无效
标题翻译：非线性函数浮点处理器的设计与非线性函数计算方法
公开(公告)号：KR1020090057588A
公开(公告)日：2009-06-08
申请号：KR1020070124235
申请日：2007-12-03
申请人： 충남대학교산학협력단
发明人： 정슬 , 김정섭
IPC分类号： G06F17/10
CPC分类号： G06F5/012 , G06F9/34 , G06F17/10
摘要： A floating point processor for operating nonlinear functions and a method for operating the nonlinear functions by using the processor are provided to design a numerical value operating module including an adder, a subtracter, a multiplier and a divider, thereby obtaining nonlinear functions for robot control through a successive operation. An instruction decoder(3) separately analyzes an instruction code of an operation program stored in a memory(1) based on an opcode address and an operand address. The instruction decoder outputs a control signal for controlling each module for instruction execution. A function unit(5) performs a numerical value operation, a logic operation and format conversion based on single precision.
摘要翻译：提供了一种用于操作非线性函数的浮点处理器和一种通过使用处理器来操作非线性函数的方法，用于设计包括加法器，减法器，乘法器和除法器的数值运算模块，从而获得用于机器人控制的非线性函数一个连续的操作。指令解码器（3）基于操作码地址和操作数地址分别分析存储在存储器（1）中的操作程序的指令代码。指令解码器输出用于控制每个模块的控制信号以进行指令执行。功能单元（5）基于单精度进行数值运算，逻辑运算和格式转换。

9. 发明公开

KR1020160033550A 표현 가능한 수의 범위를 조절하는 방법 및 장치 审中-实审
标题翻译：用于控制代表范围的方法和装置
公开(公告)号：KR1020160033550A
公开(公告)日：2016-03-28
申请号：KR1020140124635
申请日：2014-09-18
申请人： 삼성전자주식회사
发明人： 김창무 , 유형석 , 류수정 , 조연곤
IPC分类号： G06F7/483 , G06T15/00
CPC分类号： G06F7/483 , G06F5/012 , G06F2207/483 , H03M7/24
摘要： 지수와가수가각각기 설정된비트수로표현되는부동소수점값을입력받고, 부동소수점값의지수의최상위비트의값에따라부동소수점값의지수와가수의비트구성을결정하고, 결정된비트구성에따른지수에따라부동소수점값의연산에필요한상수값을결정하는, 표현가능한수의범위를조절하는방법및 장치가개시된다.
摘要翻译：公开了一种用于控制可表示数字范围的方法及其装置。该方法包括以下步骤：接收由指数和尾数表示的浮点值，其中指数和尾数中的每一个由预定位数表示; 根据浮点值的指数的最高有效位的值，确定指数的位配置和浮点值的尾数; 以及根据确定的指数的比特配置来确定计算浮点值所需的常数。

10. 发明公开

KR1020160004830A 객체에 대한 바운딩 박스의 좌표 값을 표현하는 방법 및 장치 审中-实审
标题翻译：用于表示对象的边框的方法和装置
公开(公告)号：KR1020160004830A
公开(公告)日：2016-01-13
申请号：KR1020140083904
申请日：2014-07-04
申请人： 삼성전자주식회사
发明人： 황석중 , 신용삼 , 이원종 , 이재돈
IPC分类号： G06T15/06
CPC分类号： G06T15/405 , G06F5/012 , G06T11/40 , G06T15/06 , G06T15/205 , G06T15/30 , G06T2210/12
摘要： 객체에대한바운딩박스의좌표값을표현하는방법및 장치에관한것으로, 바운딩박스의좌표값중 최소값및 최대값을부동소수점(floating point) 값으로입력받고, 입력받은최대값과최소값의차이값을획득하고, 차이값을지수(exponent) 값과가수(mantissa) 값으로변환하는방법및 장치가개시된다.
摘要翻译：本发明涉及一种用于显示对象的边界框的坐标值的方法和装置。本发明的方法包括以下步骤：从作为浮点的边界框的坐标值接收最小值和最大值; 获得所接收的最大值和最小值的差值; 并将差值转换为指数值和尾数值。

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