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1. 发明授权

KR100429553B1 와이드 전압에서 일정한 히스테리시스를 갖는 슈미트트리거 회로 失效
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公开(公告)号：KR100429553B1
公开(公告)日：2004-05-03
申请号：KR1020020016960
申请日：2002-03-28
申请人： 에스케이하이닉스 주식회사
发明人： 김선민 , 차욱진 , 조병선
IPC分类号： H03K3/3565
摘要： PURPOSE: A Schmitt trigger circuit is provided to have a constant hysteresis characteristic curve regardless of various VDDs by controlling the width of the hysteresis curve. CONSTITUTION: A Schmitt trigger circuit is provided with an input/output part(310) for receiving an input signal and supplying an output signal insensitive to the variation of the input signal and a hysteresis width control part(320) for receiving a VDD selection signal and increasing the hysteresis width of the output signal of the input/output part when applying the VDD selection signal at the first logic step. At this time, the input/output part and hysteresis width control part include the first and second inverter(311,321), respectively.
摘要翻译：目的：通过控制磁滞曲线的宽度，施密特触发器电路提供恒定的滞后特性曲线，而不考虑各种VDD。一种施密特触发器电路，具有输入/输出部分（310），用于接收输入信号并提供对输入信号的变化不敏感的输出信号;以及滞后宽度控制部分（320），用于接收VDD选择信号以及当在第一逻辑步骤施加VDD选择信号时增加输入/输出部分的输出信号的滞后宽度。此时，输入/输出部分和滞后宽度控制部分分别包括第一和第二反相器（311,321）。

2. 发明授权

KR100262665B1 메모리 컨트롤러 구동 방법 失效
标题翻译：一种用于驱动存储器控制器的方法
公开(公告)号：KR100262665B1
公开(公告)日：2000-08-01
申请号：KR1019970060519
申请日：1997-11-17
申请人： 에스케이하이닉스 주식회사
发明人： 원나라 , 차욱진
IPC分类号： G06F12/08
摘要： PURPOSE: A method for driving a memory controller is provided to utilize a cache memory in a microprocessor as a main memory in case that the microprocessor is used for controlling a system. CONSTITUTION: A cache/memory bit of a system control register in the microprocessor is checked(31). If the cache/memory bit represents '1', that is, the cache memory is used as the main memory, it is determined whether an address exists in an area of the cache memory(32). If the address does not exist in the area thereof, data is fetched from an external memory module(34). The data is fetched from the cache memory in case that the address exists in the area thereof(33). If the cache/memory bit represents '0', that is, the cache memory is used as its own purpose, it is determined whether a cache hit occurs(35).
摘要翻译：目的：提供一种用于驱动存储器控制器的方法，以在微处理器用于控制系统的情况下将微处理器中的高速缓冲存储器用作主存储器。构成：检查微处理器中系统控制寄存器的缓存/存储器位（31）。如果缓存/存储器位表示“1”，即将高速缓冲存储器用作主存储器，则确定高速缓冲存储器（32）的区域中是否存在地址。如果该地址不存在，则从外部存储器模块（34）取出数据。在地址存在于其区域的情况下，从高速缓冲存储器取出数据（33）。如果缓存/存储器位表示“0”，即高速缓冲存储器用作其自身目的，则确定是否发生高速缓存命中（35）。

3. 发明公开

KR1020000042420A 자동차 안전 장치 및 그 구동 방법 无效
标题翻译：车辆的安全装置及其驱动方法
公开(公告)号：KR1020000042420A
公开(公告)日：2000-07-15
申请号：KR1019980058585
申请日：1998-12-24
申请人： 에스케이하이닉스 주식회사
发明人： 차욱진
IPC分类号： B60K28/00 , B60Q1/52
摘要： PURPOSE: A safety device for a vehicle is provided to secure safe traveling of a vehicle by automatically controlling an emergency lamp depending on speed reducing rate per second of the vehicle. CONSTITUTION: In suddenly applying the brake to reduce speed from 100Km/h to 60Km/h, the speed reducing rate is larger than first reference speed and an emergency signal is enabled. An emergency lamp(10) operates automatically to inform the following vehicle of the emergency situation. Then, the speed reducing rate per second falls down to negative value and becomes smaller than first and second reference speed when the emergency situation is released and speed data increases to 80Km/h. Therefore, the emergency signal is enabled and the emergency lamp is automatically turned off.
摘要翻译：目的：提供一种用于车辆的安全装置，以通过根据车辆每秒的减速率自动控制应急灯来确保车辆的安全行驶。构成：在突然施加制动以将速度从100Km / h降低到60Km / h时，减速比大于第一参考速度并启用紧急信号。应急灯（10）自动运行，通知下列车辆的紧急情况。然后，当紧急情况被释放并且速度数据增加到80Km / h时，每秒降速率降到负值并变得小于第一和第二参考速度。因此，应急信号被使能，应急灯自动关闭。

4. 发明公开

KR1020000001332A 축차근사레지스터를이용한아날로그-디지털변환장치 失效
标题翻译：模拟数字转换器件
公开(公告)号：KR1020000001332A
公开(公告)日：2000-01-15
申请号：KR1019980021540
申请日：1998-06-10
申请人： 에스케이하이닉스 주식회사
发明人： 차욱진
IPC分类号： H03M1/12
CPC分类号： H03M1/38 , H03M2201/6107
摘要： PURPOSE: An analog-digital converting device is provided to improve the speed for converting an analog signal into digital signal as a effective SAR design. CONSTITUTION: The analog-digital converting device comprises: a first unit(30) to generate a conversion starting signal informing a start of the analog-digital conversion and a channel selection signal in response to a first control signal and a plurality of address signals input from a core; a second unit(32) to generate an enable signal for enabling the analog-digital converting device in response to a second control signal and the address signals; a third unit(34) to receive a test clock signal for the analog-digital conversion and then select one from the two clock signals, and to divide the selected clock signal for using as a reference clock of a SAR unit; a fourth unit(36) which is a block to inform the start and the end of an operation of the SAR unit and to generate a conversion completion signal informing the completion of a analog-digital conversion for outputting to a result storing unit; and a fifth unit(40) to generate a digital signal of a reference voltage input to a comparison unit in response to the reference clock and the enable signal.
摘要翻译：目的：提供一种模拟数字转换装置，以提高将模拟信号转换为数字信号的速度，作为有效的SAR设计。构成：模拟数字转换装置包括：第一单元（30），用于响应于第一控制信号和多个地址信号输入产生通知模拟数字转换开始的转换启动信号和通道选择信号从核心; 第二单元（32），用于响应于第二控制信号和地址信号而产生用于启用模数转换装置的使能信号; 第三单元（34），用于接收用于模拟数字转换的测试时钟信号，然后从两个时钟信号中选择一个，并将所选择的时钟信号划分为SAR单元的参考时钟; 第四单元（36），其是用于通知SAR单元的操作的开始和结束的块，并且生成通知完成模拟数字转换以输出到结果存储单元的转换完成信号; 以及第五单元（40），用于响应于参考时钟和使能信号而产生输入到比较单元的参考电压的数字信号。

5. 发明授权

KR100341586B1 바이어스 회로 失效
标题翻译：偏置电路
公开(公告)号：KR100341586B1
公开(公告)日：2002-06-22
申请号：KR1019990025825
申请日：1999-06-30
申请人： 에스케이하이닉스 주식회사
发明人： 차욱진
IPC分类号： H03M1/34
摘要： 본발명은오토-제로구간에서비교기의동작점을안정화하기위한바이어스회로를제공하기위한것으로, 이를위해본 발명의안정적인전압을제공하기위한바이어스회로에있어서, 제1 및제2 입력신호를제1 및제2 입력단으로각각인가받아상기제1 및제2 입력신호를비교증폭한후 제1 및제2 출력신호를출력하기위한제1 증폭수단; 접지전원단및 전원전압단에연결되어항상스위치가온되도록이루어지며, 상기제1 증폭수단의상기제1 입력신호와상기제1 출력신호를연결하기위한제1 스위칭수단; 접지전원단및 전원전압단에연결되어항상스위치가온되도록이루어지며, 상기제1 증폭수단의상기제2 입력신호와상기제2 출력신호를연결하기위한제2 스위칭수단; 전압분배동작으로 (1/2 전원전압)을생성하기위한전압분배수단; 상기제1 입력단으로상기제1 입력신호를인가받고상기전압분배수단으로부터출력되는 (1/2 전원전압)을상기제2 입력단으로인가받아증폭동작을수행하기위한제2 증폭수단; 상기제1 증폭수단의상기제2 입력단과상기제2 증폭수단의출력단사이에연결되는커패시터; 및상기제2 증폭수단의출력단에연결되어제1 및제2 바이어스신호를생성하기위한바이어스전압출력부를포함하며, 상기비교장치의오토-제로구간에서상기제1 증폭수단의상기제1 입력신호및 상기제1 출력신호와, 상기제1 증폭수단의상기제2 입력신호및 상기제2 출력신호를동일하게 (1/2 전원전압)으로고정하는것을포함한다.

6. 发明授权

KR100284312B1 8X196마이크로콘트롤러용인터럽트벡터생성장치 失效
公开(公告)号：KR100284312B1
公开(公告)日：2001-03-02
申请号：KR1019970027890
申请日：1997-06-26
申请人： 에스케이하이닉스 주식회사
发明人： 원나라 , 차욱진
IPC分类号： G06F9/46
摘要： 본 발명은 최소의 하드웨어 추가로 1 상태시간 미만의 시간으로 벡터를 생성할 수 있는 8X196 마이크로콘트롤러용 인터럽트 벡터 생성 장치를 제공하기 위한 것으로, 이를 위해 본 발명은 소프트웨어 인터럽트 서비스 및 피티에스(PTS, Peripheral Transaction Server) 인터럽트 서비스를 제공하는 8X196 마이크로콘트롤러의 인터럽트 벡터 생성 장치에 있어서, 현재 처리해야 할 인터럽트의 번호를 저장하고 있는 4비트의 인터럽트 번호 저장수단; 상기 인터럽트 번호 저장수단의 각비트를 디코딩하여 해당 인터럽트의 피티에스(PTS) 서비스 요청 정보에 따라 PTS 서비스 시의 인터럽트 벡터 생성을 제어하는 제어 수단; 상기 제어 수단의 출력 신호에 응답하여 피티에스(PTS) 서비스인 경우에 항상 ″0″의 값을, 소프트웨어 서비스와 마스크 불가능한 인터럽트 서비스의 경우에 상기 인터럽트 번호저장수단의 최상위 비트를 선택적으로 출력하는 선택수단; 및 생성하고자 하는 16비트의 인터럽트 벡터를 저장하고 있는 인터럽트 벡터 저장수단을 포함하며, 상기 인터럽트 벡터 저장수단은, 16비트 중 최상위 4비트([15;12])에 16진수 ″2″의 값을, 상기 최상위 4비트 연속되는 그 다음 하위 4비트(11:8])에 16진수 ″0″의 값을, 상기 하위 4비트([11:8])에 연속되는 그 다음 하위 1비트([7])에 2진수 ″0″의 값을, 최하위 비트([0])에 2 진수 ″0″의 값을 각각 저장하고, 상기 최하위 비트에 연속되는 그 다음 상위 4비트9[4:1])에 상기 인터럽트 번호 저장 수단의 4비트 인터럽트 번호를 저장하고, 상기 상위 4비트([4;1])에 연속되는 그 다음 상위 1비트([5])에 상기 선택수단의 출력 신호를 저장하고, 상기 상위 1비트([5])의 그 다음 상위 1 비트([6])에 상기 제어 수단의 출력 신호를 저장하도록 구성된다.

7. 发明公开

KR1020010005038A 바이어스 회로 失效
标题翻译：用于比较改进的变速装置
公开(公告)号：KR1020010005038A
公开(公告)日：2001-01-15
申请号：KR1019990025825
申请日：1999-06-30
申请人： 에스케이하이닉스 주식회사
发明人： 차욱진
IPC分类号： H03M1/34
CPC分类号： H03M1/129 , H03M1/34
摘要： PURPOSE: A device for comparing improved in movements speed is provided to guarantee stable movements of a comparing instrument and to improve movements speed of the comparing instrument in the auto-zero section. CONSTITUTION: The device includes an amplifier(100), a switching portion(120, 140), an operation amplifier(160), a capacitor(C) and a dummy comparing instrument(180). The first and second input signals(Vn ,Vp) are permitted to the amplifier(100) as an inverted input step(-) and a normal input step(+). The switching portion(120) connects the first input signal(Vn) of the amplifier(100) with the first output signal(outP). The switching portion(140) connects the second input signal(Vp) of the amplifier(100) with the second output signal(outN). The first input signal(Vn) is permitted as the inverted input step(-) and the normal input step(+) is connected with the connecting node(Vo5) in the operation amplifier(160). The capacitor(C) is connected between the input step of the second input signal(Vp) and the output step of the operation amplifier(160). The dummy comparing instrument(180) generates the bias signals(NBIAS, CBIAS).
摘要翻译：目的：提供一种用于比较改进的移动速度的装置，以保证比较仪器的稳定运动，并提高自动归零部分中比较仪器的运动速度。构成：该装置包括放大器（100），开关部分（120,140），运算放大器（160），电容器（C）和虚拟比较仪器（180）。第一和第二输入信号（Vn，Vp）被允许作为反相输入步（ - ）和正常输入步（+）到放大器（100）。开关部分（120）将放大器（100）的第一输入信号（Vn）与第一输出信号（outP）连接。开关部分（140）将放大器（100）的第二输入信号（Vp）与第二输出信号（outN）连接。允许第一输入信号（Vn）作为反相输入步（ - ），并且正常输入步（+）与运算放大器（160）中的连接节点（Vo5）连接。电容器（C）连接在第二输入信号（Vp）的输入步骤与运算放大器（160）的输出步骤之间。虚拟比较仪器（180）产生偏置信号（NBIAS，CBIAS）。

8. 发明公开

KR1019990003927A 8X196마이크로콘트롤러용인터럽트벡터생성장치 失效
标题翻译：用于8X196微控制器的中断向量生成器
公开(公告)号：KR1019990003927A
公开(公告)日：1999-01-15
申请号：KR1019970027890
申请日：1997-06-26
申请人： 에스케이하이닉스 주식회사
发明人： 원나라 , 차욱진
IPC分类号： G06F9/46
摘要： 1. 청구범위에 기재된 발명이 속한 기술분야
마이크로콘트롤러.
2. 발명이 해결하고자 하는 기술적 과제
종래의 롬 테이블 방법의 문제점인 롬 크기가 커진다는 문제점을 해결하고, 전용 가산기를 사용하는 경우의 하드웨어 낭비의 문제점을 해결하며, 산술 논리 연산 장치의 가산기를 이용하는 경우의 수행 시간 지연의 문제점을 해결한 인터럽트 벡터 생성 장치를 제공하고자 함.
3. 발명의 해결 방법의 요지
최소한의 디지털 논리 회로만으로 인터럽트 벡터 및 PTS 벡터를 생성해 낼 수 있도록하여, 최소의 하드웨어 추가로 1 상태시간 미만의 시간으로 벡터를 생성할 수 있는 8X196 마이크로콘트롤러용 인터럽트 벡터 생성 장치를 제공하고자 함.
4. 발명의 중요한 용도
8X196 마이크로콘트롤러 호환용칩 설계에 이용됨.

9. 发明公开

KR1020030058303A 저전압 감지 회로 无效
标题翻译：低电压感应电路
公开(公告)号：KR1020030058303A
公开(公告)日：2003-07-07
申请号：KR1020010088719
申请日：2001-12-31
申请人： 에스케이하이닉스 주식회사
发明人： 조병선 , 김선민 , 차욱진
IPC分类号： G05F1/10
摘要： PURPOSE: A low voltage sense circuit is provided to remove a ripple of an internal supply voltage by using a schmitt circuit having hysteresis. CONSTITUTION: A low voltage sense circuit includes a band gap reference voltage generation portion(210), a voltage divider portion(220), a ripple shield portion(230), and a comparator portion(240). The band gap reference voltage generation portion generates a reference voltage. The voltage divider portion receives an enable signal, divides an internal supply voltage, and outputs the divided voltage. The ripple shield portion removes the ripples from the divided voltage of the voltage divider portion. The comparator portion compares the internal supply voltage of the ripple shield portion with a reset threshold voltage of the voltage divider portion and outputs a reset signal.
摘要翻译：目的：提供低电压检测电路，通过使用具有滞后的施密特电路来消除内部电源电压的纹波。构成：低电压检测电路包括带隙基准电压产生部分（210），分压器部分（220），纹波屏蔽部分（230）和比较器部分（240）。带隙基准电压产生部分产生参考电压。分压器部分接收使能信号，分配内部电源电压，并输出分压。波纹屏蔽部分从分压器部分的分压中去除波纹。比较器部分将波纹屏蔽部分的内部电源电压与分压器部分的复位阈值电压进行比较，并输出复位信号。

10. 发明公开

KR1020030058302A 저전압 감지 회로 有权
标题翻译：低电压感应电路
公开(公告)号：KR1020030058302A
公开(公告)日：2003-07-07
申请号：KR1020010088718
申请日：2001-12-31
申请人： 에스케이하이닉스 주식회사
发明人： 차욱진 , 김선민 , 조병선
IPC分类号： G01R19/165
摘要： PURPOSE: A low voltage sensing circuit is provided, which has a reset threshold voltage of several steps appropriate for a plurality of internal power supply voltages. CONSTITUTION: A band gap reference voltage generation unit(210) generates a reference voltage and applies it the device. An internal power supply voltage sensing unit(220) compares the reference voltage applied from the band gap reference voltage generation unit with a voltage obtained by dividing the internal power supply voltage by receiving an enable signal. And a reset threshold voltage applying unit(230) sets a reset threshold voltage according to the internal power supply voltage sensing signal, and compares it with the internal power supply voltage applied from the internal power supply voltage sensing unit, and outputs a reset signal.
摘要翻译：目的：提供一种低电压感测电路，其具有适合于多个内部电源电压的若干步骤的复位阈值电压。构成：带隙基准电压产生单元（210）生成参考电压并将其施加于该装置。内部电源电压感测单元（220）将从带隙基准电压产生单元施加的参考电压与通过接收使能信号分压内部电源电压而获得的电压进行比较。复位阈值电压施加单元根据内部电源电压检测信号设定复位阈值电压，并将其与从内部电源电压检测单元施加的内部电源电压进行比较，并输出复位信号。

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