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热词
    • 121. 发明公开
    • 제어 시스템
    • KR1019950029886A
    • 1995-11-24
    • KR1019950009582
    • 1995-04-24
    • 화낙 코퍼레이션
    • 기노시따지로구보요시유끼
    • G05B19/18
    • 대화형 데이터 처리 장치를 FA 제어 장치로부터 떨어진 장소에 설치하고, 또한 대화형 데이터 처리 장치로부터 FA 제어 장치 내의 메모리에 직접 억세스할 수 있도록 한다. MMC(20) 내에 있어서, CNC(30) 내의 메모리(3)으로 억세스 요구가 출력되면, 억세스 요구는 리모드억세스 제어 수단(1)에 의해 CNC(30)에 대해 출력된다. CNC(30)내의 내부 데이터 입출력 수단(2)는 억세스 요구를 수취하면, 메모리(3)으로 다이렉트 메모리 억세스(DMA)를 행하고, 요구된 어드레스로 억세스한다. 그리고, 억세스 요구가 라이트 요구였던 경우, 메모리에 데이터를 기록한다. 또, 억세스 요구가 리드 요구였던 경우, 지정된 데이터를 MMC(20)에 대해 출력한다. MC(20) 내의 리모드 억세스 제어 수단(1)은 입력된 데이터를 수취하고, 억세스 요구를 출력한 장치에 데이타를 전송한다. 이와 같이 해서 MMC(20)으로부터 직접CNC(30) 내의 메모리(3)에 대해 억세스할 수 있다.
    • 124. 发明公开
    • 공구직경에 따른 이동경로 보정방법
    • KR1019940015732A
    • 1994-07-21
    • KR1019920025791
    • 1992-12-28
    • 삼성전자주식회사
    • 강문
    • G05B19/18
    • 본 발명은 컴퓨터수치 제어기기에 의한 공작물의 가공시, 첫번째 가공블록이 직선이고, 두번째 블록이 원호이며, 그 교점각도(O)가 0〈0〈90°인 경우의 공구이동경로를 보정생성할수 있는 공구직경에 따른 이동경로 보정 방법에 관한 것으로써, 공구직경에 따라 보정된 공구이동경로를 이동하면서 원하는 형상으로 공작물을 가공하는 CNC공작기계에 있어서, 직선의 시작점, 직선 및 원호의 교점, 원호의 종료점을 설정한 상태에서 제1마이크로프로세서에 의해 이동경로보정무시, 공구이동방향의 좌측 또는 우측으로의 보정여부를 판단토록 해당코드를 읽어 들이는 제1스텝과, NC프로그램에서 한 블록의 프로그램을 제1마이크로프로세서가 읽어들인후 이동경로보정 진행중인지의 여부를 판별하는 제2스텝과, 이판별결과 이동경로보정이 진행중일 경우에는 공구반지름 크기의 직선 수평 베터 d1 및 원호수직벡터 V2를 구하는 제3스텝과, 제1마이크로세서에 의해 연산된 공구직경에 따른 공구반지름 크기의 직선수직벡터 V1 및 원호수평벡터 d2를 구하는 제4스텝과, 직선과 원호가 접하는 교점에서 각각 수직하는 벡터 V1' 및 V2' 를 구하는 제5스텝과, 첫번째 교점벡터 C1을 구하는 제6스텝과, 두번째 직선과 원호간의 교점벡터 C2를 구하는 제7스텝과, 세번째 직선과 원호간의 교정베턱 C3를 구하는 제8스텝과, 상기 각각의 스텝에서 구해진 점들을 서로 연결하여 보정된 공구이동경로에 따라 서보모터를 구동시키는 제9스텝으로 이루어진 것을 특징으로 한다.
    • 128. 发明授权
    • PLC의 랙 어드레스라인 복수기능 구현 시스템
    • PLC的机架地址多功能操作系统
    • KR1019930005709B1
    • 1993-06-24
    • KR1019900022443
    • 1990-12-29
    • 엘에스산전 주식회사
    • 현태인
    • G05B19/04G05B19/18
    • The duplex rack address line communicates data between a programmable logic controller and special I/O cards having CPU and common RAM. The system includes a chip selection signal generator (10) for combining address signals (A13-A15) of a CPU to generate chip selection signal, a slot connector for interfacing chip selection signal, a read/write signal generator (17) for combining read/write signal, chip selection signal (CS0), byte signal (BY2) and data signal to generate read/write control signal, an I/O processing CPU (19) for controlling an I/O cards according to interrupt signal (INT) and fine (FIN) signal generated by the read/write signal generator (17), a common RAM (21) for storing I/ O data of the CPU (19), a transmitter/receiver (18) for transmitting output data of the CPU (19), a transmitter/receiver (18) for transmitting output data of the CPU (19) to the slot connector (11), and a multiplexer (20) for storing address signals (A0-A13), and read/write signal on the common RAM (21).
    • 双工机架地址线在可编程逻辑控制器和具有CPU和公共RAM的特殊I / O卡之间传送数据。 该系统包括用于组合CPU的地址信号(A13-A15)以产生芯片选择信号的芯片选择信号发生器(10),用于接口芯片选择信号的时隙连接器,用于组合读取的读/写信号发生器(17) /写信号,芯片选择信号(CS0),字节信号(BY2)和数据信号产生读/写控制信号,根据中断信号(INT)控制I / O卡的I / O处理CPU(19) 和由读/写信号发生器(17)产生的精细(FIN)信号,用于存储CPU(19)的I / O数据的公共RAM(21);发送/接收器(18),用于发送 CPU(19),用于将CPU(19)的输出数据发送到时隙连接器(11)的发送器/接收器(18)和用于存储地址信号(A0-A13)和读/写的多路复用器 公共RAM(21)上的信号。