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热词
    • 1. 发明公开
    • 반도체 소자 및 이의 제조 방법
    • 半导体装置及其制造方法
    • KR1020170030357A
    • 2017-03-17
    • KR1020150127841
    • 2015-09-09
    • 삼성전자주식회사
    • 박세준윤장근황성민문안식샤즈리앙
    • H01L27/115
    • H01L27/1157H01L27/11582
    • 반도체소자는, 기판상면에수직한제1 방향으로연장되는반도체패턴과, 상기반도체패턴상에상기반도체패턴과상기제1 방향으로이격되도록구비되는채널패턴과, 상기반도체패턴및 채널패턴사이에서상기반도체패턴및 채널패턴을전기적으로연결시키는연결구조물과, 상기반도체패턴을둘러싸면서상기기판상면에평행한제2 방향을따라연장되는제1 게이트와, 상기채널패턴을둘러싸면서상기제2 방향을따라연장되는복수의제2 게이트들및 상기채널패턴및 제2 게이트사이에구비되고, 터널절연막패턴, 전하저장막패턴및 블로킹패턴을포함하는정보저장구조물을포함한다. 상기연결구조물에의해상기채널패턴및 반도체패턴이전기적으로연결될수 있다.
    • 一种半导体器件包括:半导体图案,在垂直于衬底的上表面的第一方向上延伸;沟道图案,形成在半导体图案上以沿着第一方向与半导体图案间隔开; 连接结构,用于电连接所述半导体图案和所述沟道图案;第一栅极,围绕所述半导体图案并且沿平行于所述衬底的所述顶表面的第二方向延伸; 以及信息存储结构,设置在沟道图案和第二栅极之间并且包括隧道绝缘膜图案,电荷存储膜图案和阻挡图案。 沟道图案和半导体图案可以通过连接结构电连接。
    • 3. 发明公开
    • 웨이퍼 냉각 기체용 아크 방지체
    • 防止冷却气体的ARC防结构
    • KR1020040003284A
    • 2004-01-13
    • KR1020020037943
    • 2002-07-02
    • 삼성전자주식회사
    • 문안식최규상양윤식김진만
    • H01L21/02
    • PURPOSE: An arc preventing structure for wafer cooling gas is provided to be capable of securely preventing the generation of plasma arc phenomenon by prolonging the moving path of the wafer cooling gas. CONSTITUTION: An arc preventing structure(100) is located at the inner portion of a wafer cooling gas moving path. At this time, the arc preventing structure includes a body part(101) inserted in the moving path. At the time, a plurality of groove(102) are formed at the peripheral portion of the body part. Preferably, each groove is used for smoothly inducing the flow of wafer cooling gas in order to prevent arc phenomenon from being generated at the inner portion of the moving path. Preferably, the groove is formed into a spiral type structure.
    • 目的:提供一种用于晶片冷却气体的防弧结构,通过延长晶片冷却气体的移动路径,能够可靠地防止等离子体电弧现象的产生。 构成:防弧结构(100)位于晶片冷却气体移动路径的内部。 此时,防弧结构包括插入移动路径的主体部(101)。 此时,在主体部的周边部形成有多个槽102。 优选地,每个凹槽用于平滑地引导晶片冷却气体的流动,以防止在移动路径的内部部分产生电弧现象。 优选地,所述槽形成为螺旋型结构。
    • 4. 发明公开
    • 3차원 반도체 메모리 소자 및 그의 형성 방법
    • 三维半导体存储器件及其形成方法
    • KR1020170054855A
    • 2017-05-18
    • KR1020150157520
    • 2015-11-10
    • 삼성전자주식회사
    • 박세준윤장근황성민문안식샤즈리앙
    • H01L27/115
    • 3차원반도체메모리소자및 그의형성방법이제공된다. 상기 3차원반도체메모리소자는기판상에위치하는제 1 게이트패턴; 상기제 1 게이트패턴의상부면상에위치하는제 2 게이트패턴; 상기제 1 게이트패턴의측면상에위치하고, 상기제 1 게이트패턴의상부면과상기제 2 게이트패턴의하부면사이로연장하는제 1 배리어패턴; 상기제 1 배리어패턴의측면상에위치하는제 1 유전패턴; 상기제 2 게이트패턴의측면상에위치하고, 상기제 1 배리어패턴의상부면과상기제 2 게이트패턴의하부면사이로연장하는제 2 배리어패턴; 및상기제 2 배리어패턴의측면상에위치하고, 상기제 1 배리어패턴의상부면과상기제 2 배리어패턴의하부면사이로연장하는제 2 유전패턴을포함한다. 상기제 2 유전패턴은상기제 1 유전패턴의상부면상으로연장한다.
    • 提供了一种三维半导体存储器件及其形成方法。 该三维半导体存储器件包括位于衬底上的第一栅极图案; 位于第一栅极图案的上表面上的第二栅极图案; 第一阻挡图案,位于第一栅极图案的一侧并且在第一栅极图案的顶表面和第二栅极图案的底表面之间延伸; 定位在第一阻挡图案的一侧上的第一电介质图案; 第二阻挡图案,位于第二栅极图案的一侧并且在第一阻挡图案的上表面和第二栅极图案的下表面之间延伸; 以及第二电介质图案,位于第二阻挡图案的一侧并且在第一阻挡图案的上表面和第二阻挡图案的下表面之间延伸。 第二电介质图案在第一电介质图案的上表面上延伸。
    • 8. 发明公开
    • 공정 챔버
    • 过程室
    • KR1020080075734A
    • 2008-08-19
    • KR1020070015032
    • 2007-02-13
    • 삼성전자주식회사
    • 박재경박영규이원순허노현김병동문안식
    • H01L21/3065H01L21/687
    • H01J37/32715H01L21/68721
    • A process chamber is provided to compensate for a distortion of a sheath boundary by horizontally forming the sheath boundary on a surface of a substrate. A process chamber includes a plate(100) and an upper ring(104). The plate is placed on a substrate. The upper ring is installed around the plate and has a main surface. A relative height between the main surface of the upper ring and a main surface of the plate is changed. The plate is fixed, while a height of the upper ring is adjustable. A ring lift pin(106) is connected to a lower portion of the upper ring to support the upper ring. The ring lift pin elevates the upper ring in upward and downward directions. At least two lift pins are connected to the upper ring. The lift pins are connected to the upper ring with a constant distance from each other.
    • 提供处理室以通过在基板的表面上水平地形成护套边界来补偿护套边界的变形。 处理室包括板(100)和上环(104)。 将板放置在基板上。 上环安装在板上并具有主表面。 改变上环的主表面和板的主表面之间的相对高度。 板固定,上环的高度可调。 环提升销(106)连接到上环的下部以支撑上环。 环形提升销沿上下方向提升上环。 至少两个提升销连接到上环。 升降销以相互间隔一定的距离连接到上环。