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1. 发明申请

WO2010034831A1 DISPOSITIF DE SECURISATION D'UN COMPOSANT ELECTRONIQUE 审中-公开
标题翻译：用于保护电子元件的装置
公开(公告)号：WO2010034831A1
公开(公告)日：2010-04-01
申请号：PCT/EP2009/062505
申请日：2009-09-28
申请人： THALES , IZARD, Christophe , JEULIN, Franck
发明人： IZARD, Christophe , JEULIN, Franck
IPC分类号： G06F11/36 , G06F11/26
CPC分类号： G06F11/3648 , G06F11/261
摘要： L'invention concerne un dispositif de sécurisation d'un composant électronique comprenant un processeur (11 ), un module espion (12) permettant d'interroger des registres du processeur (11 ), des moyens de connexion (13) permettant de raccorder le module espion (12) à des moyens d'activation (14) du module espion (12), les moyens d'activation (14) étant externes au composant (10), le module espion (12) exécutant, lors de son activation, un programme spécifique stocké à une adresse d'une mémoire (15) du composant (10). Selon l'invention, le composant (10) comprend une mémoire de sécurisation (16) pouvant contenir des instructions permettant un saut vers le programme spécifique. Ce saut est présent lors d'opération de test du composant et est supprimé lors du fonctionnement opérationnel du composant (10). Ainsi même en cas d'activation intempestive du module espion (12), le programme spécifique n'est pas lancé.
摘要翻译：本发明涉及一种用于固定电子部件的装置，所述装置包括处理器（11），能询问处理器（11）的间谍模块（12）进行寄存，用于连接间谍模块（12）的连接装置）到所述间谍模块（12）的激活装置（14），所述激活装置（14）在组件（10）之外，并且所述间谍模块（12）在其启动时执行存储在所述组件地址在组件（10）的存储器（15）中。根据本发明，组件（10）包括可以包含能够转移到所述特定程序的指令的安全存储器（16）。在组件的测试操作期间存在移位，并且在组件（10）的功能操作期间被取消。因此，即使间谍模块（12）意外地被激活，也不执行特定的程序。

2. 发明申请

WO2005109807A1 PROCEDE DE TRANSMISSION SERIE DE DONNEES ENTRE UN EMETTEUR ET UN RECEPTEUR 审中-公开
标题翻译：用于在发射机和接收机之间数据传输的方法
公开(公告)号：WO2005109807A1
公开(公告)日：2005-11-17
申请号：PCT/EP2005/051505
申请日：2005-04-04
申请人： THALES , CHESNE, Philippe , IZARD, Christophe
发明人： CHESNE, Philippe , IZARD, Christophe
IPC分类号： H04L25/49
CPC分类号： H04L25/4904 , H04L25/4906
摘要： L'invention se rapporte à un procédé de transmission série de données série un émetteur (10) et un récepteur (11), les données étant exprimées au moyen de mots prédéfinis (21, 22, 23) comprenant des bits consécutifs, chaque bit se trouvant dans un état logique déterminé parmi deux états logiques possibles (0, 1). Des changements d'état logique entre deux bits émis par l'émetteur (10) n'interviennent que selon une première période sensiblement régulière. Le récepteur (11) ne lit les bits reçus de l'émetteur (10) que selon une seconde période sensiblement régulière. La première et la seconde période sont sensiblement égales. Chaque mot (21, 22, 23) émis comprend un premier nombre de bits consécutifs identiques au premier état logique (1), le premier nombre étant au moins égal à deux, suivi d'au moins deux bits consécutifs identiques au second état logique (0). Entre deux mots (21, 22, 23) distincts, le nombre de bits consécutifs identiques au premier état logique (1) de chacun diffère d'au moins trois.
摘要翻译：本发明涉及一种用于在发射机（10）和接收机（11）之间串行传输数据的方法，其中所述数据由预定义的字（21,22,23）表示，所述预定义字包括连续的比特，每一个都是逻辑的状态在两个可能的逻辑（0,1）之间确定。由发射机（10）发射的两个比特之间的逻辑状态（21,22,23）可以根据第一基本规则的周期进行修改。接收器（11）仅根据第二基本上规则的周期读取从发送器（10）接收的比特。第一个和第二个正常周期基本相等。每个发出的字（21,22,23）包括与第一逻辑状态（1）相同的第一数目的连续位，其中第一数目至少等于2，并且后跟至少两个与第二逻辑状态逻辑状态（0）。对于两个不同字（21,22,23）中的每一个，与第一逻辑状态（1）相同的连续位的数目至少不同于3。

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