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1. 发明申请

WO2014108749A1 Data processor and method for data processing 审中-公开
标题翻译：数据处理器和数据处理方法
公开(公告)号：WO2014108749A1
公开(公告)日：2014-07-17
申请号：PCT/IB2013/050220
申请日：2013-01-10
申请人： FREESCALE SEMICONDUCTOR, INC. , BARAK, Itzhak , AMIR, Aviram , BEN ZEEV, Eliezer
发明人： BARAK, Itzhak , AMIR, Aviram , BEN ZEEV, Eliezer
IPC分类号： G06F9/06 , G06F9/30 , G06F12/00
CPC分类号： G06F15/8023 , G06F7/764 , G06F9/3001 , G06F9/30032 , G06F9/30036 , G06F9/30098 , G06F9/30109 , G06F15/8061
摘要： A integrated circuit device has at least one instruction processing module (100) arranged for executing vector data processing upon receipt of a respective one of a set of data processing instructions (130). The data processing instructions include at least one matrix processing instruction for processing elements of a matrix. The elements of rows of the matrix are stored in a set of registers (110), and the instruction processing module comprising an accessing unit (120, 120') for accessing selected elements of the matrix, which selected elements are non- sequentially located according to a predetermined pattern across multiple registers of the set of registers, the accessing enabling respective processing lanes to write or read different registers. Advantageously elements in columns of a matrix can efficiently be processed.
摘要翻译：集成电路装置具有至少一个指令处理模块（100），用于在接收到一组数据处理指令（130）中的相应一个时执行向量数据处理。数据处理指令包括用于处理矩阵元素的至少一个矩阵处理指令。矩阵的行的元素被存储在一组寄存器（110）中，并且指令处理模块包括用于访问矩阵的所选元素的访问单元（120,120'），所选择的元素根据到该组寄存器的多个寄存器的预定模式，该访问使得相应的处理通道能够写入或读取不同的寄存器。有利的是，可以有效地处理矩阵列中的元素。

2. 发明申请

WO2012104674A1 INTEGRATED CIRCUIT DEVICE AND METHOD FOR DETERMINING AN INDEX OF AN EXTREME VALUE WITHIN AN ARRAY OF VALUES 审中-公开
标题翻译：集成电路装置和方法，用于确定数值范围内极值的指标
公开(公告)号：WO2012104674A1
公开(公告)日：2012-08-09
申请号：PCT/IB2011/050419
申请日：2011-01-31
申请人： FREESCALE SEMICONDUCTOR, INC. , MOSKOVICH, Ilia , AMIR, Aviram , BARAK, Itzhak , BEN ZEEV, Eliezer
发明人： MOSKOVICH, Ilia , AMIR, Aviram , BARAK, Itzhak , BEN ZEEV, Eliezer
IPC分类号： G06F9/06 , G06F9/30
CPC分类号： G06F17/30336 , G06F9/30021 , G06F9/30036
摘要： An integrated circuit device (105) comprises at least one digital signal processor, DSP, module (100), the at least one DSP module (100) comprising a plurality of data registers (140) and at least one data execution unit, DEU, module (120) arranged to execute operations on data stored within the data registers (140). The at least one DEU module (120) is arranged to, in response to receiving an extreme value index instruction (210), compare a previous extreme value (425) located within a first data register set (220, 230) of the DSP module (100) with at least one input vector data value (440, 445, 450, 455) located within a second data register set (240, 250) of the DSP module (100), and determine an extreme value thereof. The at least one DEU module (120) is further arranged to, if the determined extreme value comprises an input vector data value (440, 445, 450, 455) located within the second data register set (240, 250), store the determined extreme value in the first data register set (220, 230), determine an index value for the determined extreme value, and store the determined index value in the first data register set (220, 230).
摘要翻译：集成电路装置（105）包括至少一个数字信号处理器DSP，模块（100），所述至少一个DSP模块（100）包括多个数据寄存器（140）和至少一个数据执行单元DEU，模块（120）被布置成对存储在数据寄存器（140）内的数据执行操作。所述至少一个DEU模块（120）被布置成响应于接收到极值索引指令（210）而比较位于DSP模块的第一数据寄存器组（220,230）内的先前极值（425）（100），其具有位于所述DSP模块（100）的第二数据寄存器组（240,250）内的至少一个输入向量数据值（440,445,450,455），并确定其极值。如果所确定的极值包括位于第二数据寄存器组（240,250）内的输入向量数据值（440,445,450,455），则所述至少一个DEU模块（120）还被布置为：第一数据寄存器组（220,230）中的极值确定所确定的极值的索引值，并将所确定的索引值存储在第一数据寄存器组（220,230）中。

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