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1. 发明申请

WO2010137088A1 インターフェース回路审中-公开
标题翻译：接口电路
公开(公告)号：WO2010137088A1
公开(公告)日：2010-12-02
申请号：PCT/JP2009/006322
申请日：2009-11-24
申请人：パナソニック株式会社 , 平木剛 , 宮嵜慎也 , 田町亘 , 中平圭亮 , 波戸岡和也 , 池村次朗
发明人：平木剛 , 宮嵜慎也 , 田町亘 , 中平圭亮 , 波戸岡和也 , 池村次朗
IPC分类号： H04L25/02 , G06F3/00 , H03K19/0175
CPC分类号： H04L25/0278 , H03K19/017545 , H03K19/017581
摘要：　インターフェース回路の校正回路（１０１）において、制御回路（１４０）は校正を実行する場合に、電圧（Ｖ１，ＶＲＥＦ）または電圧（Ｖ１，Ｖ２）が比較器（１３０）に与えられるように、セレクタ（１２０）を制御する。２つの電圧の比較器（１２０）への入力先は、正負入れ替えられる。そしてそれぞれの状態で、制御回路（１４０）は、比較器（１２０）の出力変化時における可変抵抗制御信号（ＵＰＣＯＤＥ，ＤＮＣＯＤＥ）の信号値を求め、求めた信号値の平均値を用いて、終端抵抗の抵抗値を制御するための校正データを求める。
摘要翻译：在接口电路的校准电路（101）中，控制电路（140）控制选择器（120），使得在执行校准时将电压（V1，VREF）或电压（V1，V2）提供给比较器（130）。可以在比较器（120）的反相或非反相输入端之间切换电压。此外，在这些状态的每一个中，当比较器（120）的输出已经改变时，控制电路（140）找到可变电阻控制信号（UPCODE，DNCODE）的信号值，并且使用信号值的平均值被发现找到用于控制终端电阻的电阻值的校准数据。

2. 发明申请

WO2011004580A1 クロックデータリカバリ回路审中-公开
标题翻译：时钟数据恢复电路
公开(公告)号：WO2011004580A1
公开(公告)日：2011-01-13
申请号：PCT/JP2010/004392
申请日：2010-07-05
申请人：パナソニック株式会社 , 山本道代 , 村田健治 , 波戸岡和也
发明人：山本道代 , 村田健治 , 波戸岡和也
IPC分类号： H04L7/02 , H03L7/08 , H03L7/107
CPC分类号： H04L7/0337 , H03L7/091 , H03L7/0996
摘要：　クロックデータリカバリに要する時間を短縮する。クロックデータリカバリ回路であって、複数のクロックを有する多相クロックを生成する多相クロック生成回路と、シリアルデータを伝送する受信データ信号を、前記複数のクロックのそれぞれに同期してサンプリングし、複数のデータ信号を生成するサンプリング回路と、前記複数のデータ信号のうち、位相が適切なデータ信号を示す選択信号を生成するデータ復元部と、前記選択信号を格納する記憶部とを有する。前記データ復元部は、前記記憶部から読み出された前記選択信号に従って、前記複数のデータ信号の１つ、及びこのデータ信号に対応するクロックを選択する。
摘要翻译：公开了一种时钟数据恢复单元，其中减少了时钟数据恢复所需的时间。时钟数据恢复电路包括：多相时钟产生电路，其产生包括多个时钟的多相时钟; 采样电路，与所述多个时钟中的每一个同步地采样发送串行数据的接收数据信号，并生成多个数据信号; 数据恢复单元，其生成指示具有适当相位的多个数据信号中的数据信号的选择信号; 以及存储单元，存储选择信号。数据恢复单元根据从存储单元读出的选择信号选择多个数据信号中的一个，并选择与该数据信号对应的时钟。

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