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    • 10. 发明申请
    • Storage Module and Method for Determining Ready/Busy Status of a Plurality of Memory Dies
    • 用于确定多个内存模块的就绪/繁忙状态的存储模块和方法
    • US20150363342A1
    • 2015-12-17
    • US14448728
    • 2014-07-31
    • SanDisk Technologies Inc.
    • Daniel E. TuersAbjiheet ManoharYoav Weinberg
    • G06F13/372G06F12/02G06F13/16G06F13/28
    • G06F12/0238G06F13/4243Y02D10/14Y02D10/151
    • A storage module and method are provided for determining ready/busy status of a plurality of memory dies. In one embodiment, a bus has a ready/busy line that is shared among the plurality of memory dies, and a time-division multiplex signal on the shared ready/busy line is used to communicate the ready/busy status of each of the memory dies. In another embodiment, each of the memory dies sends its ready/busy status to the storage controller using a different one of a plurality of data lines in the bus. In yet another embodiment, each of the memory dies sends a pulse across the ready/busy line with a different pulse width. To avoid collisions, each memory die waits a different number of clock cycles before attempting to send its pulse status after determining that the shared ready/busy line is in use.
    • 提供了一种用于确定多个存储器管芯的就绪/忙碌状态的存储模块和方法。 在一个实施例中,总线具有在多个存储器管芯之间共享的就绪/忙线,并且共享就绪/忙线上的时分多路复用信号用于传送每个存储器的就绪/忙状态 死了 在另一个实施例中,每个存储器管芯使用总线中的多个数据线中的不同的一个将其就绪/忙状态发送到存储控制器。 在另一个实施例中,每个存储器管芯以不同的脉冲宽度在待机/忙线之间发送脉冲。 为了避免冲突,每个存储器管芯在确定共享就绪/忙线正在使用之前尝试发送其脉冲状态之前等待不同数量的时钟周期。