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1. 发明专利

TWI497917B 比較器和放大器失效
简体标题：比较器和放大器
公开(公告)号：TWI497917B
公开(公告)日：2015-08-21
申请号：TW101140705
申请日：2012-11-02
申请人：聯發科技股份有限公司 , MEDIATEK INC.
发明人：許雲翔 , SHU, YUN SHIANG
IPC分类号： H03K5/22 , H03F3/45
CPC分类号： H03K5/2481 , H03F3/45 , H03F3/45071 , H03F3/45179 , H03F3/45197 , H03F2203/45424 , H03F2203/45466 , H03F2203/45482 , H03F2203/45492 , H03K5/2472 , H03K5/249

2. 发明专利

TW201320605A 比較器和放大器失效
简体标题：比较器和放大器
公开(公告)号：TW201320605A
公开(公告)日：2013-05-16
申请号：TW101140705
申请日：2012-11-02
申请人：聯發科技股份有限公司 , MEDIATEK INC.
发明人：許雲翔 , SHU, YUN SHIANG
IPC分类号： H03K5/22 , H03F3/45
CPC分类号： H03K5/2481 , H03F3/45 , H03F3/45071 , H03F3/45179 , H03F3/45197 , H03F2203/45424 , H03F2203/45466 , H03F2203/45482 , H03F2203/45492 , H03K5/2472 , H03K5/249
摘要：本發明提供一種比較器，包括一差動對電路以及一電流控制電路。上述差動對電路包括第一比較器電晶體和第二比較器電晶體，用於根據一時脈訊號比較一第一輸入值和一第二輸入值以產生一結果，其中上述結果表示上述第一輸入值和第二輸入值之一差值是否超出一內部偏移值。上述電流控制電路和上述差動對電路串聯耦接，用於分別提供上述第一比較器電晶體和第二比較器電晶體之不同的電流抽取能力。
简体摘要：本发明提供一种比较器，包括一差动对电路以及一电流控制电路。上述差动对电路包括第一比较器晶体管和第二比较器晶体管，用于根据一时脉信号比较一第一输入值和一第二输入值以产生一结果，其中上述结果表示上述第一输入值和第二输入值之一差值是否超出一内部偏移值。上述电流控制电路和上述差动对电路串联耦接，用于分别提供上述第一比较器晶体管和第二比较器晶体管之不同的电流抽取能力。

3. 发明专利

TWI638530B 在類比域和數位域之間轉換的系統有权
简体标题：在模拟域和数码域之间转换的系统
公开(公告)号：TWI638530B
公开(公告)日：2018-10-11
申请号：TW105129787
申请日：2016-09-13
申请人：聯發科技股份有限公司 , MEDIATEK INC.
发明人：許雲翔 , SHU, YUN SHIANG
IPC分类号： H03M1/12

4. 发明专利

TW201711399A 在類比域和數位域之間轉換的系統审中-公开
简体标题：在模拟域和数码域之间转换的系统
公开(公告)号：TW201711399A
公开(公告)日：2017-03-16
申请号：TW105129787
申请日：2016-09-13
申请人：聯發科技股份有限公司 , MEDIATEK INC.
发明人：許雲翔 , SHU, YUN SHIANG
IPC分类号： H03M1/12
CPC分类号： H03M1/066 , H03M1/001 , H03M1/0673 , H03M1/145 , H03M1/68 , H03M3/338 , H03M3/344
摘要：本發明實施例公開了帶有失配誤差塑造的在類比域和數位域之間轉換的系統，该系統包括數位-類比轉換器、耦接於該數位-類比轉換器的第一注入電路，以及耦接於該數位-類比轉換器的第二注入電路。該數位-類比轉換器根據第一數位值產生第一類比值，並根據第二數位值產生第二類比值。當該數位-類比轉換器產生該第二類比值時，該第一注入電路使類比注入值注入至該第二類比值，其中，該類比注入值由該第一數位值的比特子集形成的數位注入值轉換形成。該第二注入電路將該數位注入值和該第二數位值或根據該第二類比值獲得的相關值中的任一個進行合併。
简体摘要：本发明实施例公开了带有失配误差塑造的在模拟域和数码域之间转换的系统，该系统包括数码-模拟转换器、耦接于该数码-模拟转换器的第一注入电路，以及耦接于该数码-模拟转换器的第二注入电路。该数码-模拟转换器根据第一数码值产生第一模拟值，并根据第二数码值产生第二模拟值。当该数码-模拟转换器产生该第二模拟值时，该第一注入电路使模拟注入值注入至该第二模拟值，其中，该模拟注入值由该第一数码值的比特子集形成的数码注入值转换形成。该第二注入电路将该数码注入值和该第二数码值或根据该第二模拟值获得的相关值中的任一个进行合并。

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