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1. 发明专利

TW200525431A 具可變潛時堆疊快取記憶體之微處理器 MICROPORCESSOR WITH VARIABLE LATENCY STACK CACHE 审中-公开
简体标题：具可变潜时堆栈高速缓存之微处理器 MICROPORCESSOR WITH VARIABLE LATENCY STACK CACHE
公开(公告)号：TW200525431A
公开(公告)日：2005-08-01
申请号：TW093123711
申请日：2004-08-06
申请人：智權第一公司 IP-FIRST LLC
发明人：羅尼‧虎克 HOOKER, RODNEY E.
IPC分类号： G06F
CPC分类号： G06F9/30134 , G06F9/3004 , G06F9/30043 , G06F9/383 , G06F9/3842 , G06F12/0875 , G06F12/1045
摘要：本發明揭露一種可變延滯時間快取記憶體。此快取記憶體包含複數個儲存元件，並以後進先出(last–in–first–out)之操作模式，儲存堆疊記憶體資料。此快取記憶體能區分取出和下載指令之要求，並以臆測取出資料可能存在於快取記憶體之最上層快取列之操作方式，提供取出資料，且其提供取出資料之速度將快於提供下載資料之速度；此外，此快取記憶體亦將對下載指令所請求之堆疊資料進行臆測，並認為其資料將存在於快取記憶體之最上層快取列或其上層之多個快取列中。因此，當下載指令之來源虛擬位址命中於快取記憶體之最上層快取列時，則快取記憶體提供下載資料之速度將較資料位於較低之快取列時來得快；或較須進行一實體位址比較時來得快；或較資料必須從微處理器之非堆疊快取記憶體中提供時之速度來得快。
简体摘要：本发明揭露一种可变延滞时间高速缓存。此高速缓存包含复数个存储组件，并以后进先出(last–in–first–out)之操作模式，存储堆栈内存数据。此高速缓存能区分取出和下载指令之要求，并以臆测取出数据可能存在于高速缓存之最上层缓存列之操作方式，提供取出数据，且其提供取出数据之速度将快于提供下载数据之速度；此外，此高速缓存亦将对下载指令所请求之堆栈数据进行臆测，并认为其数据将存在于高速缓存之最上层缓存列或其上层之多个缓存列中。因此，当下载指令之来源虚拟位址命中于高速缓存之最上层缓存列时，则高速缓存提供下载数据之速度将较数据位于较低之缓存列时来得快；或较须进行一实体位址比较时来得快；或较数据必须从微处理器之非堆栈高速缓存中提供时之速度来得快。

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