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    • 14. 发明专利
    • 層疊積體電路及半導體元件 STACKED INTEGRATED CIRCUIT AND SEMICONDUCTOR COMPONENT
    • 层叠集成电路及半导体组件 STACKED INTEGRATED CIRCUIT AND SEMICONDUCTOR COMPONENT
    • TWI346367B
    • 2011-08-01
    • TW096132856
    • 2007-09-04
    • 台灣積體電路製造股份有限公司
    • 邱文智余振華吳文進
    • H01L
    • H01L23/481H01L21/76898H01L25/0657H01L25/50H01L2224/16H01L2225/06513H01L2225/06541
    • 本發明係提供一種層疊積體電路,包括:一第一半導體晶粒,具有一前側和一後側,且該第一半導體晶粒包含一個或多個元件;一個或多個貫穿矽晶片介層插塞,穿過一基底和該第一半導體晶粒之一前側絕緣層;一層間介電層,位於該第一半導體晶粒之該前側上,該層間介電層具有至少一接觸插塞,實體上連接該一個或多個貫穿矽晶片介層插塞之一前側,和一介面位於該至少一接觸插塞和該一個或多個貫穿矽晶片介層插塞之間;一金屬間介電層,位於該層間介電層上,其中該金屬間介電層具有至少一接合墊,電性連接該至少一接觸插塞;一第二半導體晶粒,於該至少一接合墊上,連接該第一半導體晶粒;一金屬層,位於該第一半導體晶粒之該背面上,其中該金屬層包括:至少一背面介電層,位於該背面之上;以及一蝕刻停止層,位於該至少一背面介電層之一者上方;其中該金屬層具有至少一背面接觸墊,電性連接該一個或多個貫穿矽晶片介層插塞之一背面。
    • 本发明系提供一种层叠集成电路,包括:一第一半导体晶粒,具有一前侧和一后侧,且该第一半导体晶粒包含一个或多个组件;一个或多个贯穿硅芯片介层插塞,穿过一基底和该第一半导体晶粒之一前侧绝缘层;一层间介电层,位于该第一半导体晶粒之该前侧上,该层间介电层具有至少一接触插塞,实体上连接该一个或多个贯穿硅芯片介层插塞之一前侧,和一界面位于该至少一接触插塞和该一个或多个贯穿硅芯片介层插塞之间;一金属间介电层,位于该层间介电层上,其中该金属间介电层具有至少一接合垫,电性连接该至少一接触插塞;一第二半导体晶粒,于该至少一接合垫上,连接该第一半导体晶粒;一金属层,位于该第一半导体晶粒之该背面上,其中该金属层包括:至少一背面介电层,位于该背面之上;以及一蚀刻停止层,位于该至少一背面介电层之一者上方;其中该金属层具有至少一背面接触垫,电性连接该一个或多个贯穿硅芯片介层插塞之一背面。