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1. 发明公开

KR1020170118913A 오차 보상 직접 디지털 변조 장치 审中-实审
标题翻译：误差补偿直接数字调制器
公开(公告)号：KR1020170118913A
公开(公告)日：2017-10-25
申请号：KR1020177026876
申请日：2016-01-19
申请人： 후아웨이 테크놀러지 컴퍼니 리미티드
发明人： 팔머스피에터 , 크리스토퍼니엘스 , 반데나미엘패트릭 , 삼솜요하네스 , 코네리센코엔 , 바티소피아
IPC分类号： H04L27/36 , H04L25/03 , H03M1/06 , H03M1/08 , H03M1/66 , H04B1/30 , G06F1/06
CPC分类号： H04L27/2627 , G06F1/06 , H03M1/1047 , H03M1/66 , H04B1/0007 , H04B1/123 , H04L25/03 , H04L27/122 , H04L27/368
摘要： 본개시는오차보상직접디지털변조장치(800)에관한것이다. 오차보상직접디지털변조장치(800)는, 디지털베이스밴드신호(802)의변조에기초하여무선주파수(RF) 신호(804)를생성하도록구성된직접디지털무선주파수변조부(DDRM)(801); 상기생성된 RF 신호(804), 및상기디지털베이스밴드신호(802)의표현에기초하여편차로인한오차신호(806)를결정하도록구성된오차추정부(803); 및오차보상 RF 신호(808)를제공하기위해상기 RF 신호(804)에서상기오차신호(806)를차감하도록구성된오차보상부(805)를포함한다.
摘要翻译：本公开涉及到误差补偿直接数字调制器（800）。误差补偿基于所述数字基带信号802的通过射频（RF）调制直接数字调制单元800，直接发信号给被配置为生成一个数字射频（804）的调制部（DDRM）（801）; 它所述生成的RF信号804和误差估计单元803被配置成确定一个误差信号（806）由于所述数字基带信号802的代表性的基础上的偏差; 和由RF信号804，以提供误差补偿的RF信号808包括被配置为减去该误差信号（806）的误差补偿器805。

2. 发明公开

KR1020160130236A DARC 신호 복조 회로 장치, 그리고 DARC 신호 복조 회로 장치의 작동 방법 审中-实审
标题翻译： DARC DARC DARC信号解调电路布置及其操作方法
公开(公告)号：KR1020160130236A
公开(公告)日：2016-11-10
申请号：KR1020167024335
申请日：2015-02-02
申请人： 로베르트 보쉬 게엠베하
发明人： 니엔후이스,데틀레프
IPC分类号： H04L27/227 , H04L27/20 , H03D3/00 , H04B1/30 , H04B1/16
CPC分类号： H04L27/227 , H03D3/007 , H04B1/16 , H04B1/1646 , H04B1/30 , H04H2201/13 , H04L27/2014
摘要： FM 다중전송신호(MPX)로부터 DARC 데이터(data)를포함하는 DARC 신호(W)를복구하기위한 DARC 신호복조회로장치(100)는, FM 다중전송신호에포함된스테레오파일럿톤와동기화되어서로직교하는제 1 진동(ps19) 및제 2 진동(pc19)을얻도록구성되는파일럿톤 제어루프(101)와, 스테레오파일럿톤에비해 4배로된 주파수를포함하여서로직교하는제 3 진동(ps76) 및제 4 진동(pc76)을얻기위한주파수 4배단(102)과, FM 다중전송신호및 제 3 진동으로부터제 1 곱셈신호를얻기위한제 1 곱셈단(103)과, FM 다중전송신호및 제 4 진동으로부터제 2 곱셈신호를얻기위한제 2 곱셈단(104)과, 제 1 곱셈신호를저역통과필터링함으로써제 1 DARC 신호성분(Q)을얻기위한제 1 저역통과필터(105)와, 제 2 곱셈신호를저역통과필터링함으로써제 2 DARC 신호성분(I)을얻기위한제 2 저역통과필터(106)와, 제 1 및제 2 DARC 신호성분의주파수복조로부터 DARC 신호를얻기위한 FM 복조단(107)을포함한다. DARC 신호복조회로장치뿐만아니라이 DARC 신호복조회로장치의작동방법은향상되고간소화된다.
摘要翻译：用于从FM多路传输信号恢复DARC信号（DARC数据）的DARC信号解调电路组件包括：导频音调节电路，用于获得与由FM多路传输信号包围的立体声导频音同步的第一和第二相互正交的振荡; 频率四重部分，用于获得频率为立体声导频音的四倍的第三和第四相互正交的振荡; 第一乘法部分，用于从FM多路传输信号和第三振荡获得第一相乘信号; 第二乘法部分，用于从FM多路传输信号和第四振荡获得第二乘法信号; 第一/第二低通滤波器，用于通过第一和第二相乘信号的低通滤波获得第一/第二DARC信号分量; 以及FM解调部分，用于从第一/第二DARC信号分量的频率解调获得DARC信号。

3. 发明授权

KR101603241B1 직교 변조 방식의 송수신기를 위한 아날로그 회로를 이용한 Ｉ／Ｑ 신호 불균형 제어 장치 有权
标题翻译：通过使用正交调制收发器的模拟电路来控制I / Q信号不平衡的装置
公开(公告)号：KR101603241B1
公开(公告)日：2016-03-14
申请号：KR1020090127972
申请日：2009-12-21
申请人： 한국전자통신연구원
发明人： 권헌국
IPC分类号： H04B1/30 , H04L27/00
摘要： 본발명은직교변조방식의송수신기를위한아날로그회로를이용한 I/Q 신호불균형제어장치에관한것으로서, I/Q 신호불균형정보에서추출된위상불균형을제어하기위해입력신호의위상을 0내지 180내에서지연시켜 I/Q 신호위상불균형을보정하는위상조절회로및 상기위상조절회로의출력신호의크기를 0 내지 1배내에서변화시켜 I/Q 신호크기불균형을보정하는신호크기조절회로를포함하여구성된다.

4. 发明公开

KR1020110071409A 직교 변조 방식의 송수신기를 위한 아날로그 회로를 이용한 Ｉ／Ｑ 신호 불균형 제어 장치 有权
标题翻译：通过使用模拟电路来控制I / Q信号不平衡的装置，用于平衡调制收发器
公开(公告)号：KR1020110071409A
公开(公告)日：2011-06-29
申请号：KR1020090127972
申请日：2009-12-21
申请人： 한국전자통신연구원
发明人： 권헌국
IPC分类号： H04B1/30 , H04L27/00
CPC分类号： H04L27/2089
摘要： PURPOSE: An i / Q signal asymmetry control device using an analog circuit for a transceiver of a quadrature phase shift keying is provided to control the size and phase of a baseband imaginary / Q signal by the small resolving power. CONSTITUTION: A signal phase adjustment circuits(110,110') delay a phase of the input signal within 0 or 180 degree. The signal phase control circuits revises I / Q signal phase unbalance. A signal level adjustment circuits(120,120') diversify the sizes of the output signals of the phase control circuits in 0 or 1 times. The signal amplitude control circuits revises I / Q signal amplitude unbalanced.
摘要翻译：目的：提供使用正交相移键控的收发器的模拟电路的i / Q信号不对称控制装置，以通过小的分辨率来控制基带虚数/ Q信号的大小和相位。构成：信号相位调整电路（110,110'）将输入信号的相位延迟0或180度。信号相位控制电路修正I / Q信号相位不平衡。信号电平调节电路（120,120'）使相位控制电路的输出信号的大小在0或1倍内分散。信号幅度控制电路修正I / Q信号幅度不平衡。

5. 发明授权

KR101038845B1 다중 주파수 대역 수신기 有权
标题翻译：多频带接收机
公开(公告)号：KR101038845B1
公开(公告)日：2011-06-02
申请号：KR1020090048150
申请日：2009-06-01
申请人： 삼성전기주식회사
发明人： 한동옥 , 김정훈
IPC分类号： H04B1/18 , H04B1/26 , H04B1/30
CPC分类号： H04B1/28 , H03D7/1441 , H03D7/1458 , H03D7/1483 , H03D7/165
摘要： 호모다인(직접변환) 방식과 헤테로다인 방식을 공통으로 사용하면서 적어도 하나의 믹서를 두 방식의 신호처리에 공통으로 사용함으로써 수신기를 구현하기 위한 전체 칩 면적을 감소시킬 수 있는 다중 주파수 대역 수신기가 개시된다. 상기 다중 주파수 대역 수신기는, 서로 다른 주파수 대역의 신호가 각각 입력되는 복수의 입력단; 상기 복수의 입력단에 각각 하나씩 연결되며, 서로 다른 주파수 대역의 신호를 각각 입력받아 사전 설정된 크기 만큼 주파수를 하향 변환하는 복수의 믹서; 기저대역 신호가 출력되는 하나의 출력단; 및 상기 각 입력단과 각 믹서 사이에 배치되며 인덕터를 포함하는 복수의 저잡음 증폭기를 포함하며, 상기 복수의 믹서 각각은 자신이 연결된 입력단 또는 타 믹서로부터 신호를 입력받으며, 상기 복수의 믹서 중 가장 낮은 주파수 대역의 신호가 상기 입력단으로부터 입력되는 믹서는, 입력받은 신호를 기저대역으로 변환하여 상기 출력단에 제공하며, 상기 복수의 믹서 중 나머지 믹서는 자신이 입력받은 신호를 타 믹서에 입력되는 신호의 주파수 대역으로 하향변환하며 상기 나머지 믹서는 각각 상기 하향변환된 신호를 입력받는 상기 타 믹서에 연결된 저잡음 증폭기의 상기 인덕터를 공유하는 것을 특징으로 한다.
호모다인, 직접변환, 헤테로다인, 믹서, 저잡음 증폭기(LNA), 부하, 공유, 필터

6. 发明授权

KR101009077B1 직접 변환 수신기에서 ＤＣ 오프셋 보상을 위한 장치 및 방법 有权
标题翻译：直接转换接收机直流偏移补偿的装置和方法
公开(公告)号：KR101009077B1
公开(公告)日：2011-01-18
申请号：KR1020057003151
申请日：2003-08-28
申请人： 퀄컴 인코포레이티드
发明人： 쉬레겔,니콜라이 , 호렌스테인,크리스티안 , 필리포빅,다니엘에프. , 카스튜리,니틴
IPC分类号： H04B1/30 , H04L25/06 , H04B1/26
CPC分类号： H04L25/063 , H03D3/008 , H04B1/30
摘要： 직접 베이스밴드 수신기 구조에서 직류(DC) 오프셋의 대략적인 보상을 위한 장치는 델타-시그마 변환기와 같은 직렬 아날로그 대 디지털 변환기(ADC)를 이용하여 수신기 신호를 디지털 폼으로 변환한다. ADC로부터의 출력은 소정수의 샘플들을 위해 샘플링되고, ADC에 커플링되는 카운터는 ADC에 의해 발생된 샘플이 논리 1 인 경우에 매번 증분된다. ADC로부터의 샘플이 논리 0 인 경우에는 카운터는 증분되지 않는다. 소정수의 샘플들이 획득된 후, 카운터 값은 수신된 신호에서 DC 오프셋을 표시한다. 카운터 값은 디지털 대 아날로그 변환기(DAC)의 용이한 동작을 위해서 코드 변환기에 의해 보정 값으로 변환된다. ADC로부터의 샘플들의 수가 2의 거듭제곱이면, 변환된 코드는 카운터로부터의 최상위 비트(MSB)를 단순히 인버팅함으로써 구현되고, 이를 통해 카운터 값의 2의 보수 버젼을 발생시킨다. 이러한 보정 값은 DAC에 커플링되어 보상값을 발생시키고, 이러한 보상값은 DC 오프셋을 보상하기 위해서 피드백 신호 형태로 수신 신호 경로에 제공된다.

7. 发明授权

KR100790858B1 시공유 Ｉ 채널 및 Ｑ 채널을 가진 직접변환 수신기 및수신방법 失效
标题翻译：时间分享？频道直接转换接收机及其方法。
公开(公告)号：KR100790858B1
公开(公告)日：2008-01-02
申请号：KR1020020053161
申请日：2002-09-04
申请人： 삼성전자주식회사
发明人： 손미현 , 포포프올레그
IPC分类号： H04B1/30
CPC分类号： H04B1/30
摘要： 본 발명은 무선통신 환경에서의 무선 단말기에서 사용되는 수신기에 관한 것으로, 특히 직접변환(direct conversion) 방식을 채용한 직접변환수신기(Direct Conversion Receiver)와 직접변환수신방법에 관한 것이다. 본 발명의 직접변환수신기(DCR)는 정현파 신호를 발생시키는 국부 발진기(LO); 신호를 입력받아 입력받은 신호와 상기 국부 발진기로부터 입력되는 상기 정현파 신호를 합성하는 믹서(mixer); 상기 믹싱한 아날로그 신호를 디지털 신호로 변환시키는 아날로그 디지털 변환기(ADC); 및 상기 변환된 디지털 신호를 I 채널과 Q 채널로 분리하여 출력하고, 상기 국부 발진기(LO)에 국부 발진기(LO)가 공급하여야 할 정현파의 위상정보를 송신하는 디지털 신호처리기(DSP)를 포함한다. 본 발명의 적접변환수신기(DCR)를 사용하여 I 채널과 Q 채널간의 불일치 문제를 해결하고, 높은 데이터 레이트(data rate)의 디지털 시스템에서의 좋은 효율 및 수율(yield)을 가져오는 효과가 있다.

8. 发明授权

KR100790109B1 푸쉬 로드 및 그를 구비하는 슬라이딩형 휴대용 단말기 有权
标题翻译：推杆式和滑动型便携式终端
公开(公告)号：KR100790109B1
公开(公告)日：2008-01-02
申请号：KR1020060110613
申请日：2006-11-09
申请人： 삼성전자주식회사
发明人： 김광환
IPC分类号： H04B1/30
CPC分类号： H04M1/0237
摘要： A push rod and a sliding-type portable terminal having the same are provided to implement a smooth sliding motion by rotatively forming rotary members, which are installed at housings, and support members, which convey the elastic force of elastic members. A push rod(203) in a sliding-type portable terminal having the first housing and the second housing provides driving force to slide the second housing. The push rod(203) comprises a housing, support members(233), elastic members(237), and rotary members(235). The housing includes an upper case(231a) and a lower case(231b). The support members(233) are combined so as to be inserted into or extracted from both ends of the housing. The elastic members(237) provide elastic force to push the support members(233) toward both ends of the housing. The rotary members(235), rotatively combined at the ends of the support members(233), are also rotatively combined at either the first housing or the second housing.
摘要翻译：提供一种推杆和具有该推动杆的滑动式便携式终端，以通过旋转地形成安装在壳体上的旋转构件和传递弹性构件的弹力的支撑构件来实现平滑的滑动运动。具有第一壳体和第二壳体的滑动式便携式终端中的推杆（203）提供驱动力以滑动第二壳体。推杆（203）包括壳体，支撑构件（233），弹性构件（237）和旋转构件（235）。壳体包括上壳体（231a）和下壳体（231b）。支撑构件（233）被组合以便被插入或从壳体的两端抽出。弹性构件（237）提供弹性力以将支撑构件（233）朝向壳体的两端推动。在支撑构件（233）的端部旋转组合的旋转构件（235）也可以在第一壳体或第二壳体处旋转组合。

9. 发明公开

KR1020060129342A 오프칩 필터들의 제거를 위한 높은 동적범위 시변 집적수신기 有权
标题翻译：用于消除片外滤波器的高动态范围时变集成接收器
公开(公告)号：KR1020060129342A
公开(公告)日：2006-12-15
申请号：KR1020067015372
申请日：2005-01-28
申请人： 미디어텍 인크.
发明人： 몰나르,알요샤 , 마군,라울
IPC分类号： H03D7/14 , H04B1/30
CPC分类号： H03D7/1441 , H03D7/1458 , H03D7/1466 , H03D7/1483 , H03D7/165 , H03D2200/0088 , H03H19/004 , H04B1/006 , H04B1/48
摘要： A quadrature mixer with an LO input is provided. The quadrature mixer receives a signal having a frequency FLO and a signal input having a frequency FSIG and has an output that comprises an output impedance that is high at frequencies of [FLO-F SIG] and [FLO + FSIG] and low at other. A mixer coupled to the output impedance interacts with the output impedance such that an impedance presented at the signal input is high for signals at FSIG if FSIG is a predetermined signal frequency, and low at other frequencies.
摘要翻译：提供具有LO输入的正交混频器。正交混频器接收具有频率FLO和具有频率FSIG的信号输入的信号，并且具有包括在[FLO-F SIG]和[FLO + FSIG]的频率处高的输出阻抗并且在另一个处的低输出的输出。耦合到输出阻抗的混频器与输出阻抗相互作用，使得如果FSIG是预定的信号频率，则在FSIG处的信号在信号输入处呈现的阻抗较高，并且在其它频率处低。

10. 发明授权

KR100424474B1 다이렉트 컨버젼 회로에서의 ＤＣ-오프셋 제거 회로 失效
标题翻译： 다이렉트컨버젼회로에서의DC-오프셋제거회로
公开(公告)号：KR100424474B1
公开(公告)日：2004-03-24
申请号：KR1020010065422
申请日：2001-10-23
申请人： 삼성전자주식회사
发明人： 곽동훈
IPC分类号： H04B1/30
摘要： PURPOSE: A circuit of removing DC-offset in a direct conversion circuit is provided to remove the DC-offset during direct conversion, and to configure the direct conversion circuit by using a relatively simple circuit, thereby improving performance with the use of digital control when necessary. CONSTITUTION: An adder(341) obtains a sum of an in-phase signal and a quadrature phase signal passing through LPFs(Low Pass Filters)(352,343). The first subtracter(342) obtains a difference between the in-phase signal and the quadrature phase signal. One pair of multipliers(345,346) multiply a difference signal by a sine signal and a cosine signal corresponding to a data rate, and output the multiplied signals. The one pair of LPFs(352,343) filter the output signals of the one pair of multipliers(345,346). The second subtracter(355) subtracts the output signals from each other, and outputs size of a signal component. The third subtracter(357) subtracts an output of the second subtracter(355) from an output of the adder(341), and obtains a DC-offset value.
摘要翻译：目的：提供在直接转换电路中消除直流偏移的电路，以消除直接转换期间的直流偏移，并通过使用相对简单的电路来配置直接转换电路，从而当使用数字控制来提高性能时必要。构成：加法器（341）获得通过LPF（低通滤波器）（352,343）的同相信号和正交相位信号的和。第一减法器（342）获得同相信号和正交相位信号之间的差值。一对乘法器（345,346）将差信号乘以对应于数据速率的正弦信号和余弦信号，并输出相乘后的信号。一对LPF（352,343）对一对乘法器（345,346）的输出信号进行滤波。第二减法器（355）相互减去输出信号，并输出信号分量的大小。第三减法器（357）从加法器（341）的输出中减去第二减法器（355）的输出，并且获得DC偏移值。

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