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1. 发明公开

KR1020170055964A 태스크의 배분 경로를 결정하는 방법, 디바이스 및 시스템 审中-实审
标题翻译：一种确定任务分配路径的方法，设备和系统
公开(公告)号：KR1020170055964A
公开(公告)日：2017-05-22
申请号：KR1020177006601
申请日：2015-09-07
申请人： 하이브리드서버 테크 아이피 게엠베하
发明人： 뒤르코프헨드릭 , 지엘린스키토비아스 , 아슬란할리스 , 사레미파보드
IPC分类号： G06F9/50
CPC分类号： G06F9/5055 , G06F9/4887 , G06F9/5044
摘要： 본발명은태스크의배분경로를결정하는방법을제공하는데, 그방법은, 태스크를프로세싱할수 있는다수의프로세싱소자들로부터하나이상의프로세싱소자들을식별하는단계, 하나이상의식별된프로세싱소자들과통신하기위한하나이상의경로들을식별하는단계, 식별된경로들과식별된프로세싱소자들중 하나이상에대한사이클길이를예측하는단계, 식별된프로세싱소자들로부터선호프로세싱소자를선택하고, 식별된경로들로부터선호경로를선택하는단계를구비한다. 또한, 본발명은디바이스및 시스템과관련된다.
摘要翻译：本发明提供一种方法，用于确定用于所述任务的分配路径，所述方法包括：从多个处理装置可以处理该任务的一个或多个所识别的处理元件和用于传送识别一个或多个处理设备识别一个或多个路径，预测一个或多个处理元件识别和所识别的通路的周期长度，从所识别的处理元件选择优选的处理元件，并且从所识别的通路，路径优选和选择的步骤。本发明还涉及装置和系统。

2. 发明公开

KR1020170137061A 대규모 병렬 실행 가능 객체를 생성하는 방법, 디바이스 및 시스템 审中-实审
标题翻译：如何创建大规模并行可执行对象，设备和系统
公开(公告)号：KR1020170137061A
公开(公告)日：2017-12-12
申请号：KR1020177025698
申请日：2016-04-04
申请人： 하이브리드서버 테크 아이피 게엠베하
发明人： 뒤르코프헨드릭 , 지엘린스키토비아스 , 아슬란할리스 , 사레미파보드
IPC分类号： G06F9/45
CPC分类号： G06F8/456 , G06F8/451 , G06F8/457
摘要： 본발명은하나이상의버스들과다수의프로세싱소자들을구비한디바이스상에서실행될머신코드를최적화하는방법을제공하는데, 머신코드는다수의서브작업들을구비한디바이스상에서작업을실행하도록구성되며, 상기방법은, 적어도하나의서브작업에대해, 상기서브작업을프로세싱할수 있는다수의프로세싱소자들로부터하나이상의프로세싱소자들을식별하는단계, 하나이상의식별된프로세싱소자들과통신하는하나이상의경로들을식별하는단계, 식별된프로세싱소자들및/또는식별된경로들중 하나이상에대한사이클길이를예측하는단계, 식별된프로세싱소자들로부터바람직한프로세싱소자를선택하고/하거나식별된경로들로부터바람직한경로를선택하는단계, 상기디바이스가바람직한경로를통해바람직한프로세싱소자와통신하게하고바람직한프로세싱소자상에서그 서브작업을실행하도록하는명령들을구비한머신코드시퀀스를생성하는단계를구비한다. 본발명은디바이스및 시스템과관련된다.
摘要翻译：本发明提供了一种用于优化将在具有一个或多个总线和多个处理元件的设备上执行的机器代码的方法，所述机器代码被配置为在具有多个子任务的设备上执行任务，对于至少一个子任务，识别来自能够处理该子任务的多个处理元件中的一个或多个处理元件，识别与该一个或多个识别的处理元件通信的一个或多个路径，预测一个或多个所识别的处理元件和/或所识别的路径的周期长度，从所识别的处理元件中选择期望的处理元件和/或从所识别的路径中选择期望的路径，允许设备在期望的路径上与期望的处理元件通信，它包括产生与指令的机器代码序列中进行操作的子步骤。本发明涉及装置和系统。

3. 发明公开

KR1020150121108A 실행가능 코드를 실행하기 위한 방법, 처리 모듈 및 시스템 审中-实审
标题翻译：方法，处理模块和执行可执行代码的系统
公开(公告)号：KR1020150121108A
公开(公告)日：2015-10-28
申请号：KR1020157025722
申请日：2014-02-17
申请人： 하이브리드서버 테크 아이피 게엠베하
发明人： 아슬란할리스 , 지엘린스키토비아스 , 뒤르코프헨드릭 , 사레미파보드
IPC分类号： G06F9/50 , G06F9/45
CPC分类号： G06F9/5027 , G06F8/456 , G06F9/5066 , Y02D10/22 , Y02D10/36
摘要： 본발명은처리모듈들의집합에의한실행가능코드의실행을제공하며, 실행가능코드는처리모듈들의집합중에서적어도하나의제1 처리모듈에의해실행되고, 상기실행가능코드는병렬실행가능부분들의집합을구비하고, 실행가능코드의각 병렬실행가능부분은적어도두 개의병렬실행가능단계들을구비하고, 상기실행은, 상기적어도하나의제1 처리모듈에의해, 실행될상기실행가능코드의상기병렬실행가능부분들의집합중에서상기병렬실행가능부분을검출하는단계; 상기적어도하나의제1 처리모듈에의해, 상기처리모듈들의집합중에서적어도두 개의제2 처리모듈들을선택하는단계; 및상기실행가능코드의상기검출된병렬실행가능부분의상기적어도두 개의실행가능단계들을수행하기위해, 상기적어도하나의제1 처리모듈에의해, 상기선택된적어도두 개의제2 처리모듈들에게명령하는단계를구비한다.

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