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1. 外观设计

KR3008049040000S 有权
公开(公告)号：KR3008049040000S
公开(公告)日：2015-07-09
申请号：KR3020140057779
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 이지나 , 정종일 , 명지혜 , 한봉희

2. 外观设计

KR3008049010000S 有权
公开(公告)号：KR3008049010000S
公开(公告)日：2015-07-09
申请号：KR3020140057775
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 정종일 , 이숙경 , 명지혜 , 한봉희

3. 外观设计

KR3008233970000S 有权
公开(公告)号：KR3008233970000S
公开(公告)日：2015-11-06
申请号：KR3020140057780
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 이지나 , 정종일 , 명지혜 , 한봉희

4. 外观设计

KR3008049000000S 有权
公开(公告)号：KR3008049000000S
公开(公告)日：2015-07-09
申请号：KR3020140057774
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 정종일 , 명지혜 , 한봉희

5. 发明公开

KR1020130126435A 디지털 신호 발생기 및 이를 포함하는 자동 테스트 장비 审中-实审
标题翻译：数字信号发生器及具有相同功能的自动测试设备
公开(公告)号：KR1020130126435A
公开(公告)日：2013-11-20
申请号：KR1020120118280
申请日：2012-10-24
申请人： 삼성전자주식회사 , 조지아 테크 리서치 코오포레이션
发明人： 이성관 , 최현우 , 김성열 , 데이비드키저 , 칼그레이 , 테후이첸
IPC分类号： G01R31/3183
CPC分类号： H03K19/21 , H03K2005/00241
摘要： The present invention provides a digital signal generator generating a high-speed data signal having a variable cycle what a user wants by using a commercial IC and automatic test equipment (ATE) having the same. The digital signal generator comprises an input unit receiving signal information of a target data signal, a controller calculating at least two delay values and at least two data values, the at least two delay values and the at least two data values being used to generate a data signal corresponding to the signal information input through the input unit, a multi-phase clock generator delaying a reference clock signal based on the at least two delay values to generate at least two clock signals having different phases, a signal generator generating at least two data signals by assigning the at least two data values to the at least two clock signals, and a logic gate unit outputting the data signal corresponding to the signal information input through the input unit based on the at least two data signals generated in the signal generator and including at least one XOR gate. [Reference numerals] (110) Input unit;(120) Control unit;(130) Multi-phase clock generator;(140) Signal generation unit;(150) Logic gate unit
摘要翻译：本发明提供一种数字信号发生器，其通过使用商用IC和具有该商用IC的自动测试设备（ATE）产生具有用户想要的可变周期的高速数据信号。所述数字信号发生器包括接收目标数据信号的信号信息的输入单元，计算至少两个延迟值和至少两个数据值的控制器，所述至少两个延迟值和所述至少两个数据值用于产生数据信号对应于通过输入单元输入的信号信息;多相时钟发生器，其基于所述至少两个延迟值延迟参考时钟信号以产生具有不同相位的至少两个时钟信号;信号发生器，其产生至少两个通过将至少两个数据值分配给所述至少两个时钟信号的数据信号，以及逻辑门单元，其基于在所述信号发生器中生成的所述至少两个数据信号输出与通过所述输入单元输入的信号信息相对应的数据信号并且包括至少一个XOR门。（110）输入单元;（120）控制单元;（130）多相时钟发生器;（140）信号生成单元;（150）逻辑门单元

6. 发明公开

KR1020130119348A 고속 신호 측정 장치 및 방법 审中-实审
标题翻译：高速信号测量装置和方法
公开(公告)号：KR1020130119348A
公开(公告)日：2013-10-31
申请号：KR1020130030520
申请日：2013-03-21
申请人： 삼성전자주식회사 , 조지아 테크 리서치 코오포레이션
发明人： 김성열 , 최현우 , 니콜라스쵸우 , 시안왕 , 토마스문 , 압히짓채터지 , 유호선
IPC分类号： G01R23/00 , H03M1/12
CPC分类号： H03M1/1245 , H03B21/00 , H03M1/121
摘要： PURPOSE: A high speed signal measurement apparatus and a method thereof are provided to improve time/frequency resolution as implementing simple hardware architecture by using a small number of analog digital (AD) converters (10). CONSTITUTION: A high speed signal measurement apparatus includes an AD converter (10), a frequency generator (11), a signal processor and a controller (30). The AD converter samples an input signal with different frequencies and is arranged in parallel. The frequency generator provides a different sampling frequency to each of the plurality of AD converters arranged in parallel. The signal processor receives an output of the plurality of AD converters arranged in parallel, and then restores a signal. The controller receives a trigger signal and processes the received trigger signal.
摘要翻译：目的：提供一种高速信号测量装置及其方法，以通过使用少量的模拟数字（AD）转换器（10）来实现简单的硬件架构来提高时间/频率分辨率。构成：高速信号测量装置包括AD转换器（10），频率发生器（11），信号处理器和控制器（30）。 AD转换器对具有不同频率的输入信号进行采样并且并行布置。频率发生器对并行布置的多个AD转换器中的每一个提供不同的采样频率。信号处理器接收并行布置的多个AD转换器的输出，然后恢复信号。控制器接收触发信号并处理接收到的触发信号。

7. 发明授权

KR102058494B1 고속 신호 측정 장치 및 방법 有权
公开(公告)号：KR102058494B1
公开(公告)日：2019-12-23
申请号：KR1020130030520
申请日：2013-03-21
申请人： 삼성전자주식회사 , 조지아 테크 리서치 코오포레이션
发明人： 김성열 , 최현우 , 니콜라스쵸우 , 시안왕 , 토마스문 , 압히짓채터지 , 유호선
IPC分类号： G01R23/00 , H03M1/12

8. 外观设计

KR3009210670000S 有权
公开(公告)号：KR3009210670000S
公开(公告)日：2017-08-30
申请号：KR3020170008421
申请日：2017-02-22
申请人： 삼성전자주식회사
设计人： 배효진 , 이자경 , 최현우 , 박천현 , 유영웅 , 유재인 , 이용구

9. 外观设计

KR3008049020000S 有权
公开(公告)号：KR3008049020000S
公开(公告)日：2015-07-09
申请号：KR3020140057776
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 정종일 , 이숙경 , 명지혜 , 한봉희

10. 外观设计

KR3008049030000S 有权
公开(公告)号：KR3008049030000S
公开(公告)日：2015-07-09
申请号：KR3020140057777
申请日：2014-11-28
申请人： 삼성전자주식회사
设计人： 최현우 , 정종일 , 이숙경 , 명지혜 , 한봉희

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