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    • 2. 发明公开
    • 확률론적 병렬 마이크로프로세서
    • 概率并行微处理器
    • KR20180021744A
    • 2018-03-05
    • KR20177037919
    • 2016-06-17
    • CENTRE NATIONAL DE LA RECHERCHE SCIENT C N R SCOLLEGE DE FRANCE
    • DROULEZ JACQUESBESSIERE PIERRE
    • G06F7/70
    • G06F7/70
    • 본발명은확률론적유형의마이크로프로세서에관한것이다. 마이크로프로세서는본 발명은 2개의각각의주어진입력확률값의이진코딩을각각나타내는 2개의무작위이고독립적인이진입력신호(A, B)를입력으로서수신할수 있고, 무작위이진출력신호(C)를출력으로서발생시킬수 있는적어도하나의기본확률론적계산모듈(1)을포함한다. 기본모듈은: - 출력신호(C)를발생시키도록 2개의입력신호(A, B)를결합할수 있는프로그래밍가능한로직유닛(2); - 로직유닛(2)에의해발생된출력신호(C)에의해코딩된출력확률값을저장할수 있는어드레싱가능한메모리(3); - 제1 클럭신호(CLK1)를생성할수 있는적어도하나의제1 확률론적클럭(4); - 제2 클럭신호(CLK2)를생성할수 있는적어도하나의제2 확률론적클럭(5)을포함한다.
    • 本发明涉及一种随机型微处理器。 微处理器中的本发明提供一种每两个两个随机和独立的二进制输入信号的(A,B),以可被接收作为输入,输出表示给定的输入概率值的二进制编码,分别随机二进制输出信号(C) 以及至少一个能够产生概率函数的基本概率计算器模块1。 基本模块包括:可编程逻辑单元(2),其能够组合两个输入信号(A,B)以产生输出信号(C); - 一个逻辑单元(2)的输出信号(C)能够通过生成由存储编码的输出概率可寻址存储器(3); 至少一个能够产生第一时钟信号(CLK1)的第一随机时钟(4); - 至少一个能够产生第二时钟信号(CLK2)的第二概率时钟(5)。