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2. 发明专利

KR20210030599A KR20210030599A - Memory system for supporting distributed read of data and method operation thereof 审中-公开
公开(公告)号：KR20210030599A
公开(公告)日：2021-03-18
申请号：KR1020190111911A
申请日：2019-09-10
申请人： 에스케이하이닉스 주식회사
发明人： 변유준
IPC分类号： G06F12/1072 , G06F3/06 , G06F12/1009
CPC分类号： G06F12/1072 , G06F3/065 , G06F12/1009 , G06F3/0604 , G06F3/061 , G06F3/0614 , G06F3/064 , G06F3/0653 , G06F3/0679 , G11C16/10 , G11C16/26 , G11C29/38
摘要： 본 기술은 리드 요청된 데이터를 분산 리드할 수 있는 메모리 시스템 및 메모리 시스템의 동작방법에 관한 것으로서, 다수의 페이지를 각각 포함하는 다수의 메모리 블록을 포함하며, 다수의 메모리 블록은 적어도 하나 이상의 배드(bad)블록 및 나머지 정상블록으로 구분되는 비휘발성 메모리 장치; 및 정상블록에 포함된 다수의 페이지 중 리드요청 횟수가 제1기준횟수 이상인 제1페이지가 검출되고 제2페이지가 설정된 경우, 제1페이지의 데이터를 제2페이지에 복사하는 백업동작을 수행하고, 백업동작 이후 제1페이지에 대한 리드요청에 응답하여 제2페이지에서 데이터를 리드하는 컨트롤러를 포함하며, 컨트롤러는, 배드블록에 포함된 다수의 페이지 중 데이터의 프로그램/리드가 가능한 특정페이지의 존재여부를 확인하는 확인동작을 수행하고, 확인동작에서 특정페이지가 존재하는 경우, 해당 특정페이지를 제2페이지로 설정한다.

3. 发明专利

JP2021043966A グラフィックス表面アドレス指定有权
公开(公告)号：JP2021043966A
公开(公告)日：2021-03-18
申请号：JP2020147034
申请日：2020-09-01
申请人：アップルインコーポレイテッド , Apple Inc.
发明人：アンソニーピードロリエ , マイケルジェースウィフト , ミカルバリエント , ロバートエスハルトーグ , タイソンジェーバーグランド , グーカンアヴカログラリ
IPC分类号： G06F12/1009 , G06F12/0897 , G06F12/0862 , G06F12/0875 , G06F12/1027
摘要：【課題】グラフィックス表面に対するメモリ割り当てのためのアドレス変換を行う装置を提供する。【解決手段】グラフィックス処理回路110は、グラフィックス表面に割り当てられた表面空間内のアドレスに基づいてグラフィックス表面にアクセスする。第1の変換回路は、表面空間のページのための複数の変換エントリのセットの1以上のエントリにアクセスし、変換エントリのうちの1以上に基づいて、表面空間のためのアドレス情報を仮想空間内のアドレス情報に変換する。グラフィックス処理回路は、仮想空間内のアドレスを、グラフィックス表面を記憶するメモリの物理空間内のアドレスに変換する、第1及び第2の変換回路による変換に基づいて、グラフィックス表面へアクセスするためのアドレスを提供する。【選択図】図1

6. 发明专利

JP2020074222A メモリ装置及び方法审中-公开
公开(公告)号：JP2020074222A
公开(公告)日：2020-05-14
申请号：JP2020017134
申请日：2020-02-04
申请人：キオクシア株式会社
发明人：菅野伸一
IPC分类号： G06F12/00 , G06F12/1009 , G06F12/1027 , G06F12/02
摘要：【課題】アドレス変換データを効率的に管理するメモリ装置を提供する。【解決手段】情報処理システムにおいて、メモリ装置は、不揮発性メモリ、キャッシュメモリ、アドレス変換部、書き込み制御部及び読み出し制御部を含む。不揮発性メモリは、複数のレイヤを持つ階層構造により、書き込み先又は読み出し先として指定された論理アドレスと、不揮発性メモリの位置を示す物理アドレスとを関連付けているアドレス変換データを格納する。キャッシュメモリは、アドレス変換データの一部を格納する。アドレス変換部は、アドレス変換データの階層構造に従って、キャッシュメモリに格納すべきアドレス変換データの一部を探索し、キャッシュメモリに格納し、キャッシュメモリを参照して論理アドレスを物理アドレスに変換する。書き込み制御部及び読み出し制御部は、其々アドレス変換部によって取得した物理アドレスに対して、対象データの書き込み又は読み出しを行う。【選択図】図1

8. 发明专利

JP6545861B2 共有仮想メモリ有权
公开(公告)号：JP6545861B2
公开(公告)日：2019-07-17
申请号：JP2018079012
申请日：2018-04-17
申请人：インテルコーポレイション
发明人：ラオ,ジャヤンス,エヌ. , シルヴァス,ロナルド,ダブリュー. , シャー,アンクール,エヌ.
IPC分类号： G06F12/1009 , G06F12/0875 , G06F12/109

9. 发明专利

JP6408747B1 統合メモリ管理ユニット(MMU)を使用したメモリ管理機能の提供有权
公开(公告)号：JP6408747B1
公开(公告)日：2018-10-17
申请号：JP2018515040
申请日：2016-09-12
申请人：クアルコム,インコーポレイテッド
发明人：セラッグ・モニアー・ガデルラブ , ジェイソン・エドワード・ポダイマ , ルオロン・リウ , アレクサンダー・ミレトスキー , ポール・クリストファー・ジョン・ウィアーシエンスキー , カイル・ジョン・アーンウェイン , カルロス・ハビエル・モレイラ , サイモン・ピーター・ウィリアム・ブース , メガール・ヴァリア , トーマス・デイビッド・ドライバーグ
IPC分类号： G06F12/00 , G06F12/1027 , G06F12/1009 , G06F12/02
CPC分类号： G06F12/1072 , G06F2212/1008 , G06F2212/1016
摘要：統合メモリ管理ユニット(MMU)を使用したメモリ管理機能が提供され、関連装置および方法が開示される。一態様では、それぞれが複数の入力トランザクションバッファを含む複数の入力データパスと、それぞれが複数の出力トランザクションバッファを含む複数の出力パスとを備える統合MMUが提供される。統合MMUのいくつかの態様は、さらに、1つまたは複数の変換キャッシュおよび/あるいは1つまたは複数のハードウェアページテーブルウォーカーをさらに提供する。統合MMUは、入力トランザクションバッファからメモリアドレス変換要求(MATR)を検索することと、変換されたメモリアドレスフィールド(TMAF)を生成するためにMATRに基づいてメモリアドレス変換動作を実行することと、出力トランザクションバッファにTMAFを提供することとを行うように構成されたMMU管理回路をさらに含む。統合MMUはまた、複数の出力データパスを提供し、それぞれは、結果として得られるメモリアドレス変換を伴うトランザクションを出力するように構成される。

10. 发明专利

JPS5630578B1 失效
公开(公告)号：JPS5630578B1
公开(公告)日：1981-07-15
申请号：JP340567
申请日：1967-01-19
IPC分类号： G06F9/34 , G06F12/04 , G06F12/10 , G06F12/1009

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