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    • 3. 发明专利
    • 半導体装置およびその制御方法
    • 半导体器件及其控制方法
    • JP2016046478A
    • 2016-04-04
    • JP2014171777
    • 2014-08-26
    • 株式会社デンソー株式会社豊田中央研究所
    • 荒川 和樹小山 和博加地 徹菊田 大悟
    • H01L27/098H01L29/808H01L21/338H01L29/778H01L29/812H01L21/337
    • 【課題】高速スイッチング化が実現可能で、かつ、高耐圧を得ることが可能なヘテロジャンクション構造を有す半導体装置を提供する。 【解決手段】GaN層3の上にダイヤモンド層5を介してゲート電極6を形成する。このような構成とすると、順バイアス時に、ダイヤモンド層5とGaN層3との接合界面にエネルギー障壁が形成され、電子はゲート側へは殆ど流入せず、ホールもチャネル側へほとんど流入しない。このため、ホールを排出する必要が無く、高速スイッチング化が可能となる。また、逆バイアス時に、ポテンシャルが高くなり、電子に対してはチャネル側からゲート側への障壁が高いが、ホールに対してはチャネル側からゲート側への障壁がなくなり、ホールをゲート側へ逃がすことが可能となる。このため、準位トラップなどにより、チャネル側に発生したホールが逆バイアスを印加することによってゲート側に逃がされる。よって、絶縁耐圧も得られる。 【選択図】図1
    • 要解决的问题:提供一种包括异质结结构的半导体器件,其中可以实现高速切换并且可以获得高耐压性。解决方案:通过金刚石层在GaN层3上形成栅电极6 在这种配置中,在正向偏压期间,在金刚石层5和GaN层3之间的结界面上形成能量势垒,电子几乎不流到栅极侧,并且孔几乎不流入沟道侧 ,或者。 因此,不需要排出孔,并且可以紧固切换。 此外,在反向偏置期间,虽然电位变高,并且从通道侧到栅极侧的势垒对于电子高,但是从通道侧到栅极侧的孔不存在阻挡,并且可以制成孔 逃到门边 因此,在通道侧产生的孔通过由水平阱等施加反向偏压而被排出到栅极侧。 因此,也可以获得绝缘耐压。选择图:图1
    • 4. 发明专利
    • 半導体装置およびその製造方法
    • 半导体器件及其制造方法
    • JP2016009843A
    • 2016-01-18
    • JP2014131692
    • 2014-06-26
    • 株式会社デンソー株式会社豊田中央研究所
    • 土屋 義規樽見 浩幸星 真一松井 正樹伊藤 健治成田 哲生加地 徹
    • H01L29/778H01L29/812H01L29/786H01L21/336H01L29/78H01L21/20H01L21/338
    • H01L21/20H01L29/778H01L29/78H01L29/786H01L29/812
    • 【課題】閾値電圧を適正値に制御でき、バラツキの少ないGaNデバイスを実現する。 【解決手段】ゲート絶縁膜4とGaN層2との界面およびGaN層2側(GaN層2の表層部)の格子位置にあるドナー元素(SiやO)の濃度を5.0×10 17 cm -3 以下にする。具体的には、ゲート絶縁膜4の形成工程の前に、リセス形状部3aから露出させられたGaN層2の表面に存在するドナー元素の除去工程を行う。このように、ゲート絶縁膜4とGaN層2との界面およびGaN層2側の格子位置にあるドナー元素濃度が低い濃度に設定することで、チャネル部のドナーに起因する閾値電圧の変動を抑制できる。したがって、閾値電圧を適正値に制御することが可能となって、バラツキの少ないGaNデバイスを実現することができる構造の半導体装置とすることが可能となる。 【選択図】図1
    • 要解决的问题:实现能够将阈值电压控制在适当值以具有较小变化的GaN器件。解决方案:在半导体器件制造方法中,施主元件(Si,O等)的浓度 栅绝缘膜4和GaN层2的界面以及GaN层2侧(GaN层2的表层部)的晶格位置设定为5.0×10cm以下。 特别地,在栅极绝缘膜4的形成处理之前,执行从凹部形状部3a露出的存在于GaN层2的表面上的施主元件的去除处理。 如上所述,通过将施主元件设置在栅极绝缘膜4和GaN层2的界面处,并且在GaN层2侧的晶格位置处设置为较低浓度,由供体在 通道部分可以被禁止。 因此,可以将阈值电压控制在合适的值,从而使得半导体器件具有能够实现具有较小变化的GaN器件的结构。
    • 5. 发明专利
    • 半導体装置
    • 半导体器件
    • JP2016058622A
    • 2016-04-21
    • JP2014185313
    • 2014-09-11
    • 株式会社デンソー株式会社豊田中央研究所
    • 樽見 浩幸小山 和博松井 正樹樋口 安史大竹 伸幸加地 徹菊田 大悟
    • H01L29/778H01L29/812H01L29/786H01L21/336H01L29/788H01L29/792H01L21/338
    • 【課題】浮遊ゲート層からの電荷抜けを防ぎ、経時劣化によってノーマリオフ状態が維持できなくなることを防ぐ。 【解決手段】第1のGaN系半導体層をGaN層3で構成すると共に第2のGaN系半導体層をAlGaN層4で構成し、AlGaN層4に設けた凹部4aに、ゲート構造体を構成する。そして、ゲート構造体としてゲート電極8に加えて浮遊ゲート層6を備え、浮遊ゲート層6をダイヤモンド膜によって構成された第1、第2ゲート絶縁膜5、7によって挟み込んだ構成とする。このように、第1、第2ゲート絶縁膜5、7をシリコン酸化膜よりも電子に対して高い障壁を有した絶縁膜で構成することで、浮遊ゲート層6に注入された電荷が抜け難くなり、経時劣化によってノーマリオフ状態が維持できなくなることを抑制できる。 【選択図】図1
    • 要解决的问题:为了防止由浮栅层引起的电荷泄漏,以防止由于老化而劣化而导致不能保持正常关闭状态。解决方案:半导体器件包括:第一GaN基半导体层,其由 GaN层3; 由AlGaN层4构成的第二GaN基半导体层; 以及栅极结构,其形成在设置在AlGaN层4中的凹部4a中,并且除了栅极电极8之外还包括浮置栅极层6,其中浮栅层6被第一和第二栅极绝缘膜5夹在中间, 7金刚石薄膜组成。 如上所述,通过利用对氧化硅膜具有比电极更高的屏障的绝缘膜形成第一和第二栅极绝缘膜5,7,注入浮栅层6的电荷不太可能泄漏,并且不能保持正常的电压, 关闭状态,这是由年龄恶化引起的,可以被抑制。选择图:图1