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热词
    • 3. 发明公开
    • Signal processor
    • Signalprozessor
    • EP2085893A2
    • 2009-08-05
    • EP09155502.9
    • 1995-10-20
    • Panasonic Corporation
    • Ninomiya, KazukiSumida, KeizoMiyake, JiroNishiyama, Tamotsu
    • G06F15/80
    • G06F15/8046G06F15/8023
    • An improved signal processor is disclosed which is suitable for convergence processing of images that achieves parallel processing with a smaller bus structure. An arithmetic array is provided which is formed of twenty arithmetic cells capable of concurrently operating. Each arithmetic cell is specified by a denotation of E[x(column number),y(row number)] where the column number x is 1 = 2. Each arithmetic cell has a multiplier and an adder for multiply-add operation. An arithmetic cell, specified by E[x,y] where 2
    • 公开了一种改进的信号处理器,其适用于以较小的总线结构实现并行处理的图像的收敛处理。 提供了一个算术数组,它由能够同时操作的20个算术单元组成。 每个算术单元由列号x为1 <= x <= M且行号y为1 <= y <= M +的E [x(列号),y(行号)]的指示来指定, 1,M是M> = 2的整数。每个算术单元具有用于乘法运算的乘法器和加法器。 由E [x,y]指定的算术单元,其中2 <= x <= M和x + 1 <= y <= M + 1,通过直接从E [x-1,y]算术单元接收数据 总线以及从E [x-1,y-1]算术单元经由斜线总线。 例如,由BUSES 109和110互连在一起以形成树结构的一组CELLS A1,B1,C1,D1,B2,C2,D2,C3,D3和D4独立于一组细胞P1, Q1,R1,S1,Q2,R2,S2,R3,S3和S4,通过BUSES 109和110互连在一起以形成树结构。 这允许其中一个组执行水平滤波处理,另一组可以执行垂直滤波处理。