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1. 发明授权

CN101411059B 具有并联耦合差分输入对的转换器失效
公开(公告)号：CN101411059B
公开(公告)日：2012-07-04
申请号：CN200780010417.4
申请日：2007-03-21
申请人： NXP股份有限公司
发明人：王振华
IPC分类号： H03F3/45
CPC分类号： H03F3/45183 , H03F3/45475 , H03F2203/45138 , H03F2203/45361 , H03F2203/45574
摘要：一种将第一和第二差分输入信号转换为输出信号的电路(1)，所述电路(1)具有第一差分输入级(10)、第二差分输入级(20)和输出级(30)以避免复杂的运算放大器，所述第一差分输入级(10)包括用于接收第一差分输入信号的第一和第二输入(11，12)，并且包括第一和第二输出(13，14)；所述第二差分输入级(20)包括用于接收第二差分输入信号的第三和第四输入(21，22)，并且包括第三和第四输出(23，24)；所述输出级(30)包括与第一输出(11)(其还与第三输出(21)连接)连接的第一端子(31)，包括与第二输出(12)(其还与第四输出(22)连接)连接的第二端子(32)，并且包括提供输出信号的第三端子(33)。差分输入级(10，20)包括两个晶体管对(15，16，25，26)，而且输出级(30)包括具有第三晶体管对(34，35)的电流镜。稳压器(4)包括电路(1)和响应输出信号以调制电压源信号的调制器级(40)。

2. 发明公开

CN1551490A 运算放大电路以及使用运算放大电路的采样保持电路和滤波电路失效
公开(公告)号：CN1551490A
公开(公告)日：2004-12-01
申请号：CN200410063141.4
申请日：2004-02-27
申请人：株式会社东芝
发明人：板仓哲朗 , 山路隆文
IPC分类号： H03F3/45
CPC分类号： H03F3/45475 , G11C27/024 , G11C27/026 , H03F3/45632 , H03F3/45928 , H03F3/45977 , H03F2203/45101 , H03F2203/45138 , H03F2203/45428 , H03F2203/45574 , H03H11/1243 , H03H11/32
摘要：本发明的目的是提供一种运算放大电路以及使用运算放大电路的采样保持电路和滤波电路，能充分抑制同相信号，使在差动信号的各路径中的内部节点数为一个来改善频率特性。所述运算放大电路由下述部件构成：输入第一、第二输入信号的第一、第二反转放大电路(A1、A2)，输入模拟同相输出信号和第一反转放大电路的输出信号并输出第一、第二输出信号的第三反转放大电路(A3)，输入模拟同相输出信号和第二反转放大电路的输出信号并输出第三、第四输出信号的第四反转放大电路(A4)，和输入模拟同相输出信号并反馈给第一、第二反转放大电路的输出的第一以及第二非反转放大电路(A5、A6)。

3. 发明公开

CN1494763A 具有高线性度和单调相关的偏移电压的自动增益控制电路无效
公开(公告)号：CN1494763A
公开(公告)日：2004-05-05
申请号：CN02805698.1
申请日：2002-02-26
申请人：英特塞尔美国公司
发明人：约翰·S·普伦蒂斯 , 帕特里克·J·兰迪
IPC分类号： H03G3/30 , H03G3/20 , H03F1/32 , H03F3/45
CPC分类号： H03F1/3211 , H03F3/45085 , H03F3/456 , H03F3/45973 , H03F2203/45574 , H03G3/3042
摘要：一种自动增益控制(AGC)电路100包括高增益放大器A1，反馈网络RA，RB，RC，和两个跨导放大器G1，G2。所述反馈网络具有接收AGC电路的输入信号VIN的第一端，与高增益放大器的输出VOUT相连的第二端，以及两个中间节点V1，V2。每个跨导放大器G1，G2具有和所述反馈网络的各个中间节点相连的输入端，以及和高增益放大器的输入相连的输出端。所述跨导放大器共同地控制反馈网络内的虚地的位置，从而控制AGC电路的增益。每个跨导放大器G1，G2都包括衰减器201和跨导级203，被连接在反馈网络和高增益放大器之间，并被构成在相对宽的输入电压范围内线性地操作。所述AGC电路的输入偏移电压随AGC电路的增益单调地改变。

4. 发明公开

CN1198855A 放大电路失效转让
公开(公告)号：CN1198855A
公开(公告)日：1998-11-11
申请号：CN96197465.6
申请日：1996-09-06
申请人：摩托罗拉公司
发明人：伊恩·麦克贝斯
IPC分类号： H03F3/72 , H03F3/45
CPC分类号： H03F3/45192 , H03F3/45479 , H03F3/72 , H03F2203/45138 , H03F2203/45574 , H03F2203/45616 , H03F2203/45726
摘要：一种包括第一和第二双输入差分输入电路的放大电路。第一输入电路有第一和第二输入端,第二输入电路有第三和第四输入端。第一输入端与第一电路输入相连,第四输入端与第四电路输入相连。可编程电路用来有选择地把第二和第三输入端连到第二和第三电路输入或连到第四和第一输入。

5. 发明公开

CN101411059A 具有并联耦合差分输入对的转换器失效
公开(公告)号：CN101411059A
公开(公告)日：2009-04-15
申请号：CN200780010417.4
申请日：2007-03-21
申请人： NXP股份有限公司
发明人：王振华
IPC分类号： H03F3/45
CPC分类号： H03F3/45183 , H03F3/45475 , H03F2203/45138 , H03F2203/45361 , H03F2203/45574
摘要：一种将第一和第二差分输入信号转换为输出信号的电路(1)，所述电路(1)具有第一差分输入级(10)、第二差分输入级(20)和输出级(30)以避免复杂的运算放大器，所述第一差分输入级(10)包括用于接收第一差分输入信号的第一和第二输入(11，12)，并且包括第一和第二输出(13，14)；所述第二差分输入级(20)包括用于接收第二差分输入信号的第三和第四输入(21，22)，并且包括第三和第四输出(23，24)；所述输出级(30)包括与第一输出(11)(其还与第三输出(21)连接)连接的第一端子(31)，包括与第二输出(12)(其还与第四输出(22)连接)连接的第二端子(32)，并且包括提供输出信号的第三端子(33)。差分输入级(10，20)包括两个晶体管对(15，16，25，26)，而且输出级(30)包括具有第三晶体管对(34，35)的电流镜。稳压器(4)包括电路(1)和响应输出信号以调制电压源信号的调制器级(40)。

6. 发明授权

CN1316735C 运算放大电路以及使用运算放大电路的采样保持电路和滤波电路失效
公开(公告)号：CN1316735C
公开(公告)日：2007-05-16
申请号：CN200410063141.4
申请日：2004-02-27
申请人：株式会社东芝
发明人：板仓哲朗 , 山路隆文
IPC分类号： H03F3/45
CPC分类号： H03F3/45475 , G11C27/024 , G11C27/026 , H03F3/45632 , H03F3/45928 , H03F3/45977 , H03F2203/45101 , H03F2203/45138 , H03F2203/45428 , H03F2203/45574 , H03H11/1243 , H03H11/32
摘要：本发明的目的是提供一种运算放大电路以及使用运算放大电路的采样保持电路和滤波电路，能充分抑制同相信号，使在差动信号的各路径中的内部节点数为一个来改善频率特性。所述运算放大电路由下述部件构成：输入第一、第二输入信号的第一、第二反转放大电路(A1、A2)，输入模拟同相输出信号和第一反转放大电路的输出信号并输出第一、第二输出信号的第三反转放大电路(A3)，输入模拟同相输出信号和第二反转放大电路的输出信号并输出第三、第四输出信号的第四反转放大电路(A4)，和输入模拟同相输出信号并反馈给第一、第二反转放大电路的输出的第一以及第二非反转放大电路(A5、A6)。

7. 发明授权

CN1083640C 放大电路失效转让
公开(公告)号：CN1083640C
公开(公告)日：2002-04-24
申请号：CN96197465.6
申请日：1996-09-06
申请人：摩托罗拉公司
发明人：伊恩·麦克贝斯
IPC分类号： H03F3/72 , H03F3/45
CPC分类号： H03F3/45192 , H03F3/45479 , H03F3/72 , H03F2203/45138 , H03F2203/45574 , H03F2203/45616 , H03F2203/45726
摘要：一种包括第一和第二双输入差分输入电路的放大电路。第一输入电路有第一和第二输入端，第二输入电路有第三和第四输入端。第一输入端与第一电路输入相连，第四输入端与第四电路输入相连。可编程电路用来有选择地把第二和第三输入端连到第二和第三电路输入或连到第四和第一输入。

8. 发明申请

WO1986007215A1 IMPROVEMENTS IN OR RELATING TO TRANSCONDUCTORS 审中-公开
标题翻译：改善或相对于传感器的改进
公开(公告)号：WO1986007215A1
公开(公告)日：1986-12-04
申请号：PCT/GB1986000289
申请日：1986-05-23
申请人： WOLFSON MICROELECTRONICS LIMITED , PENNOCK, John, Laurence
发明人： WOLFSON MICROELECTRONICS LIMITED
IPC分类号： H03F03/45
CPC分类号： H03F3/45179 , H03F3/45197 , H03F3/45502 , H03F3/4565 , H03F2203/45352 , H03F2203/45431 , H03F2203/45574 , H03F2203/45592 , H03H11/0444
摘要： A differential input, differential output transconductor for IC fabrication comprises a matched pair of field-effect transistors (10) whose source terminals (11) are connected together to a first fixed voltage, the substrate terminals are connected together to a second fixed voltage and the quiescent voltages of the gate terminals (12) are equal. The FETs are biassed in the triode region of operation for the expected gate-source voltage and signal voltages of equal but opposite polarity are superimposed on the gate terminals (12) of the FETs. Circuitry is disclosed to maintain the voltage of the drain terminals (13) and to transmit the differential - mode output current component at a higher impedance level to output circuitry. A common-mode bias stabilisation circuit, a phase neutralising circuit and active filter circuits are also disclosed.
摘要翻译：用于IC制造的差分输入差分输出跨导体包括一对匹配的场效应晶体管（10），其源极端子（11）一起连接到第一固定电压，衬底端子连接到第二固定电压，并且栅极端子（12）的静态电压相等。在期望的栅极 - 源极电压的三极管工作区域中将FET偏压，并且FET的栅极端子（12）上叠加相等但相反极性的信号电压。公开了电路以维持漏极端子（13）的电压并且将更高阻抗电平的差分模式输出电流分量传输到输出电路。还公开了共模偏置稳定电路，相位中和电路和有源滤波器电路。

9. 发明授权

EP2005582B1 CONVERTER WITH PARALLEL COUPLED DIFFERENTIAL INPUT PAIRS 有权
标题翻译：与并行差分输入对转换器
公开(公告)号：EP2005582B1
公开(公告)日：2011-09-14
申请号：EP07735210.2
申请日：2007-03-21
申请人： NXP B.V.
发明人： WANG, Zhenhua
IPC分类号： H03F3/45
CPC分类号： H03F3/45183 , H03F3/45475 , H03F2203/45138 , H03F2203/45361 , H03F2203/45574
摘要： A circuit (1) for converting first and second differential input signals into an output signal is provided with a first differential input stage (10) comprising first and second inputs (11,12) for receiving the first differential input signal and comprising first and second outputs (13,14) and with a second differential input stage (20) comprising third and fourth inputs (21,22) for receiving the second differential input signal and comprising third and fourth outputs (23,24) and with an output stage (30) comprising a first terminal (31) connected to the first output (11) that is further connected to the third output (21) and comprising a second terminal (32) connected to the second output (12) that is further connected to the fourth output (22) and comprising a third terminal (33) for providing the output signal, to avoid complex operational amplifiers. The differential input stages (10,20) comprise two pairs of transistors (15,16,25,26) and the output stage (30) comprises a current mirror with a third pair of transistors (34,35). A regulator (4) comprises the circuit (1) and a modulator stage (40) for in response to the output signal modulating a voltage supply signal.

10. 发明公开

EP1083655A2 Amplifier circuit 审中-公开
标题翻译： Verstärkungsschaltung
公开(公告)号：EP1083655A2
公开(公告)日：2001-03-14
申请号：EP00119379.6
申请日：2000-09-11
申请人： KABUSHIKI KAISHA TOSHIBA
发明人： Ishii, Hirotomo , Czarnul, Zdzislaw
IPC分类号： H03F3/45
CPC分类号： H03F3/45183 , H03F3/45475 , H03F3/45659 , H03F3/45766 , H03F3/45991 , H03F2203/45418 , H03F2203/45424 , H03F2203/45574
摘要： A balanced type DDA 1 is combined with a single end type DDA 2 to form a differential amplifier circuit 3 which is a balanced type DDA- The balanced type DDA 1 has four input terminals VPP, VPN, VNN and VNP which are input terminals of two differential input stages, and two output terminals VoutP and VoutN which are output terminals of two output stages. These terminals are four input terminals and two output terminals of the differential amplifier circuit 3. The single end type DDA 2 has four input terminals, which are input terminals of two differential input stages and which are connected to the four input terminals of the differential amplifier circuit 3, respectively. The single end type DDA 2 also has an output terminal vout of one output stage, which serves as a control output terminal for the feedback control of the differential amplifier circuit 3. By the negative feedback of the signal of the control output terminal Vout, a virtual short-circuit can be established between two input terminals of each differential input stages, so that it is possible to reduce distortion without reducing gains.
摘要翻译：平衡型DDA 1与单端DDA2组合形成平衡型DDA的差分放大电路3。平衡型DDA 1具有四个输入端子VPP，VPN，VNN和VNP，输入端为二差分输入级，以及作为两个输出级的输出端子的两个输出端子VoutP和VoutN。这些端子是差分放大器电路3的四个输入端子和两个输出端子。单端型DDA2具有四个输入端子，它们是两个差分输入级的输入端子，它们连接到差分放大器的四个输入端子电路3。单端型DDA2还具有一个输出级的输出端子vout，其作为用于差分放大器电路3的反馈控制的控制输出端子。通过控制输出端子Vout的信号的负反馈，a 可以在每个差分输入级的两个输入端之间建立虚拟短路，使得可以在不减少增益的情况下减少失真。

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