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1. 发明授权

US6167556A System for logic extraction from a layout database 失效
标题翻译：从布局数据库中提取逻辑的系统
公开(公告)号：US6167556A
公开(公告)日：2000-12-26
申请号：US29119
申请日：1998-02-23
申请人： Albert C. Sun , Chee-Horng Lee , Chang-Lun Chen , Chun-hao Li
发明人： Albert C. Sun , Chee-Horng Lee , Chang-Lun Chen , Chun-hao Li
IPC分类号： G06F17/50
CPC分类号： G06F17/5022
摘要： A system and process for logic extraction from the layout of logic blocks is described. Logic design information is extracted from a transistor level net list which is stored in a memory. The transistor level net list in turn is generated from a layout polygon database using techniques in the art. The process comprises processing the transistor level net list in the memory to define groups of transistors according to whether or not transistors in the transistor level net list are connected to a supply voltage, whether or not transistors in the transistor level net list are connected to a reference voltage and the transistor type. The groups of transistors are analyzed according to their interconnections, and their membership in groups. Finally, logic units are identified in response to the step of analyzing the groups of transistors.
摘要翻译： PCT No.PCT / US97 / 18844 Sec。 371日期1998年2月23日 102（e）日期1998年2月23日PCT 1997年10月14日PCT公布。出版物WO99 / 19818 日期1999年04月22日描述了逻辑块布局逻辑提取的系统和过程。从存储在存储器中的晶体管级网表提取逻辑设计信息。晶体管级网表依次使用本领域的技术从布局多边形数据库生成。该处理包括处理存储器中的晶体管级网表，以根据晶体管级网表中的晶体管是否连接到电源电压来定义晶体管组，晶体管级网表中的晶体管是否连接到参考电压和晶体管类型。晶体管组根据它们的相互关系以及它们的分组成员进行分析。最后，响应于分析晶体管组的步骤来识别逻辑单元。

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