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    • 8. 发明授权
    • Memory having nonvolatile and volatile memory banks
    • 具有非易失性和易失性存储器的存储器
    • US5343437A
    • 1994-08-30
    • US19492
    • 1993-02-19
    • Mark J. JohnsonBrian D. Branson
    • Mark J. JohnsonBrian D. Branson
    • G06F12/06G11C11/00G11C8/00
    • G06F12/0638G11C11/005
    • A memory (20) includes a nonvolatile memory array (32) and a volatile memory array (22). The nonvolatile memory array (32) is subdivided into banks of memory cells. The volatile memory array (22) may also be subdivided into multiple banks, and is smaller than the nonvolatile memory array (32). A transfer circuit (40) transfers the contents of a bank of nonvolatile memory array (32) into a bank of volatile memory array (22) before the data can be accessed by a processor (160). In addition, a preload decision logic circuit (180) may transfer a bank of nonvolatile memory array (32) into volatile memory array (22) invisibly to the processor (160), to have the data available when needed, thus avoiding a space fault. Coupling a smaller volatile memory array (22) to a nonvolatile memory array (32) combines the advantages of faster access times and nonvolatility without greatly increasing the size of the memory (20).
    • 存储器(20)包括非易失性存储器阵列(32)和易失性存储器阵列(22)。 非易失性存储器阵列(32)被细分为存储单元组。 易失性存储器阵列(22)也可以被细分为多个存储体,并且小于非易失性存储器阵列(32)。 在数据可由处理器(160)访问之前,传送电路(40)将非易失性存储器阵列(32)的内容传送到易失性存储器阵列(22)。 此外,预加载判定逻辑电路(180)可以将非易失性存储器阵列(32)的组不可见地传输到易失性存储器阵列(22),以在需要时使数据可用,从而避免空间故障 。 将较小的易失性存储器阵列(22)耦合到非易失性存储器阵列(32),结合了更快的访问时间和非易失性的优点,而不会大大增加存储器(20)的大小。