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    • 3. 发明申请
    • INTRINSIC COMPARATOR DELAY FOR OUTPUT CLAMPING CIRCUIT
    • 用于输出钳位电路的内部比较器延迟
    • WO2015032079A1
    • 2015-03-12
    • PCT/CN2013/083109
    • 2013-09-09
    • TEXAS INSTRUMENTS INCORPORATEDMING, XiaoJIAN, Wang
    • MING, XiaoJIAN, Wang
    • H02M3/137G05F1/40G05F1/56
    • H03K5/08H02H9/041H03K3/02337H03K5/2481
    • A circuit includes a comparator to generate a clamp output signal by monitoring an output voltage and a reference voltage that sets a clamp voltage threshold for the output voltage. The clamp output signal is employed to limit an input voltage from exceeding the clamp voltage threshold. A first switch supplies the reference voltage to the comparator. The first switch forms a portion of an intrinsic delay circuit with a first feedback path in the comparator to mitigate ripple in the output voltage. A second switch is coupled to the input voltage and a second feedback path in the comparator. The second switch forms another portion of the intrinsic delay circuit with the first switch, the first feedback path, and the second feedback path in the comparator to further mitigate ripple in the output voltage.
    • 电路包括比较器,用于通过监视输出电压和为输出电压设定钳位电压阈值的参考电压来产生钳位输出信号。 采用钳位输出信号来限制输入电压超过钳位电压阈值。 第一个开关将参考电压提供给比较器。 第一开关在比较器中形成具有第一反馈路径的固有延迟电路的一部分,以减轻输出电压中的纹波。 第二开关耦合到比较器中的输入电压和第二反馈路径。 第二开关通过比较器中的第一开关,第一反馈路径和第二反馈路径形成本征延迟电路的另一部分,以进一步减轻输出电压中的纹波。