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71. 发明申请

WO2005022745A1 OPERATING FREQUENCY REDUCTION FOR TRANSVERSAL FIR FILTER 审中-公开
标题翻译：用于横向FIR滤波器的工作频率降低
公开(公告)号：WO2005022745A1
公开(公告)日：2005-03-10
申请号：PCT/CA2004/001571
申请日：2004-08-27
申请人： DIABLO TECHNOLOGIES INC. , LAPOINTE, Marcel
发明人： LAPOINTE, Marcel
IPC分类号： H03H17/00
CPC分类号： H03H17/0223 , H03H17/06 , H03H2017/0245 , H03H2017/0247 , H04L25/0278 , H04L25/0288 , H04L25/0292 , H04L25/03038 , H04L25/03057 , H04L25/03343 , H04L25/14
摘要： A method and system for reducing the frequency of operation for a transversal Finite Impulse Response (FIR) filter is disclosed. In the preferred embodiment, the transversal filter operates in such a way that it has an even and odd row of data, which are latched on rising and falling edges of the clock respectively. This allows the clock frequency to be reduced by a factor of 2, and thus allows the use of more power efficient latches. A reduction in the frequency of operation causes the high speed latches within the transversal filter to hold the data bits twice as long as is required, which changes the desired impulse response of the FIR filter. A circuit is required to select the appropriate data bits from the output of the appropriate half-speed latch, and subsequently scale it to apply the co-efficient gain. Each of the subsystems is analog, and operates in accordance with a synchronous clock system. In a more general embodiment of the invention, the data is provided to Q shift registers that operate at a clock rate which is reduced by a factor of Q.
摘要翻译：公开了一种用于降低横向有限脉冲响应（FIR）滤波器的操作频率的方法和系统。在优选实施例中，横向滤波器以这样的方式工作，使得它具有偶数和奇数行的数据，其分别锁存在时钟的上升沿和下降沿。这允许将时钟频率降低2倍，从而允许使用更多功率高效的锁存器。操作频率的降低导致横向滤波器内的高速锁存器将数据位保持为所需时间的两倍，这改变了FIR滤波器的期望脉冲响应。需要一个电路从适当的半速锁存器的输出中选择适当的数据位，然后将其缩放以应用高效增益。每个子系统是模拟的，并且根据同步时钟系统进行操作。在本发明的更一般实施例中，将数据提供给以移位因子Q减小的时钟速率工作的Q移位寄存器。

72. 发明申请

WO99054996A1 SYSTEM FOR VARYING THE DYNAMIC RANGE OF COEFFICIENTS IN A DIGITAL FILTER 审中-公开
标题翻译：改变数字滤波器中系数的动态范围的系统
公开(公告)号：WO99054996A1
公开(公告)日：1999-10-28
申请号：PCT/IB1999/000263
申请日：1999-02-15
IPC分类号： H03H21/00 , H03H17/02 , H03H17/06
CPC分类号： H03H17/06 , H03H17/0223
摘要： A digital filter includes a plurality of filter cells, each of which includes circuitry to determine a coefficient for the filter cell, to adjust the coefficient in accordance with a gain that is used by each of the plurality of filter cells, and to multiply input data by the adjusted coefficient in order to generate a filter cell output. An adder circuit generates a filter output by adding filter cell outputs from each of the plurality of filter cells, and an inverse gain circuit adjusts the filter output in accordance with an inverse of the gain used to adjust the coefficients of the plurality of filter cells.
摘要翻译：数字滤波器包括多个滤波器单元，每个滤波器单元包括确定滤波单元的系数的电路，根据多个滤波单元中的每一个使用的增益来调整系数，并将输入数据通过调整后的系数来生成滤波器单元输出。加法器电路通过将来自多个滤波器单元中的每一个的滤波器单元输出相加而产生滤波器输出，并且逆增益电路根据用于调整多个滤波单元的系数的增益的倒数来调整滤波器输出。

73. 发明专利

JPWO2010113526A1 積和演算装置有权
公开(公告)号：JPWO2010113526A1
公开(公告)日：2012-10-04
申请号：JP2010513510
申请日：2010-04-02
申请人：三菱電機株式会社
发明人：悟崇奥田 , 悟崇奥田 , 聡山中 , 聡山中 , 浩次南 , 浩次南
IPC分类号： G06F17/10 , G06F1/04
CPC分类号： G06F17/15 , G06F7/5443 , H03H17/0223 , H03H2218/10
摘要：デジタルフィルタなどに用いられる積和演算を実行する積和演算装置において、第1のデータ記憶部(1)及び第2のデータ記憶部(2)において、第1のクロック(CLK1)に同期してデータ(Da1)が書き込まれ、第1のクロックよりも高い周波数の第2のクロック(CLK2)に同期して読み出される。演算処理部(5)が、第2のクロック(CLK2)に同期して演算を実行する。第3の記憶部(3)では、第2のクロック(CLK2)に同期して前記演算処理部(5)から出力されるデータが書き込まれ、第1のクロック(CLK1)に同期して書き込まれたデータが読み出される。フィルタのタップ数が多くなった場合、フィルタのタップ数に比例して演算器の数が増加を抑制することができる。

74. 发明专利

JP4696989B2 Signal processing method and signal processing equipment 有权
公开(公告)号：JP4696989B2
公开(公告)日：2011-06-08
申请号：JP2006077007
申请日：2006-03-20
申请人：ヤマハ株式会社
发明人：保之村木
IPC分类号： G06F7/00
CPC分类号： H03H17/0223 , H03H17/045 , H03H2017/0298

75. 发明专利

JP2010512124A Method and apparatus for implementing a finite impulse response filter that does not use multiplier 有权
公开(公告)号：JP2010512124A
公开(公告)日：2010-04-15
申请号：JP2009540417
申请日：2007-12-04
申请人：アロカ株式会社
发明人：ラドゥーアレキサンドル
IPC分类号： H03H17/06
CPC分类号： H03H17/0248 , H03H17/0223 , H03H17/023 , H03H17/06
摘要：有限インパルス応答フィルタは、個別の成分のランニングサムフィルタの和として実装される。所望のフィルタ応答に必要なすべての成分ナイタの合計は、累算器内で計算され、更新期間のみが成分フィルタごとに計算される。所望のインパルス応答は、高さが等しい矩形インパルス応答の和に分解され、前記矩形インパルス応答は、それぞれ、減算および加算を必要とするランニングサムとして実施される。サンプリングクロックの倍数で動作する回路を利用することで、複数のランニングサムを同一のハードウェア上で実施することができる。任意のインパルス応答形状および長さｍａの全体フィルタは、メモリおよび２つの演算装置を利用して実装される。２つ以上のこのようなフィルタをカスケード接続して、所望の周波数特性のより優れた近似化を行うことができる。本発明は、チップ資源および製造コストを節約する。

76. 发明专利

JP4197293B2 A / d converter, d / a converter 有权
公开(公告)号：JP4197293B2
公开(公告)日：2008-12-17
申请号：JP2003411412
申请日：2003-12-10
申请人：パナソニック株式会社
发明人：恭貴浦元 , 浩二金森
IPC分类号： H03M1/08 , G11B20/10 , H03H17/02 , H03H17/06
CPC分类号： H03H17/0294 , G11B20/10527 , H03H17/0223 , H03H17/0286 , H03H17/0621 , H03H17/0657 , H03H17/0664

77. 发明专利

JP2005027267A Band pass filter and method for obtaining desired frequency band from input signal 审中-公开
标题翻译：带通滤波器和从输入信号中获取所需频带的方法
公开(公告)号：JP2005027267A
公开(公告)日：2005-01-27
申请号：JP2003306971
申请日：2003-08-29
申请人： Renei Kagi Kofun Yugenkoshi , 聯詠科技股▲ふん▼有限公司
发明人： YU DAII , RIN BUNKI , CHO ENJO
IPC分类号： H03H15/00 , H03H17/02
CPC分类号： H03H17/0223
摘要： PROBLEM TO BE SOLVED: To provide another method for producing a band pass filter which greatly reduces the complexity, the costs, the power consumption and the design area required for an infinite impulse response (IIR), or finite impulse response (FIR) based band pass filter by using a difference between an input signal and a time shift version of the input signal to conquer conventional IIR or FIR filter design techniques.
SOLUTION: The band pass filter (BPF) extracts a desired frequency band from an input signal that is represented in a sequence of data streams.
COPYRIGHT: (C)2005,JPO&NCIPI
摘要翻译：要解决的问题：提供另一种用于制造带通滤波器的方法，其大大降低了无限脉冲响应（IIR）或有限脉冲响应（FIR）所需的复杂性，成本，功耗和设计区域）的带通滤波器，通过使用输入信号和输入信号的时移版本之间的差异来克服常规的IIR或FIR滤波器设计技术。解决方案：带通滤波器（BPF）从在数据流序列中表示的输入信号中提取期望的频带。版权所有（C）2005，JPO＆NCIPI

78. 发明公开

KR1020090048588A 디지털필터, 그 합성장치, 및 합성프로그램이 기록된 컴퓨터 판독 가능한 기록매체 失效
标题翻译：程序过滤器，合成装置，综合程序和合成程序记录介质
公开(公告)号：KR1020090048588A
公开(公告)日：2009-05-14
申请号：KR1020097002804
申请日：2007-03-19
申请人： 파나소닉 주식회사
发明人： 나가노고우이치
IPC分类号： H03H17/04 , H03H17/00
CPC分类号： H03H17/04 , H03H17/0223 , H03H2220/04
摘要： 예를 들어 IIR디지털필터에 있어서, 구성요소로서 복수의 승산기 및 복수의 가산기 대신, 다입력 승산가산회로를 사용한다. 이로써, 복수의 승산기 및 복수의 가산기를 사용하지 않으므로, 회로의 소형화를 도모할 수 있음과 더불어, 다입력 승산가산회로는 피드백 처리에 있어서 처리속도를 올리기 위한 파이프라인 처리가 가능한 구성이므로 필터처리의 고속화도 가능하다.

79. 发明授权

KR100378192B1 연산 프로세서를 이용한 디지털 베이스 부스터 失效
标题翻译： 연산프로서서를이용한디지털베이스부스터
公开(公告)号：KR100378192B1
公开(公告)日：2003-03-29
申请号：KR1020010003166
申请日：2001-01-19
申请人： 삼성전자주식회사
发明人： 염왕섭
IPC分类号： H03H17/02
CPC分类号： H03H17/0223 , G06F7/49947 , G06F7/5443 , H03G5/005
摘要： A digital base booster (DBB) for reducing hardware by using an arithmetic processor is provided. Instead of using a conventional IIR filter having a cascade structure including a plurality of partial building blocks, the digital base booster using an arithmetic processor includes first internal data, an inputting portion, a data assigner, an arithmetic portion, and an output data storing device. The first internal data is the output data of the arithmetic portion. The inputting portion includes a plurality of multi-bit registers, thereby storing input data and the first internal data and outputting the stored data in a predetermined signal. The data assigner selects one output data from a plurality of output data of the inputting portion. The arithmetic portion performs an arithmetic operation on the output data of the data assigner and data stored in the arithmetic portion, compensates for and stores a round-off error of the data output by the operation, and outputs the first internal data. The output data storing device stores and outputs data processed in the arithmetic portion.
摘要翻译：提供了一种通过使用算术处理器来减少硬件的数字基础增强器（DBB）。代替使用具有包括多个部分构建块的级联结构的传统IIR滤波器，使用算术处理器的数字基本增强器包括第一内部数据，输入部分，数据分配器，算术部分和输出数据存储设备。第一个内部数据是算术部分的输出数据。输入部分包括多个多位寄存器，从而存储输入数据和第一内部数据，并以预定信号输出存储的数据。数据分配器从输入部分的多个输出数据中选择一个输出数据。算术部分对数据分配器的输出数据和存储在算术部分中的数据执行算术运算，补偿并存储由该操作输出的数据的舍入误差，并输出第一内部数据。输出数据存储装置存储并输出在运算部分中处理的数据。

80. 发明公开

KR1020010014014A 디지털 필터 계수의 동적 범위를 변화시키는 시스템 失效
标题翻译：改变数字滤波器中系数的动态范围的系统
公开(公告)号：KR1020010014014A
公开(公告)日：2001-02-26
申请号：KR1019997012043
申请日：1999-02-15
申请人： 코닌클리케 필립스 엔.브이.
发明人： 위티그카알 , 터키니취진
IPC分类号： H03H17/02
CPC分类号： H03H17/06 , H03H17/0223
摘要： A digital filter includes a plurality of filter cells, each of which includes circuitry to determine a coefficient for the filter cell, to adjust the coefficient in accordance with a gain that is used by each of the plurality of filter cells, and to multiply input data by the adjusted coefficient in order to generate a filter cell output. An adder circuit generates a filter output by adding filter cell outputs from each of the plurality of filter cells, and an inverse gain circuit adjusts the filter output in accordance with an inverse of the gain used to adjust the coefficients of the plurality of filter cells.
摘要翻译：数字滤波器包括多个滤波器单元，每个滤波器单元包括确定滤波单元的系数的电路，根据多个滤波单元中的每一个使用的增益来调整系数，并将输入数据通过调整后的系数来生成滤波器单元输出。加法器电路通过将来自多个滤波器单元中的每一个的滤波器单元输出相加而产生滤波器输出，并且逆增益电路根据用于调整多个滤波单元的系数的增益的倒数来调整滤波器输出。

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