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11. 发明申请

WO98041054A1 TIME SWITCH STAGES AND SWITCHES 审中-公开
标题翻译：时间开关阶段和开关
公开(公告)号：WO98041054A1
公开(公告)日：1998-09-17
申请号：PCT/SE1998/000373
申请日：1998-03-02
IPC分类号： H04Q11/04 , H04Q11/06
CPC分类号： H04Q11/06 , H04Q2213/13056 , H04Q2213/13103 , H04Q2213/13208 , H04Q2213/13213 , H04Q2213/1331
摘要： The invention relates to the preservation of sequence integrity (TSSI) and frame integrity (TSFI) in switching wideband connections through a switch or a switch stage. The speech memory (17) in a switch stage (6.n) in the switch is extended to include storage positions (44.n) that in number correspond to the number of time slots in two frames. These storage positions are arranged into two parts (48, 49) of the same size in the speech memory (17). Furthermore, there is provided a delay control unit (26) in the time switch stage (6.n) for generating delay information based on control information in the control memory (23) of the switch stage (6.n) and a determined part of the counter information from a time slot counter circuit (28). This delay information controls, for each time slot, to/from (depending on if the speech memory (17) is arranged in an outgoing stage or an incoming stage) which one of the first (48) and second part (49) of the speech memory (17) that user data is switched.
摘要翻译：本发明涉及在通过交换机或交换机阶段切换宽带连接时保持序列完整性（TSSI）和帧完整性（TSFI）。开关中的开关级（6.n）中的语音存储器（17）被扩展为包括与两帧中的时隙数相对应的存储位置（44.n）。这些存储位置被布置成在语音存储器（17）中具有相同大小的两个部分（48,49）。此外，在时间切换级（6.n）中设置有用于基于开关级（6.n）的控制存储器（23）中的控制信息产生延迟信息的延迟控制单元（26）和确定部分来自时隙计数器电路（28）的计数器信息。该延迟信息针对每个时隙控制到/从（取决于语音存储器（17）是否被布置在输出级或输入级中），第一（48）和第二部分（49）中的哪一个语音存储器（17），用户数据被切换。

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