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1. 发明授权

US5650952A Circuit arrangement for forming the sum of products 失效
标题翻译：形成产品总和的电路布置
公开(公告)号：US5650952A
公开(公告)日：1997-07-22
申请号：US695951
申请日：1996-08-13
申请人： Alfred Baier , Johannes Schuck , Dirk Weinsziehr
发明人： Alfred Baier , Johannes Schuck , Dirk Weinsziehr
IPC分类号： G06F7/50 , G06F7/509 , G06F7/544 , G06F7/00
CPC分类号： G06F7/5095 , G06F7/5443
摘要： In processors, notably digital signal processors, it is often necessary to form the sum of products of a concatenation of data word pairs, for example for correlation or convolution operations, in which the one data word of each pair can assume only one of the two values +1 or -1. In accordance with the invention, in that case instead of forming a product in a multiplier, the one data word of each pair is applied to an add/subtract device in order to control the function thereof in respect of addition or subtraction; one input of the add/subtract unit then receives the other data words of the data word pairs, and the other input is connected to the output of the accumulator register. Thus, a complex multiplier device is saved or, should such a device be present anyway, it will not be used so that the power loss of the processor is reduced.
摘要翻译：在处理器中，特别是数字信号处理器，通常需要形成数据字对的级联的和，例如用于相关或卷积运算，其中每对的一个数据字只能承担两个中的一个值+1或-1。根据本发明，在这种情况下，代替在乘法器中形成乘积，每对中的一个数据字被应用于加法/减法器件，以便控制加法或减法的功能; 然后，加/减单元的一个输入接收数据字对的其他数据字，另一个输入连接到累加器寄存器的输出。因此，保存复数乘法器装置，或者如果这样的装置出现，则不会使用它，以致减少了处理器的功率损耗。

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