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    • 37. 发明申请
    • Memory micro-tiling request reordering
    • 内存微贴请求重新排序
    • US20060294328A1
    • 2006-12-28
    • US11159741
    • 2005-06-23
    • James AkiyamaWilliam CliffordPaul Brown
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    • G06F13/28
    • G06F13/1626G06F13/1684G09G5/393G09G2360/122G09G2360/125
    • According to one embodiment, a memory controller is disclosed. The memory controller includes assignment logic, a reorder table and a transaction assembler. The assignment logic receives a request to access a memory channel and assigns the request to access one of two or more independently addressable subchannels within the channel. The reorder table includes two or more table elements. Each table element includes a shared address component and an independent address component corresponding to each of the two or more independently addressable subchannels. The transaction assembler combines the shared and independent address components in a reorder table element and issue a single memory transaction.
    • 根据一个实施例,公开了一种存储器控制器。 存储器控制器包括分配逻辑,重排序表和事务汇编器。 分配逻辑接收访问存储器通道的请求,并分配请求以访问通道内的两个或更多个可独立寻址的子信道中的一个。 重排序表包括两个或多个表元素。 每个表格元素包括共享地址组件和对应于两个或更多个可独立寻址的子信道中的每一个的独立地址组件。 事务汇编器将重新排序表元素中的共享和独立地址组件合并并发出单个内存事务。