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1. 发明专利

TWI477961B 應用於序列傳輸系統之晶片及相關的故障處理方法有权
简体标题：应用于串行传输系统之芯片及相关的故障处理方法
公开(公告)号：TWI477961B
公开(公告)日：2015-03-21
申请号：TW101122782
申请日：2012-06-26
申请人：點晶科技股份有限公司 , SILICON TOUCH TECHNOLOGY INC.
发明人：金際遠 , CHIN, CHI YUAN , 陳奎君 , CHEN, KUEI JYUN
IPC分类号： G06F11/16 , G06F13/14
CPC分类号： H04L1/1809 , G01R31/318505 , G01R31/318541 , H04L49/109 , H04L49/15 , H04L49/25 , H04L49/552

2. 发明专利

TWI332154B 廣埠裝置、用於處理訊框之方法及電腦運算系統 WIDE PORT APPARATUS, METHOD FOR PROCESSING FRAME AND COMPUTING SYSTEM 有权
简体标题：广端口设备、用于处理讯框之方法及电脑运算系统 WIDE PORT APPARATUS, METHOD FOR PROCESSING FRAME AND COMPUTING SYSTEM
公开(公告)号：TWI332154B
公开(公告)日：2010-10-21
申请号：TW095123322
申请日：2006-06-28
申请人：英特爾公司
发明人：海勒克威廉 , 張乃其 , 賽多帕克隆格 , 劉維克特
IPC分类号： G06F
CPC分类号： G06F13/385 , H04L49/552
摘要：一種裝置係包含有：一個任務脈絡控制器、連接至該任務脈絡控制器之至少一個傳輸引擎、和連接至該傳輸引擎之至少一個比較器。該比較器將一個來自一個接收訊框之資料偏移與一個當前之資料偏移相比較，以及其結果係用來決定訊框處理次序。
简体摘要：一种设备系包含有：一个任务脉络控制器、连接至该任务脉络控制器之至少一个传输发动机、和连接至该传输发动机之至少一个比较器。该比较器将一个来自一个接收讯框之数据偏移与一个当前之数据偏移相比较，以及其结果系用来决定讯框处理次序。

3. 发明专利

TWI269163B 使用快取技術維持封包次序的方法及系統 METHOD AND SYSTEM FOR MAINTENANCE OF PACKET ORDER USING CACHING 失效
简体标题：使用缓存技术维持封包次序的方法及系统 METHOD AND SYSTEM FOR MAINTENANCE OF PACKET ORDER USING CACHING
公开(公告)号：TWI269163B
公开(公告)日：2006-12-21
申请号：TW093113835
申请日：2004-05-17
申请人：英特爾公司 INTEL CORPORATION
发明人：庫瑪阿洛克 KUMAR, ALOK , 亞法特卡瑞傑 YAVATKAR, RAJ
IPC分类号： G06F
CPC分类号： H04L47/10 , H04L47/34 , H04L49/252 , H04L49/30 , H04L49/552 , H04L2012/565
摘要：本發明揭露使用快取技術來維持封包次序的方法與系統。將在一接收元件上接收為一串封包之部分的封包。將由一個或數個處理模組處理該等封包。一再定序元件隨後將排序該串封包以確保該等封包係依照所接收到的順序傳送出去。當在一再定序元件上接收到一串封包時，該再定序元件將判定是否該已接收封包為該串封包中欲傳送的下一個封包。若是，便傳送該封包。若否，如果該封包適於一區域快取記憶體的話，該再定序元件便將該已接收封包儲存在該區域快取記憶體中。否則，便將該封包儲存在非區域記憶體中。當已儲存封包為該串封包中欲傳送的下一個封包時，將檢索且傳送該已儲存封包。
简体摘要：本发明揭露使用缓存技术来维持封包次序的方法与系统。将在一接收组件上接收为一串封包之部分的封包。将由一个或数个处理模块处理该等封包。一再定序组件随后将排序该串封包以确保该等封包系依照所接收到的顺序发送出去。当在一再定序组件上接收到一串封包时，该再定序组件将判定是否该已接收封包为该串封包中欲发送的下一个封包。若是，便发送该封包。若否，如果该封包适于一区域高速缓存的话，该再定序组件便将该已接收封包存储在该区域高速缓存中。否则，便将该封包存储在非区域内存中。当已存储封包为该串封包中欲发送的下一个封包时，将检索且发送该已存储封包。

4. 发明专利

TW341021B 數位開關中之冗餘結構失效
简体标题：数码开关中之冗余结构
公开(公告)号：TW341021B
公开(公告)日：1998-09-21
申请号：TW085110928
申请日：1996-09-06
申请人： LM艾瑞克生電話公司
发明人：安德瑞斯貝傑尼 , 彼德路德
IPC分类号： H04Q , G06F
CPC分类号： H04L49/552 , H04L49/1523 , H04Q11/04
摘要：一數位開關(102)內的機能實體被分成三份在平行作業的諸平面內。對每一平面而言，有一相關傳遞資料流被散佈到與其平行的各個平面。一多數決定機能(502)接收其本身平面及與其平行之諸平面的資料流，並且在位元層次比較這些資料流以產生一多數決定資料流(majority voted data flow DATAMV)。一平面狀況感測機能(514)指出諸平面(A、B、C)之連結是否有有意義的資訊及同步，並從而發射一連結狀況指示信號(INSYAI-INSYBI-INSYCI)給各平面而形成其指示信號。一優先權選擇機能(506)被連接以接收多數決定資料流(DATAMV)及連結狀況指示信號。若連結狀況指示信號指出一錯誤狀況，則優先權選擇機能讓多數決定資料流(DATAMV)通過做為從該機能實體輸出的資料流(DATAOUT)。若在一個或更多個連結狀況指示信號中指出有錯誤狀況，則優先權選擇機能根據一既定的優先次序從諸平面中選擇一平面之資料流當做輸出資料流(DATAOUT)(圖5)。
简体摘要：一数码开关(102)内的机能实体被分成三份在平行作业的诸平面内。对每一平面而言，有一相关传递数据流被散布到与其平行的各个平面。一多数决定机能(502)接收其本身平面及与其平行之诸平面的数据流，并且在比特层次比较这些数据流以产生一多数决定数据流(majority voted data flow DATAMV)。一平面状况传感机能(514)指出诸平面(A、B、C)之链接是否有有意义的信息及同步，并从而发射一链接状况指示信号(INSYAI-INSYBI-INSYCI)给各平面而形成其指示信号。一优先权选择机能(506)被连接以接收多数决定数据流(DATAMV)及链接状况指示信号。若链接状况指示信号指出一错误状况，则优先权选择机能让多数决定数据流(DATAMV)通过做为从该机能实体输出的数据流(DATAOUT)。若在一个或更多个链接状况指示信号中指出有错误状况，则优先权选择机能根据一既定的优先次序从诸平面中选择一平面之数据流当做输出数据流(DATAOUT)(图5)。

5. 发明专利

TW200712905A 經由串列附接小型電腦系統介面串列SCSI協定廣埠應用程式中之資料偏移比較結果進行的硬體輔助接收通道訊框處置技術 HARDWARE ASSISTED RECEIVE CHANNEL FRAME HANDLING VIA DATA OFFSET COMPARISON IN SAS SSP WIDE PORT APPLICATIONS 审中-公开
简体标题：经由串行附接小型电脑系统界面串行SCSI协定广端口应用进程中之数据偏移比较结果进行的硬件辅助接收信道讯框处置技术 HARDWARE ASSISTED RECEIVE CHANNEL FRAME HANDLING VIA DATA OFFSET COMPARISON IN SAS SSP WIDE PORT APPLICATIONS
公开(公告)号：TW200712905A
公开(公告)日：2007-04-01
申请号：TW095123322
申请日：2006-06-28
申请人：英特爾公司 INTEL CORPORATION
发明人：海勒克威廉 HALLECK, WILLIAM , 張乃其 CHANG, NAICHIH , 賽多帕克-隆格 SETO, PAK-LUNG , 劉維克特 LAU, VICTOR
IPC分类号： G06F
CPC分类号： G06F13/385 , H04L49/552
摘要：一種裝置係包含有:一個任務脈絡控制器、連接至該任務脈絡控制器之至少一個傳輸引擎、和連接至該傳輸引擎之至少一個比較器。該比較器將一個來自一個接收訊框之資料偏移與一個當前之資料偏移相比較,以及其結果係用來決定訊框處理次序。
简体摘要：一种设备系包含有:一个任务脉络控制器、连接至该任务脉络控制器之至少一个传输发动机、和连接至该传输发动机之至少一个比较器。该比较器将一个来自一个接收讯框之数据偏移与一个当前之数据偏移相比较,以及其结果系用来决定讯框处理次序。

6. 发明专利

TW200500858A 使用快取技術維持封包次序的方法及系統 METHOD AND SYSTEM FOR MAINTENANCE OF PACKET ORDER USING CACHING 失效
简体标题：使用缓存技术维持封包次序的方法及系统 METHOD AND SYSTEM FOR MAINTENANCE OF PACKET ORDER USING CACHING
公开(公告)号：TW200500858A
公开(公告)日：2005-01-01
申请号：TW093113835
申请日：2004-05-17
申请人：英特爾公司 INTEL CORPORATION
发明人：庫瑪阿洛克 KUMAR, ALOK , 亞法特卡瑞傑 YAVATKAR, RAJ
IPC分类号： G06F
CPC分类号： H04L47/10 , H04L47/34 , H04L49/252 , H04L49/30 , H04L49/552 , H04L2012/565
摘要：本發明揭露使用快取技術來維持封包次序的方法與系統。將在一接收元件上接收為一串封包之部分的封包。將由一個或數個處理模組處理該等封包。一再定序元件隨後將排序該串封包以確保該等封包係依照所接收到的順序傳送出去。當在一再定序元件上接收到一串封包時，該再定序元件將判定是否該已接收封包為該串封包中欲傳送的下一個封包。若是，便傳送該封包。若否，如果該封包適於一區域快取記憶體的話，該再定序元件便將該已接收封包儲存在該區域快取記憶體中。否則，便將該封包儲存在非區域記憶體中。當已儲存封包為該串封包中欲傳送的下一個封包時，將檢索且傳送該已儲存封包。
简体摘要：本发明揭露使用缓存技术来维持封包次序的方法与系统。将在一接收组件上接收为一串封包之部分的封包。将由一个或数个处理模块处理该等封包。一再定序组件随后将排序该串封包以确保该等封包系依照所接收到的顺序发送出去。当在一再定序组件上接收到一串封包时，该再定序组件将判定是否该已接收封包为该串封包中欲发送的下一个封包。若是，便发送该封包。若否，如果该封包适于一区域高速缓存的话，该再定序组件便将该已接收封包存储在该区域高速缓存中。否则，便将该封包存储在非区域内存中。当已存储封包为该串封包中欲发送的下一个封包时，将检索且发送该已存储封包。

7. 发明专利

TWI221370B 網路交換裝置與網路交換方法(一) NETWORK SWITCHING DEVICE AND NETWORK SWITCHING METHOD 有权
简体标题：网络交换设备与网络交换方法(一) NETWORK SWITCHING DEVICE AND NETWORK SWITCHING METHOD
公开(公告)号：TWI221370B
公开(公告)日：2004-09-21
申请号：TW092102031
申请日：2003-01-29
申请人：富士通股份有限公司 FUJITSU LIMITED
发明人：片山徹 TAUL KATAYAMA
IPC分类号： H04L
CPC分类号： H04L49/9042 , H04L47/50 , H04L49/103 , H04L49/508 , H04L49/552 , H04L49/90 , H04L49/9021
摘要：本發明之目的在於提供一種可提高儲存可變長度封包之緩衝器之使用效率，同時可防止阻塞之產生之網路交換裝置。己接收之封包係藉封包分割電路(2)分割成1個以上之固定長度之資料區塊且供給於緩衝器(1)。藉緩衝器控制電路(3)之控制，於封包之轉送目的地之各網路形成可登錄一定數量之資料區塊之發送佇列(4-1~n,n為1以上之整數)，而業經寫入緩衝器(1)之資料區塊係以封包單位依序登錄於對應於位址之發送佇列。此時，各封包內之資料區塊間之連結與各發送佇列內之封包間之連結則作為根據各資料區塊之緩衝器中之寫入位置之連結串列構造來管理。
简体摘要：本发明之目的在于提供一种可提高存储可变长度封包之缓冲器之使用效率，同时可防止阻塞之产生之网络交换设备。己接收之封包系藉封包分割电路(2)分割成1个以上之固定长度之数据区块且供给于缓冲器(1)。藉缓冲器控制电路(3)之控制，于封包之转送目的地之各网络形成可登录一定数量之数据区块之发送队列(4-1~n,n为1以上之整数)，而业经写入缓冲器(1)之数据区块系以封包单位依序登录于对应于位址之发送队列。此时，各封包内之数据区块间之链接与各发送队列内之封包间之链接则作为根据各数据区块之缓冲器中之写入位置之链表构造来管理。

8. 发明专利

TW522682B 交換結構有权
简体标题：交换结构
公开(公告)号：TW522682B
公开(公告)日：2003-03-01
申请号：TW090107659
申请日：2001-03-30
申请人：英特爾公司
发明人：勞伯 M 葛洛 , 法吉爾 I 歐斯曼 , 維泰克扎巴 , 勞伯 J 培色
IPC分类号： H04L
CPC分类号： H04L49/1576 , H04L49/101 , H04L49/106 , H04L49/3045 , H04L49/552 , H04L49/608 , H04L2012/5679 , H04L2012/568
摘要：揭示一用以傳送數位資料自複數個來源地至複數個目的地之交換結構。該交換結構包含複數個輸入埠、複數個輸出埠及複數個交換區段。每個輸入埠接收資料框並分割所接收之資料負載中至少某些該框成為複數個相關資料單元。每個輸出埠係耦合至至少一與該資料框表頭相關之目的地。每個交換區段可耦合至每個輸入埠及每個輸出埠，以傳送每個所選之資料單元自該至少一輸入埠至一或更多該耦合之輸出埠。
简体摘要：揭示一用以发送数码数据自复数个来源地至复数个目的地之交换结构。该交换结构包含复数个输入端口、复数个输出端口及复数个交换区段。每个输入端口接收数据框并分割所接收之数据负载中至少某些该框成为复数个相关数据单元。每个输出端口系耦合至至少一与该数据框表头相关之目的地。每个交换区段可耦合至每个输入端口及每个输出端口，以发送每个所选之数据单元自该至少一输入端口至一或更多该耦合之输出端口。

9. 发明专利

TW201401043A 應用於序列傳輸系統之晶片及相關的故障處理方法审中-公开
简体标题：应用于串行传输系统之芯片及相关的故障处理方法
公开(公告)号：TW201401043A
公开(公告)日：2014-01-01
申请号：TW101122782
申请日：2012-06-26
申请人：點晶科技股份有限公司 , SILICON TOUCH TECHNOLOGY INC.
发明人：金際遠 , CHIN, CHI YUAN , 陳奎君 , CHEN, KUEI JYUN
IPC分类号： G06F11/16 , G06F13/14
CPC分类号： H04L1/1809 , G01R31/318505 , G01R31/318541 , H04L49/109 , H04L49/15 , H04L49/25 , H04L49/552
摘要：一種應用於一序列傳輸系統之晶片包含有一輸入端點、一核心電路、一輸出端點、一第一傳輸線路、一第二傳輸線路以及一備用傳輸線路，其中該輸入端點用來接收來自該晶片外的一輸入訊號，該輸出端點用來輸出一輸出訊號，該第一傳輸線路耦接於該輸入端點與該核心電路之間，該第二傳輸線路耦接於該核心電路與該輸出端點之間，以及該備用傳輸線路耦接於該輸入端點與該輸出端點之間；當該核心電路無法正常處理該輸入訊號時，該輸入訊號會直接經由該備用傳輸線路傳送至該輸出端點，以作為該輸出訊號並由該輸出端點輸出。
简体摘要：一种应用于一串行传输系统之芯片包含有一输入端点、一内核电路、一输出端点、一第一传输线路、一第二传输线路以及一备用传输线路，其中该输入端点用来接收来自该芯片外的一输入信号，该输出端点用来输出一输出信号，该第一传输线路耦接于该输入端点与该内核电路之间，该第二传输线路耦接于该内核电路与该输出端点之间，以及该备用传输线路耦接于该输入端点与该输出端点之间；当该内核电路无法正常处理该输入信号时，该输入信号会直接经由该备用传输线路发送至该输出端点，以作为该输出信号并由该输出端点输出。

10. 发明专利

TW200644540A 在網路中實行區域中心授權服務所用之系統及方法 SYSTEM AND METHOD FOR PERFORMING LOCAL CENTER AUTHORIZATION SERVICE IN A NETWORK 失效
简体标题：在网络中实行区域中心授权服务所用之系统及方法 SYSTEM AND METHOD FOR PERFORMING LOCAL CENTER AUTHORIZATION SERVICE IN A NETWORK
公开(公告)号：TW200644540A
公开(公告)日：2006-12-16
申请号：TW095102426
申请日：2006-01-23
申请人：拉薩微電子股份有限公司 RAZA MICROELECTRONICS, INC.
发明人：保羅納維士 PAOLO NARVAEZ , 姆拉特保庫 MURAT BOG
IPC分类号： H04L , G06F , H04J
CPC分类号： H04L49/552 , H04J3/062 , H04J3/12 , H04J3/1611 , H04J3/1617 , H04J2203/0069 , H04J2203/0085 , H04J2203/0094 , H04L12/54 , H04L49/351
摘要：一種於網路系統中執行區域中心授權服務(LCAS)之系統及方法，該系統具有一資料排列器，其係設置用於依據成員群組，排列輸入資料位元組。該系統亦包括一LCAS控制管理器，其係設置用於回應來自資料排列器之輸入資料，產生解排序控制指命。該系統進一步包括一解排序器，其係設置用於依據解排序控制指令，解排序來自資料列器之輸入資料，而該排序控制指令係由LCAS控制管理器接收。
简体摘要：一种于网络系统中运行区域中心授权服务(LCAS)之系统及方法，该系统具有一数据排列器，其系设置用于依据成员群组，排列输入数据字节。该系统亦包括一LCAS控制管理器，其系设置用于回应来自数据排列器之输入数据，产生解排序控制指命。该系统进一步包括一解排序器，其系设置用于依据解排序控制指令，解排序来自数据列器之输入数据，而该排序控制指令系由LCAS控制管理器接收。

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