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1. 发明专利

TW200925897A 並矢分數與符號對稱進位誤差的乘積之快速計算 FAST COMPUTATION OF PRODUCTS BY DYADIC FRACTIONS WITH SIGN-SYMMETRIC ROUNDING ERRORS 审中-公开
简体标题：并矢分数与符号对称进制误差的乘积之快速计算 FAST COMPUTATION OF PRODUCTS BY DYADIC FRACTIONS WITH SIGN-SYMMETRIC ROUNDING ERRORS
公开(公告)号：TW200925897A
公开(公告)日：2009-06-16
申请号：TW097132919
申请日：2008-08-28
申请人：高通公司 QUALCOMM INCORPORATED
发明人：優里瑞尼克 REZNIK, YURIY
IPC分类号： G06F
CPC分类号： G06F7/483 , G06F7/49942 , G06F7/533 , G06F17/147 , H04N19/42 , H04N19/60
摘要：一整數値與一無理値之一乘積可藉由一符號對稱演算法來確定。一過程可確定最小化諸如平均不對稱、平均誤差、誤差方差及誤差量値之度量的可能演算法。給定一整數變數x及近似於無理分數之有理並矢常數,可產生符號對稱之一系列中間値。該等中間値可包括加法、減法及右移運算之一序列,當共同求和時,求該整數値與該無理値之該乘積的近似値。可移除諸如0之加法或減法或0個位元之移位的其他運算。
简体摘要：一整数値与一无理値之一乘积可借由一符号对称算法来确定。一过程可确定最小化诸如平均不对称、平均误差、误差方差及误差量値之度量的可能算法。给定一整数变量x及近似于无理分数之有理并矢常数,可产生符号对称之一系列中间値。该等中间値可包括加法、减法及右移运算之一串行,当共同求和时,求该整数値与该无理値之该乘积的近似値。可移除诸如0之加法或减法或0个比特之移位的其他运算。

2. 发明专利

TWI474194B 並矢分數與符號對稱進位誤差的乘積之快速計算有权
简体标题：并矢分数与符号对称进制误差的乘积之快速计算
公开(公告)号：TWI474194B
公开(公告)日：2015-02-21
申请号：TW097132919
申请日：2008-08-28
申请人：高通公司 , QUALCOMM INCORPORATED
发明人：優里瑞尼克 , REZNIK, YURIY
IPC分类号： G06F17/14
CPC分类号： G06F7/483 , G06F7/49942 , G06F7/533 , G06F17/147 , H04N19/42 , H04N19/60

3. 发明专利

TW401557B 邏輯電路之自動設計方法、系統及其裝置以及其乘法器失效
简体标题：逻辑电路之自动设计方法、系统及其设备以及其乘法器
公开(公告)号：TW401557B
公开(公告)日：2000-08-11
申请号：TW083107256
申请日：1994-08-09
申请人：松下電器產業股份有限公司
发明人：西山保 , 津幡真太郎
IPC分类号： G06F
CPC分类号： G06F7/53 , G06F7/4824 , G06F7/52 , G06F7/533 , G06F17/5045
摘要：本發明係一種邏輯電路之自動設計方法、系統及其裝置以及其乘法器，其主要針對乘數之各位元判斷乘數係變數或是常數，當乘數為常數時，則判斷乘數之該位元的值是否為l，而產生一只有當乘數之該位元的值為l時，會將表示被乘數之信號當作部分積加以輸出之電路，而將表示被乘數之信號移位l個位元，而將之重新設定為表示被乘數之信號。針對乘數之所有的位元，藉反覆執行以上之處理，而產生可求取與乘數之各位元對應之部分積的電路。
简体摘要：本发明系一种逻辑电路之自动设计方法、系统及其设备以及其乘法器，其主要针对乘数之各比特判断乘数系变量或是常数，当乘数为常数时，则判断乘数之该比特的值是否为l，而产生一只有当乘数之该比特的值为l时，会将表示被乘数之信号当作部分积加以输出之电路，而将表示被乘数之信号移位l个比特，而将之重新设置为表示被乘数之信号。针对乘数之所有的比特，藉反复运行以上之处理，而产生可求取与乘数之各比特对应之部分积的电路。

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