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3. 发明专利

TW201203103A 運算元大小控制 OPERAND SIZE CONTROL 审中-公开
简体标题：算子大小控制 OPERAND SIZE CONTROL
公开(公告)号：TW201203103A
公开(公告)日：2012-01-16
申请号：TW100107186
申请日：2011-03-03
申请人： ARM股份有限公司
发明人：格利森斯威特理察羅伊 , 西爾大衛詹姆斯 , 羅福琳菲利比珍皮耶 , 史密斯李道格拉斯
IPC分类号： G06F
CPC分类号： G06F9/3016 , G06F9/3001 , G06F9/30112 , G06F9/3861 , G06F21/577 , G06F21/70 , G06F2221/2145
摘要：一種資料處理系統2係具有處理電路8、10、12以及一排64位元暫存器6。一指令解碼器14將指定待在儲存於64位元暫存器6內的運算元上施行之算術運算及邏輯運算的算術指令及邏輯指令解碼。指令解碼器14係回應於算術指令及邏輯指令內之一運算元大小欄位SF，其指定該等運算元是否係64位元運算元或32位元運算元。各64位元暫存器儲存單一64位元運算元或單一32位元運算元。對於一給定算術指令及邏輯指令，所有運算元皆64位元運算元或所有運算元皆32位元運算元。可支援配置在一例外位準階層中之複數個例外位準。若完成一至一較低例外位準之切換，則完成一正使用暫存器是否係先前經受一64位元寫入該暫存器之檢查。若此64位元寫入在先前已發生至該暫存器，則上面32位元被清除以避免資料自較高例外位準洩漏。
简体摘要：一种数据处理系统2系具有处理电路8、10、12以及一排64比特寄存器6。一指令译码器14将指定待在存储于64比特寄存器6内的算子上施行之算术运算及逻辑运算的算术指令及逻辑指令译码。指令译码器14系回应于算术指令及逻辑指令内之一算子大小字段SF，其指定该等算子是否系64比特算子或32比特算子。各64比特寄存器存储单一64比特算子或单一32比特算子。对于一给定算术指令及逻辑指令，所有算子皆64比特算子或所有算子皆32比特算子。可支持配置在一例外位准阶层中之复数个例外位准。若完成一至一较低例外位准之切换，则完成一正使用寄存器是否系先前经受一64比特写入该寄存器之检查。若此64比特写入在先前已发生至该寄存器，则上面32比特被清除以避免数据自较高例外位准泄漏。

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