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1. 发明专利

TW201335845A 用於迴圈餘數遮罩指令之系統、裝置及方法审中-公开
简体标题：用于循环余数遮罩指令之系统、设备及方法
公开(公告)号：TW201335845A
公开(公告)日：2013-09-01
申请号：TW101142638
申请日：2012-11-15
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：歐德亞麥德維爾艾蒙斯特阿法 , OULD-AHMED-VALL, ELMOUSTAPHA , 瓦倫泰羅柏 , VALENTINE, ROBERT , 柯柏吉瑟斯 , CORBAL, JESUS , 納勒金安得烈 , NARAIKIN, ANDREY , 賽爾蘇利曼 , SAIR, SULEYMAN , 哈吉爾阿薩夫 , HARGIL, ASAF , 吉卡密林德 , GIRKAR, MILIND B. , 托爾布萊特 , TOLL, BRET , 查尼馬克 , CHARNEY, MARK J.
IPC分类号： G06F9/32 , G06F9/38
CPC分类号： G06F9/3887 , G06F8/4441 , G06F9/30018 , G06F9/30036 , G06F9/30065 , G06F9/30072 , G06F9/3013 , G06F9/325 , G06F9/3818 , G06F9/3824
摘要：迴圈餘數遮罩指令指示迴圈之目前迭代計數作為第一運算元、迴圈限制作為第二運算元以及一目的(destination)。迴圈包含複數迭代，以及每一迭代包含陣列之資料元件。處理器接收迴圈餘數遮罩指令指示、解碼指令以執行以及儲存執行結果於目的中。前述結果指示通過陣列之前部之尾端(其待與該前部分別處理)之該陣列的資料元件數，前部之尾端為目前迭代計數所記錄處。
简体摘要：循环余数遮罩指令指示循环之目前迭代计数作为第一算子、循环限制作为第二算子以及一目的(destination)。循环包含复数迭代，以及每一迭代包含数组之数据组件。处理器接收循环余数遮罩指令指示、译码指令以运行以及存储运行结果于目的中。前述结果指示通过数组之前部之尾端(其待与该前部分别处理)之该数组的数据组件数，前部之尾端为目前迭代计数所记录处。

3. 发明专利

TWI514166B 拆裝多通道中封裝資料有权
简体标题：拆装多信道中封装数据
公开(公告)号：TWI514166B
公开(公告)日：2015-12-21
申请号：TW103117307
申请日：2010-06-18
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：哈吉爾阿薩夫 , HARGIL, ASAF , 歐倫斯坦多朗 , ORENSTEIN, DORON
IPC分类号： G06F15/80 , G06F9/30
CPC分类号： G06F9/30145 , G06F9/30032 , G06F9/30036

4. 发明专利

TWI470545B 用以執行範圍檢測之設備，處理器，系統，方法，指令，及邏輯有权
简体标题：用以运行范围检测之设备，处理器，系统，方法，指令，及逻辑
公开(公告)号：TWI470545B
公开(公告)日：2015-01-21
申请号：TW098136966
申请日：2009-10-30
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：哈吉爾阿薩夫 , HARGIL, ASAF , 費克斯曼艾弗詹尼 , FIKSMAN, EVGENY , 麥斯科維斯基亞堤恩 , MYASKOUVSKEY, ARTIOM , 歐倫斯坦多朗 , ORENSTEIN, DORON
IPC分类号： G06F9/305 , G06F9/30
CPC分类号： G06F17/17 , G06F9/30003

5. 发明专利

TW201447606A 拆裝多通道中封裝資料审中-公开
简体标题：拆装多信道中封装数据
公开(公告)号：TW201447606A
公开(公告)日：2014-12-16
申请号：TW103117307
申请日：2010-06-18
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：哈吉爾阿薩夫 , HARGIL, ASAF , 歐倫斯坦多朗 , ORENSTEIN, DORON
IPC分类号： G06F15/80 , G06F9/30
CPC分类号： G06F9/30145 , G06F9/30032 , G06F9/30036
摘要：接收指示第一及第二運算元的指令。該等運算元各者具有對應於個別位置之複數個封裝資料元件。該第一運算元之該等資料元件的第一子集及該第二運算元之該等資料元件的第一子集各者對應於第一通道。該第一運算元之該等資料元件的第二子集及該第二運算元之該等資料元件的第二子集各者對應於第二通道。儲存結果，以回應指令，該結果：(1)在該第一通道中，僅包括與對應之來自該第二運算元的第一子集之最低階資料元件交錯的來自該第一運算元之該第一子集的最低階資料元件；(2)在該第二通道中，僅包括與對應之來自該第二運算元的第二子集之最高階資料元件交錯的來自該第一運算元之該第二子集的最高階資料元件。
简体摘要：接收指示第一及第二算子的指令。该等算子各者具有对应于个别位置之复数个封装数据组件。该第一算子之该等数据组件的第一子集及该第二算子之该等数据组件的第一子集各者对应于第一信道。该第一算子之该等数据组件的第二子集及该第二算子之该等数据组件的第二子集各者对应于第二信道。存储结果，以回应指令，该结果：(1)在该第一信道中，仅包括与对应之来自该第二算子的第一子集之最低级数据组件交错的来自该第一算子之该第一子集的最低级数据组件；(2)在该第二信道中，仅包括与对应之来自该第二算子的第二子集之最高级数据组件交错的来自该第一算子之该第二子集的最高级数据组件。

6. 发明专利

TWI443525B 拆裝多通道中封裝資料失效
简体标题：拆装多信道中封装数据
公开(公告)号：TWI443525B
公开(公告)日：2014-07-01
申请号：TW099119943
申请日：2010-06-18
申请人：英特爾股份有限公司 , INTEL CORPORATION
发明人：哈吉爾阿薩夫 , HARGIL, ASAF , 歐倫斯坦多朗 , ORENSTEIN, DORON
IPC分类号： G06F15/80
CPC分类号： G06F9/30145 , G06F9/30032 , G06F9/30036

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