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1. 发明专利

TW201344435A 用於在階層式快取設計之快取記憶體間有效通訊的方法及設備失效
简体标题：用于在阶层式缓存设计之高速缓存间有效通信的方法及设备
公开(公告)号：TW201344435A
公开(公告)日：2013-11-01
申请号：TW101149054
申请日：2012-12-21
申请人：英特爾公司 , INTEL CORPORATION
发明人：夏利夫羅恩 , SHALEV, RON , 吉拉德伊弗泰奇 , GILAD, YIFTACH , 賴金斯洛摩 , RAIKIN, SHLOMO , 葉諾芙伊格爾 , YANOVER, IGOR , 席瓦斯曼史坦斯拉弗 , SHWARTSMAN, STANISLAV , 薩迪拉恩南 , SADE, RAANAN
IPC分类号： G06F12/08 , G06F13/16
CPC分类号： G06F12/0811 , G06F12/08 , G06F12/0844 , G06F12/0897 , G06F13/14 , G06F13/38
摘要：依據於本文中所揭露的數個實施例，係提供有方法、系統、機構、技術和設備，用以實施在階層式快取設計中之快取記憶體之間的有效通訊。例如，在一個實施例中，這樣的構件可包括一個積體電路，其具有一個資料匯流排；與此資料匯流排做可通訊式介接的一個較低階快取記憶體；與此資料匯流排做可通訊式介接的一個較高階快取記憶體；一或多個資料緩衝器和一或多個無資料緩衝器。在這樣一個實施例中的資料緩衝器與資料匯流排作可通訊式介接，並且這一或多個資料緩衝器各具有用來緩衝一個滿填快取列的一個緩衝器記憶體、用來指出各別資料緩衝器之狀態的一或多個控制位元、和與此滿填快取列相關聯的一個位址。在這樣一個實施例中的這些無資料緩衝器無法儲存滿填快取列，且係具有用來指出各別無資料緩衝器之狀態的一或多個控制位元及針對與各別的這個無資料緩衝器相關聯的一個快取記憶體間傳輸列的一個位址。在這樣一個實施例中，快取記憶體間傳輸邏輯會經由資料匯流排而從較高階快取記憶體請求此快取記憶體間傳輸列，並會進一步將此快取記憶體間傳輸列從資料匯流排寫入到較低階快取記憶體中。
简体摘要：依据于本文中所揭露的数个实施例，系提供有方法、系统、机构、技术和设备，用以实施在阶层式缓存设计中之高速缓存之间的有效通信。例如，在一个实施例中，这样的构件可包括一个集成电路，其具有一个数据总线；与此数据总线做可通信式介接的一个较低级高速缓存；与此数据总线做可通信式介接的一个较高级高速缓存；一或多个数据缓冲器和一或多个无数据缓冲器。在这样一个实施例中的数据缓冲器与数据总线作可通信式介接，并且这一或多个数据缓冲器各具有用来缓冲一个满填缓存列的一个缓冲器内存、用来指出各别数据缓冲器之状态的一或多个控制比特、和与此满填缓存列相关联的一个位址。在这样一个实施例中的这些无数据缓冲器无法存储满填缓存列，且系具有用来指出各别无数据缓冲器之状态的一或多个控制比特及针对与各别的这个无数据缓冲器相关联的一个高速缓存间传输列的一个位址。在这样一个实施例中，高速缓存间传输逻辑会经由数据总线而从较高级高速缓存请求此高速缓存间传输列，并会进一步将此高速缓存间传输列从数据总线写入到较低级高速缓存中。

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