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    • 8. 发明专利
    • 記憶體控制器以及優化記憶體控制器之接合墊序列的方法 MEMORY CONTROLLERS AND METHOD FOR OPTIMIZING THE PAD SEQUENCE OF THE MEMORY CONTROLLER
    • 内存控制器以及优化内存控制器之接合垫串行的方法 MEMORY CONTROLLERS AND METHOD FOR OPTIMIZING THE PAD SEQUENCE OF THE MEMORY CONTROLLER
    • TWI359421B
    • 2012-03-01
    • TW096148612
    • 2007-12-19
    • 聯發科技股份有限公司
    • 陳南誠郭志輝曾瑞興李錦智陳珮珊
    • G11C
    • G06F13/1694
    • 一種優化記憶體控制器之接合墊序列的方法。提供至少兩個優選且不同之接合墊序列,分別對應至至少兩個不同之記憶體裝置。將記憶體控制器設置於單晶片上。記憶體控制器包含核心邏輯電路、複數個輸入/輸出元件及重排器。核心邏輯電路具有複數個輸入/輸出端。每一輸入/輸出元件具有一接合墊。重排器耦接這些輸入/輸出元件與核心邏輯電路。重排器被程式化,以選擇性地連接這些輸入/輸出元件至這些輸入/輸出端。程式化重排器,以選擇並連接這些輸入/輸出元件之一部份連接這些輸入/輸出端,以使這些不同接合墊序列其中之一被大致上支援。
    • 一种优化内存控制器之接合垫串行的方法。提供至少两个优选且不同之接合垫串行,分别对应至至少两个不同之内存设备。将内存控制器设置於单芯片上。内存控制器包含内核逻辑电路、复数个输入/输出组件及重排器。内核逻辑电路具有复数个输入/输出端。每一输入/输出组件具有一接合垫。重排器耦接这些输入/输出组件与内核逻辑电路。重排器被进程化,以选择性地连接这些输入/输出组件至这些输入/输出端。进程化重排器,以选择并连接这些输入/输出组件之一部份连接这些输入/输出端,以使这些不同接合垫串行其中之一被大致上支持。