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热词
    • 13. 发明专利
    • 電壓產生電路
    • 电压产生电路
    • TW201614405A
    • 2016-04-16
    • TW103134588
    • 2014-10-03
    • 円星科技股份有限公司M31 TECHNOLOGY CORPORATION
    • 范宏政FAN, HUNG-CHENG
    • G05F1/10
    • G05F1/56
    • 本發明係揭露一種電壓產生電路,其係包含:(1)一驅動單元,具有一輸入端及一輸出端,其中該輸入端可以接收一輸入訊號,當該輸入訊號為一第一邏輯準位時,一第一電壓端對該輸出端充電,並且當該輸入訊號為一第二邏輯準位時,該輸出端對一第二電壓端放電;(2)一第一開關,根據該輸入訊號耦接該第二電壓端至一補償電容端;(3)一補償電容,耦接於該補償電容端與一第三電壓端之間;以及(4)一第二開關,根據該輸入訊號耦接該補償電容端至一第四電壓端。
    • 本发明系揭露一种电压产生电路,其系包含:(1)一驱动单元,具有一输入端及一输出端,其中该输入端可以接收一输入信号,当该输入信号为一第一逻辑准位时,一第一电压端对该输出端充电,并且当该输入信号为一第二逻辑准位时,该输出端对一第二电压端放电;(2)一第一开关,根据该输入信号耦接该第二电压端至一补偿电容端;(3)一补偿电容,耦接于该补偿电容端与一第三电压端之间;以及(4)一第二开关,根据该输入信号耦接该补偿电容端至一第四电压端。
    • 14. 发明专利
    • 時脈產生電路及時脈產生方法
    • 时脉产生电路及时脉产生方法
    • TW202005282A
    • 2020-01-16
    • TW107119377
    • 2018-06-05
    • 円星科技股份有限公司M31 TECHNOLOGY CORPORATION
    • 吳旻庭WU, MING-TING
    • H03L7/14H03L7/085
    • 一種時脈產生電路包含一電荷幫浦單元、一低通濾波單元、一電壓至電流轉換單元及一電流控制時脈產生器,可應用於鎖相迴路、鎖頻迴路、時脈資料回復電路或延遲鎖定迴路。該電荷幫浦單元產生一第一幫浦電流。該低通濾波單元產生一第一控制電壓且提供一第一電阻值。該電壓至電流轉換單元產生一控制電流且提供一第二電阻值。該電流控制時脈產生器產生一輸出時脈信號。藉由該第一幫浦電流與該控制電流的大小的比值,及該第二電阻值對該第一電阻值的比值保持常數,使得該時脈產生電路的迴路頻寬能夠不受製程、溫度及電壓的影響保持固定。
    • 一种时脉产生电路包含一电荷帮浦单元、一低通滤波单元、一电压至电流转换单元及一电流控制时脉产生器,可应用于锁相回路、锁频回路、时脉数据回复电路或延迟锁定回路。该电荷帮浦单元产生一第一帮浦电流。该低通滤波单元产生一第一控制电压且提供一第一电阻值。该电压至电流转换单元产生一控制电流且提供一第二电阻值。该电流控制时脉产生器产生一输出时脉信号。借由该第一帮浦电流与该控制电流的大小的比值,及该第二电阻值对该第一电阻值的比值保持常数,使得该时脉产生电路的回路带宽能够不受制程、温度及电压的影响保持固定。
    • 17. 发明专利
    • 實體層單元中之兼容C-Phy及/或D-Phy標準的重複IO結構
    • 实体层单元中之兼容C-Phy及/或D-Phy标准的重复IO结构
    • TW201832088A
    • 2018-09-01
    • TW106128182
    • 2017-08-18
    • 円星科技股份有限公司M31 TECHNOLOGY CORPORATION
    • 王懷德WANG, HUAI-TE洪誌謙HUNG, CHIH CHIEN
    • G06F13/14G06F13/36
    • 本發明揭露一種用於實體層單元中的電路,該電路包括兩個三線組(trio)與該兩個三線組之間的一共通線,其中每個三線組包括三條線以傳輸數據,而該共通線可配置為信號線以傳輸數據,或是配置為屏蔽線以減少兩個三線組間之干擾。 此外,一個四IO區塊(Quad-IO block)可被設計為用於支援D-PHY之兩個通道或是C-PHY之一個三線組以傳輸數據,其中該四IO區塊具有一共通線,其可被配置為D-PHY之一信號線以傳輸數據或是C-PHY之一屏蔽線以減少兩個三線組間之干擾。多個相同的四IO區塊之多個晶片墊片可以沿同一方向佈置,以防止D-PHY通道或C-PHY三線組之間的性能差異。
    • 本发明揭露一种用于实体层单元中的电路,该电路包括两个三线组(trio)与该两个三线组之间的一共通线,其中每个三线组包括三条线以传输数据,而该共通线可配置为信号线以传输数据,或是配置为屏蔽线以减少两个三线组间之干扰。 此外,一个四IO区块(Quad-IO block)可被设计为用于支持D-PHY之两个信道或是C-PHY之一个三线组以传输数据,其中该四IO区块具有一共通线,其可被配置为D-PHY之一信号线以传输数据或是C-PHY之一屏蔽线以减少两个三线组间之干扰。多个相同的四IO区块之多个芯片垫片可以沿同一方向布置,以防止D-PHY信道或C-PHY三线组之间的性能差异。