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1. 发明专利

TWI267251B 分數除頻電路及使用前述電路之資料傳送裝置失效
简体标题：分数除频电路及使用前述电路之数据发送设备
公开(公告)号：TWI267251B
公开(公告)日：2006-11-21
申请号：TW094103972
申请日：2005-02-05
申请人： NEC電子股份有限公司 NEC ELECTRONICS CORPORATION
发明人：佐伯貴範 TAKANORI SAEKI
IPC分类号： H03L , H03K
CPC分类号： H03K23/546 , H03L7/1974
摘要：〔課題〕提供：電路規模為較小來輸出工作週期比50%的時脈之分數除頻電路；及包含該除頻電路之資料傳送裝置。〔解決手段〕分數除頻電路為包括：整數除頻電路，以複數個主副正反器來構成，並將時脈信號以除頻比1/N(N為整數)來除頻；及邏輯電路，輸入從前述主副正反器之主段以及副段所輸出之複數個信號，而輸出已將前述時脈信號以除頻比2/N予以除頻之工作週期比50%的信號。資料傳送裝置係由：PLL所輸出之倍增時脈；及已以分數除頻電路將倍增時脈予以除頻之時脈以可切換於每一頻道所構成。
简体摘要：〔课题〕提供：电路规模为较小来输出工作周期比50%的时脉之分数除频电路；及包含该除频电路之数据发送设备。〔解决手段〕分数除频电路为包括：整数除频电路，以复数个主副正反器来构成，并将时脉信号以除频比1/N(N为整数)来除频；及逻辑电路，输入从前述主副正反器之主段以及副段所输出之复数个信号，而输出已将前述时脉信号以除频比2/N予以除频之工作周期比50%的信号。数据发送设备系由：PLL所输出之倍增时脉；及已以分数除频电路将倍增时脉予以除频之时脉以可切换于每一频道所构成。

2. 发明专利

TWI229501B 除頻器及除頻器設計之方法 FREQUENCY DIVIDER AND RELATED FREQUENCY DIVIDER DESIGNING METHOD 有权
简体标题：除频器及除频器设计之方法 FREQUENCY DIVIDER AND RELATED FREQUENCY DIVIDER DESIGNING METHOD
公开(公告)号：TWI229501B
公开(公告)日：2005-03-11
申请号：TW092128754
申请日：2003-10-16
申请人：威盛電子股份有限公司 VIA TECHNOLOGIES INC.,
发明人：陳柏俊 CHEN, PO CHUN
IPC分类号： H03K
CPC分类号： H03K23/68 , H03K23/546
摘要：本發明提供一種除頻器及除頻器設計之方法，將一原始脈波以一n.5倍除頻來形成一目標脈波，首先界定一除頻倍率為n.5*2，接著根據該除頻倍率，產生對應該原始脈波之一第一觸發相位與一第二觸發相位，然後分別選擇一正除頻電路或一負除頻電路方式，並決定複數個脈波產生器之初始值設定方式，以分別產生下第一目標脈波與第二目標脈波，最後根據第一目標脈波與第二目標脈波，產生目標脈波。
简体摘要：本发明提供一种除频器及除频器设计之方法，将一原始脉波以一n.5倍除频来形成一目标脉波，首先界定一除频倍率为n.5*2，接着根据该除频倍率，产生对应该原始脉波之一第一触发相位与一第二触发相位，然后分别选择一正除频电路或一负除频电路方式，并决定复数个脉波产生器之初始值设置方式，以分别产生下第一目标脉波与第二目标脉波，最后根据第一目标脉波与第二目标脉波，产生目标脉波。

3. 发明专利

TW200605511A 分數除頻電路及使用前述電路之資料傳送裝置失效
简体标题：分数除频电路及使用前述电路之数据发送设备
公开(公告)号：TW200605511A
公开(公告)日：2006-02-01
申请号：TW094103972
申请日：2005-02-05
申请人： NEC電子股份有限公司 NEC ELECTRONICS CORPORATION
发明人：佐伯貴範 TAKANORI SAEKI
IPC分类号： H03L , H03K
CPC分类号： H03K23/546 , H03L7/1974
摘要：〔課題〕提供：電路規模為較小來輸出工作週期比50％的時脈之分數除頻電路；及包含該除頻電路之資料傳送裝置。〔解決手段〕分數除頻電路為包括：整數除頻電路，以複數個主副正反器來構成，並將時脈信號以除頻比1／N(N為整數)來除頻；及邏輯電路，輸入從前述主副正反器之主段以及副段所輸出之複數個信號，而輸出已將前述時脈信號以除頻比2／N予以除頻之工作週期比50％的信號。資料傳送裝置係由：PLL所輸出之倍增時脈；及已以分數除頻電路將倍增時脈予以除頻之時脈以可切換於每一頻道所構成。
简体摘要：〔课题〕提供：电路规模为较小来输出工作周期比50％的时脉之分数除频电路；及包含该除频电路之数据发送设备。〔解决手段〕分数除频电路为包括：整数除频电路，以复数个主副正反器来构成，并将时脉信号以除频比1／N(N为整数)来除频；及逻辑电路，输入从前述主副正反器之主段以及副段所输出之复数个信号，而输出已将前述时脉信号以除频比2／N予以除频之工作周期比50％的信号。数据发送设备系由：PLL所输出之倍增时脉；及已以分数除频电路将倍增时脉予以除频之时脉以可切换于每一频道所构成。

4. 发明专利

TW200515705A 除頻器及除頻器設計之方法 FREQUENCY DIVIDER AND RELATED FREQUENCY DIVIDER DESIGNING METHOD 审中-公开
简体标题：除频器及除频器设计之方法 FREQUENCY DIVIDER AND RELATED FREQUENCY DIVIDER DESIGNING METHOD
公开(公告)号：TW200515705A
公开(公告)日：2005-05-01
申请号：TW092128754
申请日：2003-10-16
申请人：威盛電子股份有限公司 VIA TECHNOLOGIES INC.,
发明人：陳柏俊 CHEN, PO-CHUN
IPC分类号： H03K
CPC分类号： H03K23/68 , H03K23/546
摘要：本發明提供一種除頻器及除頻器設計之方法，將一原始脈波以一n.5倍除頻來形成一目標脈波，首先界定一除頻倍率為n.5＊2，接著根據該除頻倍率，產生對應該原始脈波之一第一觸發相位與一第二觸發相位，然後分別選擇一正除頻電路或一負除頻電路方式，並決定複數個脈波產生器之初始值設定方式，以分別產生一第一目標脈波與第二目標脈波，最後根據第一目標脈波與第二目標脈波，產生目標脈波。
简体摘要：本发明提供一种除频器及除频器设计之方法，将一原始脉波以一n.5倍除频来形成一目标脉波，首先界定一除频倍率为n.5＊2，接着根据该除频倍率，产生对应该原始脉波之一第一触发相位与一第二触发相位，然后分别选择一正除频电路或一负除频电路方式，并决定复数个脉波产生器之初始值设置方式，以分别产生一第一目标脉波与第二目标脉波，最后根据第一目标脉波与第二目标脉波，产生目标脉波。

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