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    • 1. 发明授权
    • 단위 셀 패널로 이루어지는 플라즈마 디스플레이 패널
    • 等离子体显示面板保持细胞面板单元
    • KR101080224B1
    • 2011-11-08
    • KR1020090067521
    • 2009-07-23
    • 부산과학기술대학교 산학협력단
    • 홍성일하영철주철완
    • H01J11/20
    • 본발명은각각전극선이형성되는상판과하판사이에혼합기체를주입하고, 전압을가할때 발생하는플라즈마를이용하여화상을표시하는플라즈마디스플레이패널을구성함에있어서, 대형진공챔버와같은생산설비를적용하지않으면서플라즈마디스플레이를더욱용이하게대형화할수 있도록하기위한단위셀 패널로이루어지는플라즈마디스플레이패널을제공한다. 본발명에따른플라즈마디스플레이패널(10)은가로및 세로가정해진길이로분할되어형성되는다수개의단위셀 패널(20)로이루어진다. 그리고, 다수개의단위셀 패널(20) 각각은가로및 세로가정해진길이로형성되는상판(12)과하판(14)의각 전극선(13, 15)이외측방향으로돌출되어형성되므로써, 다수개의단위셀 패널(20)이격자의형태로접속되어원하는크기의디스플레이패널을형성하도록한다. 본발명에의한단위셀 패널로이루어지는플라즈마디스플레이패널은일반적으로적용되는플라즈마디스플레이패널의제조공정을통해수율및 양산측면에서가장유리한크기의패널을기본단위셀 패널로설정한다. 이기본단위셀 패널간의상판, 하판의전극선을인접단위셀 패널과연결하여원하는크기의플라즈마디스플레이패널을생산할수 있으므로, 설비투자에따른비용부담을경감시키면서더욱용이하게대형화된플라즈마디스플레이패널을제공할수 있는장점이있다.
    • 4. 发明公开
    • 고압 인버터의 출력 전압 안정화 회로
    • 用于稳定高压逆变器输出电压的电路
    • KR1020100080981A
    • 2010-07-14
    • KR1020090000216
    • 2009-01-05
    • 부산과학기술대학교 산학협력단
    • 홍성일하영철
    • H02M7/48H02M7/515
    • PURPOSE: An output voltage stabilizing circuit of a high voltage inverter is provided to improve durability by preventing the malfunction of a load due to the fine variation of the output voltage of a high voltage inverter. CONSTITUTION: The output voltage of a first transistor(1) is inputted to a low voltage AC circuit. The output voltage of a low voltage AC circuit is inputted to a second transistor(2). A drain terminal of a third transistor(3) is connected to the drain terminal of the first transistor. The DC power is inputted to a source terminal of the third transistor. The drain terminal of a fourth transistor(4) is connected to the source terminal of the second transistor. The drain terminal of a fifth transistor(5) is connected to the source terminal of the first transistor. The source terminal of the fifth transistor is connected to the drain terminal of the fourth transistor and the source terminal of the second transistor.
    • 目的:提供高压逆变器的输出稳压电路,通过防止由于高电压逆变器的输出电压的微小变化引起的负载故障,提高耐久性。 构成:将第一晶体管(1)的输出电压输入到低压交流电路。 低电压AC电路的输出电压被输入到第二晶体管(2)。 第三晶体管(3)的漏极端子连接到第一晶体管的漏极端子。 直流电力被输入到第三晶体管的源极端子。 第四晶体管(4)的漏极端子连接到第二晶体管的源极端子。 第五晶体管(5)的漏极端子连接到第一晶体管的源极端子。 第五晶体管的源极端子连接到第四晶体管的漏极端子和第二晶体管的源极端子。