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1. 发明公开

KR1020010007030A 지연 로크 루프의 또는 이와 관련한 것의 향상 无效
标题翻译：延迟锁定和改进
公开(公告)号：KR1020010007030A
公开(公告)日：2001-01-26
申请号：KR1020000022822
申请日：2000-04-28
申请人： 로크 마노 리서치 리미티드
发明人： 챔버스피터 , 헐버트안토니피터
IPC分类号： H04B1/7085
CPC分类号： H04J13/12 , H04L7/0029
摘要： PURPOSE: A delay lock loop and an improvement of the same are provided to form an arrangement for selecting one particular code as a basis of despreading. CONSTITUTION: An early and rate data lock loop(100) has a wanted code generator(36) for providing the first code despreading a prompt signal extracted from a data input signal(40) and an absent code generator(110) for providing the second code despreading the early and the rate codes. The despread signals(48',50,52') are transmitted to accumulation units(22,24,26). The energy values for the early and the rate signals are transmitted to energy measurement units(28,30). A comparator(32') compares outputs(60'62') from the energy measurement units(28,30) to provide a timing error signal(64') for controlling an interpolation circuit(38) receiving an input data signal(40).
摘要翻译：目的：提供延迟锁定循环及其改进以形成用于选择一个特定代码作为解扩的基础的布置。构成：早期和速率数据锁定循环（100）具有需要的代码生成器（36），用于提供从数据输入信号（40）提取的提示信号的第一代码和不存在的代码生成器（110），用于提供第二代码代码解码早期和速率代码。解扩信号（48'，50,52'）被发送到累积单元（22,24,26）。早期和速率信号的能量值传输到能量测量单元（28,30）。比较器（32'）比较来自能量测量单元（28,30）的输出（60'62'），以提供定时误差信号（64'），用于控制接收输入数据信号（40）的内插电路（38）。

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