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    • 9. 发明专利
    • AD変換回路
    • JP2020043408A
    • 2020-03-19
    • JP2018167657
    • 2018-09-07
    • 新日本無線株式会社
    • 佐藤 裕樹石原 昇
    • H03K3/03H03K5/26
    • 【課題】回路規模が小さくて済み低消費電流を実現でき高分解能化も可能になったAD変換回路を提供する。 【解決手段】遅延回路17をループ内に備え第1パルス信号を発振する第1リング発振回路10と、遅延回路27をループ内に備え第2パルス信号を発振する第2リング発振回路20と、第1及び第2リング発振回路10、20の発振動作を同時に開始させるトリガ信号が入力するトリガ入力端子101と、第1パルス信号の“H”エッジで第2パルス信号をラッチするラッチ回路30と、ラッチ回路30のラッチした結果に応じて第1パルス信号の通過を制御するNOR回路40と、NOR回路40を通過した第1パルス信号をカウントするカウンタ60を備える。ラッチ回路30は、第1パルス信号のエッジで第2パルス信号をラッチした結果が直前にラッチした結果から変化したときNOR回路40を遮断する。遅延回路27は、所定の物理現象の検出結果により値が変化する遅延素子を有する。 【選択図】図1