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    • 1. 发明专利
    • 半導体装置
    • 半导体器件
    • JP2015230959A
    • 2015-12-21
    • JP2014116279
    • 2014-06-04
    • ルネサスエレクトロニクス株式会社
    • 古橋 隆寿松本 雅弘
    • H01L27/04H01L21/3205H01L21/768H01L23/522H01L27/14H01L27/146H01L21/822
    • H01L23/53223H01L23/53219H01L27/14636H01L27/14643H01L27/0629H01L2924/0002
    • 【課題】容量素子を有する半導体装置の信頼性を向上させる。 【解決手段】半導体基板上の層間絶縁膜L3上に配線M3および容量素子CPが形成され、層間絶縁膜L3上に配線M3および容量素子CPを覆うように層間絶縁膜L4が形成されている。容量素子CPは、層間絶縁膜L3上に形成された下部電極LEと、層間絶縁膜L3上に下部電極LEの少なくとも一部を覆うように形成された上部電極UEと、下部電極LEと上部電極UEとの間に介在する容量絶縁膜YZとを有しており、上部電極UEと配線M3とは、同層の導電膜パターンにより形成されている。下部電極LEの下にプラグP3aが配置されて下部電極LEと電気的に接続され、下部電極LEに平面視で重ならない部分の上部電極UE上にプラグP4aが配置されて上部電極UEと電気的に接続され、配線M3上にプラグP4cが配置されて配線M3と電気的に接続されている。 【選択図】図24
    • 要解决的问题:为了提高具有电容元件的半导体器件的可靠性。解决方案:在半导体上的层间绝缘膜L3上形成导线M3和电容元件CP,并且层间绝缘膜 L4形成在层间绝缘膜L3上,以覆盖线M3和电容元件CP。 电容元件CP具有形成在层间绝缘膜L3上的下电极LE,形成在层间绝缘膜L3上的上电极UE,以覆盖下电极LE的至少一部分,并且电容绝缘 膜YZ插入在下电极LE和上电极UE之间。 上电极UE和线M3由同一层中的导电膜图案形成。 插头P3a设置在下部电极LE的下方并电连接到下部电极LE。 插头P4a在平面图中与下电极LE不重叠的部分设置在上电极UE上,并与上电极UE电连接。 插头P4c设置在线M3上,并与导线M3电连接。