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    • 32. 发明专利
    • Partially programmable pipeline fabric using global configuration bus
    • JP2005539293A
    • 2005-12-22
    • JP2004529378
    • 2003-08-14
    • カーネギー−メロン ユニバーシティCarnegie−Mellon University
    • シュミット,ハーマン
    • G06F9/38G06F15/78G06F15/80
    • G06F9/38G06F9/3897G06F15/7867
    • 仮想ストライプと物理ストライプをパイプライン又はリング構造に連繋する方法であって、第1の仮想ストライプ群を2以上の物理ストライプと連繋し、第1の仮想ストライプ群とは繋がっていない第2の仮想ストライプ群を2以上の追加の物理ストライプと連繋することを含んでいる。 本発明はまた、グローバルよりも少ないが、純粋なローカルではないアソシエーションに基づいて、複数のプロセッシングエレメントをコンフィギュアする方法を対象とする。 本発明のコンフィギュレーション方法は、複数のプロセッシングエレメントに配置されたデバイスの中で実行されることができる。 本発明の方法は、2以上の物理ストライプのどちらかを、第1の仮想ストライプ群の中の仮想ストライプでコンフィギュアし、2以上の追加の物理ストライプのどちらかを、第1の仮想ストライプ群とは繋がっていない第2の仮想ストライプ群の中の仮想ストライプでコンフィギュアすることを含んでいる。 本発明はまた、リコンフィギュラブルデバイスを対象とするもので、該デバイスは、コントローラと、該コントローラに応答可能なメモリデバイスと、複数のストライプに配置された複数のプロセッシングエレメントと、ストライプ内のプロセッシングエレメントを接続するための複数のストライプ内相互接続と、1つのストライプの出力を、1つだけの他のストライプに接続するための複数のローカル・インターストライプ接続と、1以上であるが全部よりは少ない数の物理ストライプをメモリに接続するための複数のグローバル・インターストライプと、各々が1以上の物理ストライプに接続された入力バス及び出力バスと、を具えている。