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    • 4. 发明公开
    • Système de traitement de données multiprocesseur à bus actif reconfigurable
    • Multiprozessor-Datenverarbeitungssystem mit einem rekonfigurierbaren aktiven Bus。
    • EP0433142A1
    • 1991-06-19
    • EP90403481.6
    • 1990-12-06
    • UNIVERSITE DE BRETAGNE OCCIDENTALE, ( BREST)
    • Pottier, Bernard
    • G06F15/16
    • G06F15/17343
    • L'invention concerne un système de traitement de données multiprocesseur à bus actif reconfigurable.
      Le système comprend au moins deux modules interconnectables (10A, 10B). Un module comprend une unité de traitement de données (20A), une unité de mémorisation (30A) et un socle (40A) partageant un bus système (50A). Le socle (40A) comprend un premier moyen interface d'entrée/sortie (41A) relié au bus système (50A), des seconds moyens interface d'entrée/sortie (42A, 44A) reliés à un bus d'interconnexion de modules (60) pour relier au moins deux modules adjacents (10A, 10B), des moyens de synthèse d'une pluralité de cicuits opératoires (43A) et des moyens de création et de commutation de chemins de données (43A). Le socle (40A) utilise la technologie des tableaux de cellules logiques (LCA).
      L'invention trouve notamment une application dans les systèmes de traitement de données multiprocesseurs fonctionnant en parallèle.
    • 该系统包括至少两个可互连模块(10A,10B)。 模块包括数据处理单元(20A),存储单元(30A)和共享总线系统(50A)的底座(40A)。 底座(40A)包括连接到总线系统(50A)的第一输入/输出接口装置(41A),连接到模块互连总线(60)的第二输入/输出接口装置(42A,44A),用于连接至少两个 相邻模块(10A,10B),合成多个操作电路(43A)的装置以及创建和切换数据路径(43A)的装置。 底座(40A)采用逻辑单元格(LCA)技术。 本发明尤其在并行操作的多处理器数据处理系统中发现。