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1. 发明公开

EP4325705A3 METHOD FOR OPERATING A POWER CONVERTER 审中-实审
公开(公告)号：EP4325705A3
公开(公告)日：2024-05-15
申请号：EP24150636.9
申请日：2019-06-14
申请人： Infineon Technologies Austria AG
发明人： BORTIS, Dominik , KOLAR, Johann , AZURZA ANDERSON, Jon
IPC分类号： H02M1/42 , H02M7/487 , H02M7/217 , H02M1/12 , H02M1/00
CPC分类号： H02M1/4216 , H02M1/12 , H02M7/487 , H02M7/217 , Y02B70/10 , H02M1/0048 , H02M1/0054 , H02M1/0077 , H02M1/007
摘要： A method for operating a power converter is enclosed. The method includes operating the power converter (10) in a reduced switching mode. The power converter includes three input nodes (A, B, C) each configured to receive a respective one of three input voltages (V1, V2, V2) two DC link nodes (X, Z) configured to provide a DC link voltage (V4), and a midpoint (Y) coupled to each of the two DC link nodes (X, Z); three inductors (L1, L2, L3) each connected to a respective one of the three input nodes (A, B, C); and a rectifier bridge (1) comprising three bridge legs (11, 12, 13) each coupled to a respective one of the three inputs (A, B, C) through a respective one of the three inductors (L1, L2, L3) and connected to the respective one of the three inductors (L1, L2, L3) at a respective switch node (A', B', C'), wherein each of the three bridge legs (11, 12, 13) is connected to the two DC link nodes (X, Z) and the midpoint (Y), and comprises at least one electronic switch (Q1, Q2, Q3). Operating the power converter in the reduced switching mode includes deactivating at least one of the three bridge legs (11, 12, 13) for a predefined time period.

2. 发明公开

EP4358379A1 VERFAHREN ZUM BETREIBEN EINER DUALEN AKTIVBRÜCKE MITTELS EINER ELEKTRONISCHEN RECHENEINRICHTUNG, COMPUTERPROGRAMMPRODUKT, COMPUTERLESBARES SPEICHERMEDIUM, ELEKTRONISCHE RECHENEINRICHTUNG SOWIE DUALE AKTIVBRÜCKE 审中-公开
公开(公告)号：EP4358379A1
公开(公告)日：2024-04-24
申请号：EP22202926.6
申请日：2022-10-21
申请人： Siemens Aktiengesellschaft
发明人： Blum, Manuel , Simon, Alexander , von den Hoff, Daniel
IPC分类号： H02M1/00 , H02M3/335
CPC分类号： H02M3/33584 , H02M1/0054 , H02M1/0058
摘要： Die Erfindung betrifft ein Verfahren zum Betreiben einer dualen Aktivbrücke (10), wobei die duale Aktivbrücke (10) mit zumindest einer primärseitigen und einer sekundärseitigen Vollbrücke (12, 14) bereitgestellt wird, wobei zwischen der primärseitigen und der sekundärseitigen Vollbrücke (12, 14) eine Transformatoreinrichtung (16) bereitgestellt wird, und wobei die Vollbrücken (12, 14) mittels einer elektronischen Recheneinrichtung (18) angesteuert werden, wobei die primärseitige und die sekundärseitige Vollbrücke (12, 14) mit jeweiligen Halbbrücken (20, 22, 24, 26) bereitgestellt werden, wobei in einem ersten Takt (30) zuerst die erste und die dritte Halbbrücke (20, 24) geschaltet werden bevor die zweite und vierte Halbbrücke (22, 26) geschaltet werden und in einem zweiten Takt zuerst die zweite und die vierte Halbbrücke (22, 26) geschaltet werden, bevor die erste und die dritte Halbbrücke (20, 26) geschaltet werden. Ferner betrifft die Erfindung ein Computerprogrammprodukt, ein computerlesbares Speichermedium, eine elektronische Recheneinrichtung (18) sowie eine duale Aktivbrücke (10).

3. 发明授权

EP3993252B1 POWER CONVERTER CONTROL SYSTEM USING FIXED PULSE PATTERN, AND CONTROL METHOD 有权
公开(公告)号：EP3993252B1
公开(公告)日：2024-07-24
申请号：EP20844730.0
申请日：2020-03-30
IPC分类号： H02M7/483 , H02M7/5387 , H02M1/12
CPC分类号： H02M1/12 , H02M7/53873 , H02M7/483 , H02M1/0054 , Y02B70/10

4. 发明公开

EP4380035A1 CONTROL APPARATUS FOR AN ARCP INVERTER 审中-公开
公开(公告)号：EP4380035A1
公开(公告)日：2024-06-05
申请号：EP22210534.8
申请日：2022-11-30
申请人： ABB SCHWEIZ AG
发明人： Leppänen, Veli-Matti , Muszynski, Peter
IPC分类号： H02M7/5395 , H02M1/00 , H02M7/487
CPC分类号： H02M7/487 , H02M7/5395 , H02M1/0012 , H02M1/0016 , H02M1/0054
摘要： A control apparatus for ARCP (Auxiliary Resonant Commuted Pole) power inverters comprises a modulator and a modulation control (70). The modulator is configured to carry out a commutation of an ARCP inverter by selectively using a Continuous PWM (CPWM) modulation and a Discontinuous PWM (DPWM) modulation. The modulation control (76) is configured to dynamically select (76) either the CPWM modulation or the DPWM modulation in a such a way that switching losses of the ARCP inverter are reduced while a failure of the commutation of the ARCP inverter due to a neutral point voltage unbalance of the ARCP inverter is avoided.

5. 发明公开

EP4362309A1 METHOD FOR BOOSTING CURRENT COMPENSATION IN AUXILIARY RESONANT COMMUTATED POLE INVERTER (ARCPI) WITH SATURABLE INDUCTOR 审中-公开
公开(公告)号：EP4362309A1
公开(公告)日：2024-05-01
申请号：EP23206434.5
申请日：2023-10-27
申请人： ABB SCHWEIZ AG
发明人： AELOIZA, Eddy C. , SHI, Yuxiang , MANDIC, Goran , CHEN, Weiqiang
IPC分类号： H02M7/48 , H02M7/487 , H02M1/00 , G06F1/03
CPC分类号： H02M7/4811 , H02M7/487 , H02M1/0012 , H02M1/0054 , G06F1/03 , H02M1/0064
摘要： A method for an auxiliary device of an auxiliary resonant commutated pole inverter (ARCPI) to determine a boosting time of the ARCPI is provided. The auxiliary device includes an auxiliary switch path that uses a resonant inductor with at least one saturable inductor. The method includes: calculating, by a processor of the auxiliary device, a first boosting time in the auxiliary switch path based on a theoretical resonance inductance and a voltage that are applied to the resonant inductor; determining, by the processor, a second boosting time in the auxiliary switch path based on a look-up table; and determining, by the processor, the boosting time in the auxiliary switch path based on the first boosting time and the second boosting time. The method further includes controlling, by the processor, boosting current of the ARCPI based on the boosting time in the auxiliary switch path.

6. 发明公开

EP4352764A2 A WIRING DEVICE INCLUDING A PLANAR TRANSFORMER 审中-实审
公开(公告)号：EP4352764A2
公开(公告)日：2024-04-17
申请号：EP22821052.2
申请日：2022-06-09
申请人： Hubbell Incorporated
发明人： GELLIS, David, Samuel
IPC分类号： H01F27/28 , H05K1/14
CPC分类号： H02M3/33507 , H02M3/003 , H02M1/0054 , H02J7/0042 , H02J2207/2020200101 , H02J2207/3020200101 , H02J7/0013

7. 发明公开

EP4422056A1 VORRICHTUNG UND VERFAHREN ZUR REDUKTION VON SCHALTVERLUSTEN IN LEISTUNGSELEKTRONISCHEN WANDLERN 审中-公开
公开(公告)号：EP4422056A1
公开(公告)日：2024-08-28
申请号：EP24000014.1
申请日：2024-02-05
申请人： Finepower Gmbh
发明人： Heiland, Georg , Jäger, Karl
IPC分类号： H02M3/158 , H02M7/12 , H02M3/00 , H02M1/00 , H02M1/42 , H02M1/34
CPC分类号： H02M3/158 , H02M7/125 , H02M3/01 , H02M1/4225 , H02M1/4233 , H02M1/4241 , H02M1/0058 , H02M1/0054 , H02M1/34 , H02M1/342
摘要： Vorgeschlagen wird eine Vorrichtung zur Reduktion der Schaltverluste von Halbleiterbauelementen in leistungselektronischen Wandlern. Die Vorrichtung weist zumindest vier Halbleiterbauelemente sowie eine Induktivität auf und wird mit einer leistungselektronischen Schaltung zur Energiewandlung verbunden, wobei zumindest zwei der vier Halbleiterbauelemente als aktive Schaltelemente ausgeführt sind. Dabei werden ein erstes und ein zweites aktives Halbleiterbauelement und die Induktivität erfindungsgemäß elektrisch miteinander in Reihe geschaltet, wodurch sich eine erste Reihenschaltung ergibt, welche dann elektrisch parallel mit zumindest einer Induktivität der leistungselektronischen Schaltung, insbesondere einer Speicherinduktivität in Hochsetzsteller- oder Tiefsetzstellerschaltungen, verbunden wird. Leistungselektronische Schaltungen, mit welchen die vorgeschlagene Vorrichtung in besonders vorteilhafter Weise verbunden werden kann, sind beispielweise Hochsetzsteller- oder Tiefsetzstellerschaltungen, oder eine Kombination aus diesen Schaltungen, wie beispielsweise ein 4-Quadranten-Steller. Die vorgeschlagene Vorrichtung kann aber in unterschiedlichen Ausgestaltungen, welche ebenfalls offenbart werden, auch in resonanten Schaltungstopologien, wie beispielsweise Serienresonanz- oder Parallelresonanzschaltungen, oder einer Kombination aus diesen, eingesetzt werden, wenn diese in ungünstigen Betriebspunkten betrieben werden müssen, beispielsweise unterresonant angesteuert werden. Insbesondere kann die vorgeschlagene Vorrichtung auch in sogenannten LLC-Topologien sowie in phasengesteuerten Spannungswandlertopologien, wie der sogenannten Phase-Shifter-Topologie oder der Dual-Active-Bridge-Topologie, eingesetzt werden.

8. 发明授权

EP3748838B1 MULTI-LEVEL INVERTER TOPOLOGIES FOR MEDIUM- AND HIGH-VOLTAGE APPLICATIONS 有权
公开(公告)号：EP3748838B1
公开(公告)日：2024-08-21
申请号：EP20177526.9
申请日：2020-05-29
IPC分类号： H02M7/487 , H02M7/483 , H02M7/49 , H02M1/00
CPC分类号： H02M7/487 , H02M7/49 , Y02B70/10 , H02M1/0054 , H02M1/0074 , H02M1/008 , H02M1/0095 , H02M7/4837

9. 发明授权

EP3806314B1 UMRICHTER FÜR EIN WECHSELSTROMNETZ 有权
公开(公告)号：EP3806314B1
公开(公告)日：2024-06-26
申请号：EP20200443.8
申请日：2020-10-07
IPC分类号： H02M7/48 , H02M7/493 , H02M1/088 , H02M7/487 , H02M1/00
CPC分类号： H02M7/48 , H02M7/493 , H02M1/088 , H02M7/487 , H02M1/0054 , Y02B70/10

10. 发明公开

EP4387100A1 VOLTAGE-SOURCE GATE DRIVE HAVING SHUNT CAPACITORS AND SHUNT RESISTORS 审中-公开
公开(公告)号：EP4387100A1
公开(公告)日：2024-06-19
申请号：EP23216422.8
申请日：2023-12-13
申请人： Qorvo US, Inc.
发明人： ZHU, Ke
IPC分类号： H03K17/0412 , H03K17/041 , H02M1/08 , H03K17/12
CPC分类号： H03K17/04123 , H02M1/08 , H03K17/122 , H02M1/088 , H02M1/44 , H02M1/0029 , H02M1/0054
摘要： Disclosed is a device that decouples switching speed and gate delay time using an improved voltage-source gate driver. A shunt capacitor and a shunt resistor are connected in series to parallel across gate resistors of a voltage-source gate driver. The shunt capacitor and shunt resistor allow the gate delay and switching speed effect of the gate resistors to be decoupled. The shunt capacitor provides an initial high charge voltage and discharge gate current to reduce gate delay time. The shunt resistor modifies the effective gate resistance, which affects the gate current and the resulting switching speed. Shunt capacitor and shunt resistor values are determined to achieve the desired switching speed control with minimum gate delay time. When multiple power devices are paralleled, a common gate resistor, a shunt resistor and a capacitor combination is used. Each power device is also provided a respective split-gate resistor.
It is intended that, when published, the abstract be accompanied by Figure 1.

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